设计应用

MATLAB 算法面向 FPGA 的浮点定点转换

AccelChip 公司(最近已被赛灵思公司收购)最近所做的调查显示,53% 的回答者认为浮点定点转换是在 FPGA 上实现算法时最困难的地方(图 1)。   虽然 MATLAB 是一种强大的运算开发工具,但其许多优点却在浮点定点...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:2734 关键词:FPGA

基于 FPGA 的 MPEG-4 编解码器

您是否曾想在您的 FPGA 设计中使用先进的视频压缩技术,却发现实现起来太过复杂?现在您无需成为一名视频就能在您的系统中使用视频压缩。赛灵思新推出的 MPEG-4 编码器/解码器核可以帮助您满足视频压缩需求。   视...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:1611 关键词:FPGA

使用 PlanAhead Design 工具提高设计性能

PlanAhead 软件提供了一种解决方案   越来越多的客户在赛灵思® PlanAhead™ 设计分析工具提供的层次化设计方法学中找到解决方案。PlanAhead 软件为 FPGA 设计流程增加了可视性和控制。通过解决物理方面(...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:2236

设计性能:物理综合与优化

这些技巧可帮助您利用实现工具获得功效。   工艺技术的发展极大地提高了 FPGA 器件的密度。多个赛灵思® VirtexTM 系列中都包含了超过 1 百万系统门的器件。这种器件密度的提高和 300 mm 晶圆片的使用,为 FPGA...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:1284

面向FPGA的ESL工具

逻辑设计领域正在发生根本变化。新一代设计工具帮助软件开发者将其算法表达直接转换成硬件,而无需学习传统的硬件设计技术。   这些工具及相关设计方法学一起被归类为电子系统级 (ESL) 设计,广泛地指从比目前主流...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:1693 关键词:FPGA

基于CPLD的双屏结构液晶控制器的研究与设计

1.引言   随着集成电路技术的发展, 在现代电子设计中,可编程逻辑器件的运用越来越多,原因在于其规模大,体积小,功能强,价格便宜。CPLD可擦写上万次,使得硬件设计像软件设计一样灵活方便。Verilog HDL语言作为硬件...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:1644 关键词:PLD控制器

基于CPLD的LED点阵显示控制器

在系统可编程技术(ISP—In System Programming)及其在系统可编程系列器件,是90年代迅速发展起来的一种新技术和新器件。现场可编程器件(FPGA和CPLD)等ISP器件无须编程器,利用器件厂商提供的编程套件,采用自顶...

分类:EDA/PLD/PLC 时间:2007-06-14 阅读:3278 关键词:LEDPLD控制器

日本:NEC开发成功1亿门单元基LSI

NEC电子设备部开发成功CB-90系列单元基LSI。最小特征尺寸是0.09μm,采用栅长0.06μm的CMOS方法和铜金属连线技术制造。准备制造的三种单元基LSI是:高速型CB-90H、高集成度型CB-90M和低功耗型CB-90L。它们的内部工作...

分类:EDA/PLD/PLC 时间:2007-06-08 阅读:1286

IDE RAID控制器实现支持6通道功能

从事ASIC设计的韩国Aralion公司最近推出了一种支持RAID5的6通道ATA133RAID控制器。这种型号为ARS0304S的控制器支持6个可与任何一种64/32位或66/33MHzPCI数据总线连接的独立IDE通道。这种控制器芯片包含有一个

分类:EDA/PLD/PLC 时间:2007-06-08 阅读:1529 关键词:控制器

ACEX 1K系列CPLD配置方法探讨

1 引言 ACEX 1K 系列器件是Altera 公司近期推出的新型CPLD 产品。该器件基于SRAM,结合查找表(LUT)和嵌入式阵列块(EAB)提供了高密度结构,可提供10 000 到100 000 可用门,每个嵌入式阵列块增加到16 位宽...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:1823 关键词:PLD

使用PLD的三相正弦波发生器

使用本设计实例中的电路可以开发并实现一台轻型、无噪声、廉价的三相、60Hz正弦波电压发生器。尽管其目标是用于测试电源控制器的电路,但它也可以用于需要具有120°相对相位差的三个正弦波的其它应用。IC1是一只22V1...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:2477 关键词:PLD发生器

自动断电的CPLD

今天,大多数的CPLD(复杂可编程逻辑器件)都采用可减少功耗的工作模式,但当系统未使用时,应完全切断电源以保存电池能量,从而实现很多设计者的节能目标。图1描述了如何在一片CPLD 上增加几只分立元件,实现一个节...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:2372 关键词:PLD

基于视频解码芯片与CPLD的实时图像采集系统

图像采集是实时图像处理的重要步骤。目前,图像传感器件主要有CCD(Charge Coupled Device)和CMOS(Complementary Metal Oxide Scmiconductor)。CCD技术现在已经非常成熟,CCD摄像头仍然是高端应用的器件。它输出的模...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:2330 关键词:PLD芯片

如何采用FPGA协处理器实现算法加速

当今的设计工程师受到面积、功率和成本的约束,不能采用GHz级的计算机实现嵌入式设计。在嵌入式系统中,通常是由相对数量较少的算法决定的运算需求。使用设计自动化工具可以将这些算法快速转换到硬件协处理中。然后...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:1619 关键词:FPGA

分页烧写Flash的多页程序并行自举方法

TI公司的DSP芯片TMS320Vc5410(简称5410)是性能卓越的低功耗定点DSP,在嵌入式系统中有着广泛的应用。5410没有自带的片上非易失性存储器,因此需要外部的非易失性存储介质,如EPROM或FLASH,来存储程序和数据。5410片...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:1803

分页烧写Flash多页程序并行自举方法

TI公司的DSP芯片TMS320Vc5410(简称5410)是性能卓越的低功耗定点DSP,在嵌入式系统中有着广泛的应用。5410没有自带的片上非易失性存储器,因此需要外部的非易失性存储介质,如EPROM或Flash,来存储程序和数据。5410片...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:2319

Cadence逻辑设计解决方案

随着设计复杂度的提高和逻辑设计工艺尺寸的缩小,前端设计人员面临着越来越多的设计挑战,这些挑战为已经非常紧张的设计工期带来了更多的风险: 器件对低功耗的需求、日益扩大的设计与验证之间的脱节、以及逻辑-物理...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:1374

基于e语言的验证自动化系统

验证技术的发展 在目前的集成电路设计中,芯片的规模和复杂程度正呈指数增加,为保证所设计芯片功能的正确性,需要花费比以往更多的时间和人力,困难度大幅增加。而且,目前的功能验证能力已经远远落后于设计...

分类:EDA/PLD/PLC 时间:2007-06-04 阅读:1655

基于CPLD和单片机的任意波形发生器设计

引言 在电子工程设计与测试中,常常需要一些复杂的、具有特殊要求的信号,要求其波形可任意产生,频率方便可调。通常的信号产生器难以满足要求,市场上出售的任意信号产生器价格昂贵。结合实际需要,我们设...

分类:EDA/PLD/PLC 时间:2007-06-03 阅读:2585 关键词:PLD单片机发生器

基于PL3200的自动抄表系统采集器的设计

引言 随着电力市场的不断扩大,当前大量存在的人工抄表这种费时费力效率低下的方式已远不能满足现代化管理的需要。为了解决此问题,提高用电管理的自动化水平, 应采用自动抄表系统,不但可以节约劳动力、提高...

分类:EDA/PLD/PLC 时间:2007-06-03 阅读:1809

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