几个硬件研发面试经典问题（转贴）

作者：wxz008　栏目：IC设计

几个硬件研发面试经典问题（转贴）
汉王笔试

下面是一些基本的数字电路知识问题，请简要回答之。
a) 什么是Setup 和Holdup时间？
b) 什么是竞争与冒险现象？怎样判断？如何消除？
c) 请画出用D触发器实现2倍分频的逻辑电路？
d) 什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？
e) 什么是同步逻辑和异步逻辑？
f) 请画出微机接口电路中，典型的输入设备与微机接口逻辑示意图（数据接口、控制接

口、所存器/缓冲器）。
g) 你知道那些常用逻辑电平？TTL与COMS电平可以直接互连吗？
2、可编程逻辑器件在现代电子设计中越来越重要，请问：
a) 你所知道的可编程逻辑器件有哪些？
b) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑。
3、设想你将设计完成一个电子电路方案。请简述用EDA软件（如PROTEL）进行设计（包

括原理图和PCB图）到调试出样机的整个过程。在各环节应注意哪些问题？

飞利浦－大唐笔试归来

1，用逻辑们和CMOS电路实现ab+cd
2. 用一个二选一mux和一个inv实现异或
3. 给了reg的setup,hold时间，求中间组合逻辑的delay范围。
4. 如何解决亚稳态
5. 用verilog/vhdl写一个fifo控制器
6. 用verilog/vddl检测stream中的特定字符串

信威dsp软件面试题～

)DSP和通用处理器在结构上有什么不同，请简要画出你熟悉
的一种DSP结构图

2)说说定点DSP和浮点DSP的定义（或者说出他们的区别）

3）说说你对循环寻址和位反序寻址的理解

4）请写出【－8，7】的二进制补码，和二进制偏置码。
用Q15表示出0.5和－0.5

扬智电子笔试

第一题：用mos管搭出一个二输入与非门。
第二题：集成电路前段设计流程，写出相关的工具。
第三题：名词IRQ,BIOS,USB,VHDL,SDR
第四题：unix 命令cp -r, rm,uname
第五题：用波形表示D触发器的功能
第六题：写异步D触发器的verilog MODULE
第七题：What is PC Chipset?
第八题：用传输门和倒向器搭一个边沿触发器
第九题：画状态机，接受1，2，5分钱的卖报机，每份报纸5分钱。

2楼：	>>参与讨论
作者：吴明诗于 2005-8-29 18:25:00 发布：不是很难呀，一般

3楼：

>>参与讨论

作者： wxz008 于 2005-8-31 11:31:00 发布：

哪位朋友能给出标准答案吗谢了
这些问题可能对有相关经验的人来说不难
可对于从别的行业转过来的新手来说就会有一点难度

我能回答出大部分问题
但是有一些是不太敢确定的

不知道哪位朋友能给出“标准答案”吗？
可能会包含有一些经验的标准答案

谢了，先

4楼：	>>参与讨论
作者： water2005 于 2005-8-31 19:09:00 发布：菜鸟先问楼主能回答一下：什么是setup和holdup时间吗？什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？什么是同步逻辑和异步逻辑？

5楼：	>>参与讨论
作者： pyle 于 2005-8-31 19:36:00 发布：要准确地回答出来还真不容易

6楼：

>>参与讨论

作者： wxz008 于 2005-8-31 21:43:00 发布：

楼主也是菜鸟啊
这里有一些我在别的地方查到的答案
但也不敢确定它一定正确

a) 什么是Setup 和Holdup时间？
   setup数据先于时钟的最小时间
   holdup数据有效保持时间
b) 什么是竞争与冒险现象？怎样判断？如何消除？
   电路时延造成的有用逻辑组合外的干扰信号
   判断电路是否存在竞争-冒险现象的一种方法是将电路输出函数画成卡诺图分析增加冗余项的可以消除电路的冒险
c) 请画出用D触发器实现2倍分频的逻辑电路？
   /Q接D，CK输入，Q输出。
d) 什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？
   在工程实践中，有时需要将几个门的输出端并联使用，以实现与逻辑，称为线与逻辑集电极开路门
e) 什么是同步逻辑和异步逻辑？
   电路中的存储器件为时钟控制触发器，各触发器共用同一时钟信号为同步逻辑电路中的存储器件可以是时钟控制触发器、非时钟控制触发器或延时器件，电路没有统一的   时钟信号为异步逻辑。

g) 你知道那些常用逻辑电平？TTL与COMS电平可以直接互连吗？
   不可以，TTL与COMS相互之间的电源电压和输入、输出电平及电流不相同，它们之间的连接必须通过电平转换或电流转换电路

7楼：	>>参与讨论
作者：牧野流于 2005-9-30 21:23:00 发布：收获颇丰啊呵呵谢谢

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