基于16位DSP的PROFIBUS-DP从站设计

...器；4个独立可编程的I/O引脚，1个输出引脚XF和1个输入引脚B IO；JTAG扫描仿真接口，用来实现在线仿真测试。硬件系统构成图2 为PROFIBUS-DP 从站的硬件框图，系统由MAX125、TMS320F206、SPC3、EPM7128SQC100、DS1286、HK1225、外部RAM以及地址拨码开关组成一个PROFIBUS-DP从站，用于铁路信号电源故障的诊断。三相交流电压和电流信号经MAX125同步采样，DSP通过一定的算法进行数据处理和数...
采用DSP的铁路道口图像监控系统设计

...期可执行8条32位的指令；超长指令字结构，支持32位、16位、8位数据；有四个主DMA通道和一个DMA辅助通道，通过32位的EMIF接口允许外接不同的设备，包括SBSRAM、SDRAM、ASRAM、FLASH以及FIFO等。EPM7128SQC100的内部具有逻辑阵列块(LAB)、宏单元、扩展乘积项(共享和并联)、可编程连线阵列(PIA)及I／O控制块。它提供低功耗工作模式，可使用户定义的信号路径或整个器件工作在低功耗状态。内...
基于DSP和CPLD的液晶模块的设计

...16×16和 32×32的乘加操作，可以方便的进行FFT、FIR滤波等数字信号处理算法；具有多达 56个通用、双向数字 I/O引脚，能方便的实现各种 I/O操作。 CPLD 采用 Altera公司 MAX7000系列的 EPM7128SQC100，3.3V供电，不存在 DSP及 LCD电平兼容的问题，采用 CMOS E2PROM工艺，传输延迟仅为5ns；具有 68个用户可编程的 IO 口，为系统定义输入、输出和双向口提供了极大的方便； EPM7128...
基于Verilog HDL设计的自动数据采集系统

...展为18位1024字的高速异步FIFO存储器，数据处理速度达到50MHz，可以实现数据的高速写入和高速读出。FIFO异步读写时序见图3。2.3 状态机模块状态机（FSM）完成自动A/D转换和数据存储，控制芯片是EPM7128SQC100。该状态机由系统时钟驱动，产生RD、WR、INT信号，状态机能连续运行，不断地写命令字以启动A/D转换，然后读出A/D的转换结果并同时写入FIFO。时序图见图4。复位时，产生写脉冲WR，...
基于CPLD的120MHz高速A／D采集卡的设计

...在许多领域得到愈来愈广泛的应用，本文将详细论述采用CPLD技术来实现120MHz高速A／D采集卡的设计方法，该采集卡具有包括负延迟触发在内的多种触发方式，采用CPLD复杂可编程逻辑器件（又称FPGA）EPM7128SQC100－7和AD公司的高速模数转换器（A／D）AD9054BST－135来实现。 1 芯片介绍 1．1 EPM7128SQC100－7简介 EPM7128SQC100－7内含128个宏单元（或2500个可用门），其引脚到引脚的最短传...

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