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  • 深圳市森恒泽科技有限公司

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  • 深圳市莱克讯科技有限公司

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LM358技术文章
  • 基于FPGA及嵌入式CPU(NiosⅡ)的TFT-LCD接口设计

    显示缓存 ram的改写就相当于对 tft_lcd显示内容的改写。 3.2 fpga 本文 fpga选用的是 altera公司的 cyclone 系列中 ep1c6q240。 3.2.1 时序发生电路 首先由外部输入一相当的频率时钟,通过 fpga内部的锁相环电路(pll)生成 100mhz的时钟信号。系统对 100mhz时钟计数生成 50mhz的时钟给嵌入式 cpu(niosⅱ)作为嵌入式 cpu的工作主频,同时生成 tft_lcd所须的场同步时钟、行同步时钟、显示使能时钟和 25mhz的 tft_lcd主时钟;生成地址切换控制信号、数据分离控制信号,由嵌入式 cpu输出的读写信号产生显示缓存 ram的读写信号。 3.2.2调色电路 由于文中是以 256色的电路为例,所以,调色电路是将 8位数据译码成 3*6位的三基色数据,调色电路也可以是 rom型或 ram型。如果作成 ram型,可以依据嵌入式 cpu需要显示的图象相应修改调色电路,可显示更丰富的色彩。 3.2.3地址切换、数据分离 此部分电路的作用是:在嵌入式 cpu操作显示缓存 ram时将地址、数

  • 测量快速时钟的低成本方法

    66mhz的信号是由于采样166mhz信号产生的,我们必须使用一个不同的采样频率再次进行采样。 怎样区分走样频率? 如果你是用不同于一开始的 33.333mhz的采样频率再次对160mhz时钟的信号进行采样,走样频率将会出现在不同的地方。如果你发现这个新的走样频率也表示你可能捕获了160mhz的信号,你就很有把握推断说两次采样中都是采样了160mhz的信号,而将其他频率的可能性排除。新的采样频率和原始频率不要相关,否则他们具有的共模因子会削弱160mhz下的信号意义。例如,如果你使用25mhz(每个周期40ns)的采样频率来采样160mhz的信号,就很难发现真实的结果(图1b)。 使用25mhz采样意味着160mhz比150mhz(25mhz的6倍)高出10mhz,所以它的nyquist波段内走样频率应该出现在10mhz。因为33.333mhz(一个周期30ns)和25mhz(一个周期40ns)有一个共模因子1/(10ns),也就是100mhz,他们以产生同样的走样频率告终。 比较图1a和图1b,你就可以发现问题。请注意60mhz同时出现在两个走样频率的列表上(数字标注在

  • 基于AD6620的正交解调器设计

    ,输出经过低通滤波,最后得到两路16位输出信号vs和vb。 低通滤波器的设计要综合考虑信号的能量和信噪比,通带增宽可以增强信号能量,但也会增大误差,阻带的截止频率和衰减必须能够有效地抑制高次谐波和其他高频噪声的干扰。本文采用的滤波器的通带截止频率为400khz,阻带截止频率为1.2mhz,阻带衰减大于50db。 在本系统中,cic2、cic5和rcf的抽取率分别为2,4、1。它们的传递函数分别为: 值得注意的是:以上传递函数所对应的采样率是不同的,假设ad6620输入数据的采样率为25mhz,则hcic2对应的采样率为25mhz,hcic5对应的采样率为12.5mhz,hrcf对应的采样率为3.125mhz, 若要得到它们级联后总的频率特性,需要将它们的采样率统一折算到25mhz。折算后的传递函数为: 硬件接口 与cpu接口 cpu采用mcf5206,与cpu接口包括3位地址线cpu_addr[2..0]、8位数据线cpu_db[7..0]、片选线/cpu_cs、读信号cpu-rd和写信号cpu_wr,其中,cpu的地址线需要先在pld中完成译码后产生3位地址线再送给

  • 高速线阵CCD IL-P1-4096的原理和应用

    高速线阵ccd il-p1-4096的原理和应用 [日期:2006-1-12] 来源:国外电子元器件 作者:苏州大学电子信息学院 邵 雷 施国梁 [字体:大 中 小] 摘要:il-p1-4096是加拿大dalsa公司生产的双相高速线阵ccd。其单相工作频率可达25mhz甚至更高,因此应用十分广泛。文中介绍了il-p1-4096的性能和工作原理,并给出了具体的应用电路。 关键词:ccd 驱动时序 il-p1-4096 1 引言 近年来,电荷耦合器件(ccd,charge coupled devices)在图像拍摄方面起着非常重要的作用。是光电成像领域里非常重要的高新技术产品。与传统的拍摄传感器相比,ccd图像传感器具有输出噪声小、动态范围大、光谱响应范围宽、分辨率高、输出信号线性度好、功耗低、体积小、寿命长等优点。ccd从芯片结构上可分为面阵ccd和线阵ccd两种类型。面阵ccd主要用于黑白及彩色摄像,而线阵ccd则在高清晰图像拍摄方面表现出良好的应用前景,因此,ccd成为现代光电子学和测试技术中最活跃、最富有成果的应用器件之一。图12 主要特点和

  • 基于FPGA的高精度相位测量仪的设计

    址分成60组。第15、30、45、60组的6个地址中点与点之间的距离都为3;其余各组前5点之间的点距为3,第5点与第6点之间的点距为2。相位测量模块设计原理 本系统的相位测量采用由高速时钟脉冲测量两路波形过零点之间距离的方法。相位测量模块原理框图如图4所示。 图4中,a、b为两路方波输入,clk为50mhz时钟输入,dfd2块为下降沿触发的2分频模块。a、b经2分频的目的是使测相范围由0麀180┐蟮 0麀360or为异或门,其输出信号的脉宽为(b-a)。clxw为一高速计数器,通过25mhz的高频时钟来计算(b-a)的长度。fb360模块为倍乘模块,主要完成(b-a)×360的运算。bpsc模块为分频模块,将25mhz的时钟信号进行(b-a)×360倍的分频,使其输出信号脉宽为tclk×(b-a)×360(tclk为25mhz的时钟周期)。xwc为相位差计数模块,通过a相输入脉冲,计算tclk×(b-a) ×360的长度,然后完成(b-a)×360/a的计算,进而得出相位差值输出,同时该模块还将测得的相位差值送到数码管显示。在对该模块进行仿真时,人为设定了频率为10khz,相位差为

  • 10~25MHz晶体振荡器


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      通滤波,最后得到两路16位输出信号vs和vb。 低通滤波器的设计要综合考虑信号的能量和信噪比,通带增宽可以增强信号能量,但也会增大误差,阻带的截止频率和衰减必须能够有效地抑制高次谐波和其他高频噪声的干扰。本文采用的滤波器的通带截止频率为400khz,阻带截止频率为1.2mhz,阻带衰减大于50db。 在本系统中,cic2、cic5和rcf的抽取率分别为2,4、1。它们的传递函数分别为: 值得注意的是:以上传递函数所对应的采样率是不同的,假设ad6620输入数据的采样率为25mhz,则hcic2对应的采样率为25mhz,hcic5对应的采样率为12.5mhz,hrcf对应的采样率为3.125mhz, 若要得到它们级联后总的频率特性,需要将它们的采样率统一折算到25mhz。折算后的传递函数为: 硬件接口 与cpu接口 cpu采用mcf5206,与cpu接口包括3位地址线cpu_addr[2..0]、8位数据线cpu_db[7..0]、片选线/cpu_cs、读信号cpu-rd和写信号cpu_wr,其中,cpu的地址线需要先在pld中完成译码后产生3位

    • 基于FPGA的高精度相位测量仪的设计

      0组。第15、30、45、60组的6个地址中点与点之间的距离都为3;其余各组前5点之间的点距为3,第5点与第6点之间的点距为2。 相位测量模块设计原理 本系统的相位测量采用由高速时钟脉冲测量两路波形过零点之间距离的方法。相位测量模块原理框图如图4所示。 图4中,a、b为两路方波输入,clk为50mhz时钟输入,dfd2块为下降沿触发的2分频模块。a、b经2分频的目的是使测相范围由0麀180┐蟮 0麀360or为异或门,其输出信号的脉宽为(b-a)。clxw为一高速计数器,通过25mhz的高频时钟来计算(b-a)的长度。fb360模块为倍乘模块,主要完成(b-a)×360的运算。bpsc模块为分频模块,将25mhz的时钟信号进行(b-a)×360倍的分频,使其输出信号脉宽为tclk×(b-a)×360(tclk为25mhz的时钟周期)。xwc为相位差计数模块,通过a相输入脉冲,计算tclk×(b-a) ×360的长度,然后完成(b-a)×360/a的计算,进而得出相位差值输出,同时该模块还将测得的相位差值送到数码管显示。在对该模块进行仿真时,人为设定了频率为10khz,相位差为

    • 瑞萨M16C/64和M16C/65家族扩展M16C平台微控制器阵容

      ic或谐振器这样的外部元件,可以缩小系统尺寸和降低成本。在当前简化的i2c总线增加了硬件多主控i2c总线,另外还增加了可处理从一秒至一个星期计数周期的实时时钟。 (3)由于扩展了工作电压范围,比瑞萨当前m16c产品的性能增加30% 与瑞萨当前的产品相比,在32mhz条件下,m16c/65家族的工作电压可以从3.0v至5.5v扩展到2.7v至5.5v,最高工作频率的性能大约提高了30%,有助于用户开发需要低电压和高速运行的系统。m16c/64家族的工作频率为25mhz,工作电压为2.7v至5.5v。而且最高工作频率与当前的产品相同,通过将工作电压极限从3.0v降低到2.7v,可以实现低电压运行。 产品细节 m16c/64家族和m16c/65家族集成了高性能的m16c/60 16位cpu内核,可以使用现有的系统程序。两个家族可提供高速运行和最高工作频率,m16c/64家族为25mhz,m16c/65家族为32mhz,工作频率范围为2.7v至5.5v。此外,这些新产品继承了m16c系列的可靠性设计传统,还可通过实

  • 由LTC3543驱动白光LED电路

    ltc3543可提供高达600ma的连续输出电流,采用2mm×3mmdfn封装。ltc3543能以2.25mhz恒定频率、扩频或同步锁相环(pll)模式工作,从而为实现低噪声运行提供了多种选择。其电流模式结构允许用2.5~5.5v的输入电压工作,因此该器件非常适合单节锂离子电池或多节碱性、镍镉、镍氢金属电池应用。ltc3543的开关频率高达2.25mhz,允许使用高度低于1mm的纤巧、低成本陶瓷电容器和电感器。

  • 传感器放大调节电路原理图

    传感器是一种物理装置或生物器官,能够探测、感受外界的信号、物理条件(如光、热、湿度)或化学组成(如烟雾),并将探知的信息传递给其他装置或器官。电路中的ad584为基准电压,输入电压为4.5~30v;输出电压选择范围有:10v、7.5v、5v和2.5v。op-07为运算放大器,输入范围为±14v,用于激励传感桥电路。ad624为精密仪器放大器,主要用于放大低电平传感器信号。增益带宽积为25mhz;增益可设置为1、100、200、500、1000;不要求外接元件。ad1674为12位a/d变换器,它是12位10μs采样单位电路adc,内置采样保持放大器。8位和16位微机接口,单极性和双极性输入。 来源:lidy

  • 高达25MHz的频率/相位电路

    通用的移位寄存器如5495/7495连接到一起来比较两个dc至25mhz载波信号的频率和相位。当f1大于f2时,输出为1;当f1小于f2时,输出为0。当f1=f2时,输出为方波,其占空比随着f1和f2的相位差异呈线性变化。比较几乎是瞬间的,最多需要两个载波周期。 来源:zhengwei

  • 采用MOSFET的晶体控制频率转换器

    mosfet的第二个门可以被用来把一个晶体振荡器并入到一个与混频器一样的状态。尽管是老式的电子管,这个设计图在双门mosfet电路中是很少见到的。l3,c3和xi形成晶体振荡器,t2是一个if输出变压器。t1和c1被调谐到转换器的输入频率。该电路可与三泛音晶振一起用高于达25mhz左右或更高的频率。 来源:zhenglili

  • c8051f单片机应用解析之c8051f330

    单片机爱好者开发的一款单片机学习板,也可作为工程人员开发参考之用。本学习板采用美国silabs公司的c8051f330作为核心控制器,指令集与mcs51兼容,是学习c8051f系列单片机入门级mcu。 2. c8051f330单片机主要特性(1)高速流水线结构的8051兼容的cip-51内核,最高25mips执行速度;(2)全速非侵入式的系统调试接口(片内,c2接口);(3)真正10位200ksps的16通道单端/差分adc,带模拟多路器;(4)1个10位电流型输出dac;(5)高精度可编程的25mhz内部震荡器;(6)8k字节可在系统编程的flash存储器;(7)768(512+256)字节的片内ram;(8)硬件实现的spi,smbus/iic和1个uart串行接口;(9)4个通用的16位定时器;(10)具有3个捕捉/比较模块的可编程计数器/定时器阵列;(11)片内上电复位,看门狗定时器,1个电压比较器,vdd监视器和温度传感器;(12)17个i/o端口;(13)-40~85度工业级温度范围;(14)2.7v~3.6v工作电压,20脚dip或mlp封装; 3.本学习板主要特点(1)选择与

  • 关于振荡器,外接C1,C2是TBD的,不知何意?什么是TBD?

    感激涕零!数据手册上是这么写的: c1 c2hs 20mhz 15-33pf 15-33pf 25mhz tbd tbd我就不懂了,是说25mhz的c1,c2值得自己去试吗?在差不多范围里。 再有,各频率下,都有推荐的品牌型号,比如,epson.唯独没有25mhz的石英晶振的型号。是说微芯找不到合适的型号吗?

  • 液晶驱动问题

    我的是这样配置的,19264的液晶和lpc2138相连,已经调试完了/* system configuration .fosc、fcclk、fcco、fpclk must be defined *//* 系统设置, fosc、fcclk、fcco、fpclk必须定义*/#define fosc 11059200 //crystal frequence,10mhz~25mhz,should be the same as actual status. //应当与实际一至晶振频率,10mhz~25mhz,应当与实际一至#define fcclk (fosc * 3) //system frequence,should be (1~32)multiples of fosc,and should be equal or less than 60mhz.html">60mhz. //

  • 请教HOTPOWER大虾。看了您的KEIL UART例程。波特率设置?

    哈哈,给你个例程注意: 以下的*5的5是msel=5,一般设置为4,因为我要求速度快u0dll = 94;//95;//96;//98;//97;是我做实验的,计算值在90左右.(在msel=4时)#define fosc 11059200 //crystal frequence,10mhz~25mhz,should be the same as actual status. //应当与实际一至晶振频率,10mhz~25mhz,应当与实际一至#define fcclk (fosc * 5) //system frequence,should be (1~32)multiples of fosc,and should be equal or less than 60mhz.html">60mhz. //系统频率,必须为fosc的整数倍(1~32),且<=60mhz#d

  • 请关注:目前业界最便宜的ARM,LPC2101/02/03

    道。 2 个16 位的定时器/外部事件计数器,具有3 路捕获和7 路比较通道。 低功耗实时时钟(rtc),有独立的供电电源和专门的32khz 时钟输入。 多个串行接口,包括2 个uart(16c550),2 个快速i2c 总线(400kbits/s)以及带缓冲和可变数据长度功能的spi 和ssp。 向量中断控制器,可配置优先级和向量地址。 多达32 个可承受5v 的通用i/o 口。 高达13 个边沿或电平有效的外部中断管脚。 通过可编程的片内pll(可能的输入频率范围:10mhz~25mhz)可实现最大为70mhz 的cpu 时钟频率,设置时间为100us。 片内集成的振荡器,工作在1mhz~25mhz 的外部晶体下。 节电模式包括空闲模式、rtc 有效的睡眠模式和掉电模式。 通过外设功能的单独使能/禁止和调节外设时钟来实现功耗的最优化。 通过外部中断或rtc 将处理器从掉电模式中唤醒。

  • 请教哪位仁兄关于直接频率合成芯片AD9832的问题。

    回复dds的时钟频率为25mhz,按照资料中说明,其最大输出频率应该为25mhz*40%=10mhz,我的输出端就接了一个300欧姆的电阻,没有其他负载,现在输出频率为250khz时,幅度几乎只有十几个毫伏了。

25mhz替代型号
25M2 25LC512 25LC256 25LC160 25LC1024 25LC080 25FR120 25F120 25C64 25C040

25N120 25N15 25P06 25P10 25P80 25S10 25T80 25V/100UF 25V/470UF 25V100UF

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2SK2417 2SD965 2SC5411 2N3906S-RTK/PS 2SB709A-R(TX) 2SB1189T100R 24LC21A/SN 2SJ327-Z-E1 25LC040AT-I/SN 2SA1298-Y

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