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当前位置：维库电子市场网>IC>74hc74 更新时间:2024-04-21 00:21:14

74hc74供应商优质现货

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  • 深圳市捷力华电子科技有限公司

  • 74HC74A

    74HC74A
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74hc74价格行情

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历史最低报价：￥0.0900 历史最高报价：￥5.0000 历史平均报价：￥0.9268

74hc74中文资料

  • Windows 95下智能数据采集系统

    c机。pc机中的应用程序由并口接收单片机发送的数据，并对其进行数据处理和显示。1.单片机与主机间的并口通信随着计算机技术的发展，微机的并行口发生了很大的变化，由原来的只能打印，即只能向外设传输数据，发展成为可以在微机与外设之间进行双向、快速交换数据的双向并行接口。利用双向并行口使得pc机能与数据采集系统的单片机之间以异步的、全互锁的双向并行方式通信。它能减少用户交互地操作外部设备的次数，以更高的传输速率完成数据传送。并口通信硬件部分原理如图2所示，软件部分流程图如图3所示。并口通信利用了d触发器74hc74的预置和清零功能提供传输数据所需的握手信号。用八d锁存器74hc573完成单片机传出数据的锁存。在单片机向pc机送数时，单片机先将数据锁存在74hc573中。74hc573的输出端接到微机并行口的数据寄存器的输入端。数据锁存后，单片机将74hc74的清零端cd清零，使输出端q输出低电平，q端同时送至并行口的状态寄存器，通知pc机可以取数。pc机检测到这一信号后，经控制口选通数据锁存器，将锁存的数据取出，并将触发器置位端sd置1，使q端输出高电平，通知单片机数已取出，可以送下一个数据了。单片机检测

  • 基于LPC2134的多道脉冲幅度分析器设计

    00μs之间(根据cpu处理速度及代码量而定)，甚至更多，也就是说，实际信号出现这种情况的几率很少，所以，可以忽略这个问题。 另外，还要解决信号过密而引起的幅度信号错误纪录，而高能区的信号也可能被误计为低能区的信号，容易引起低能计数偏大而高能计数偏小的问题。 图2所示是甄别电路和控制电路的原理图。甄别电路的主要功能是完成过峰检测和去除信号噪声，可通过设定闭值将信号中能量小于阀值的噪声去。峰值通过后，提供信息给控制电路；控制电路的主要功能是完成对a/d读入／转换状态的控制。控制电路可由74hc74触发器构成。 甄别和控制电路具体工作过程是，先由嵌入式微处理器控制中心给控制电路发出信号，以使控制电路处于工作状态，当脉冲信号到达多道脉冲幅度分析器后，由甄别电路进行甄别，并在过峰值后，将峰值通过的时间信息提供给控制电路；此后由控制电路启动模数转换，数模转换完毕，再由嵌入式微处理器控制中心产生中断，同时使控制电路停止工作，同时进行相应的数据处理；中断完毕，再由单片机发信号使控制电路重新处于工作状态。 采样开始时，先由arm通过控制74hc74来启动a／d，然后，使u2a的rd和u

  • 基于CPLD的无人机综合无线电系统中扩频电路的设计

    n码产生器的时钟；当通道选择信号选择副通道工作时，选择102.4k的信号作为127位的pn码产生器的时钟。另一路102.4k的信号经过2分频和16分频，作为同步时钟送飞行控制柜。 当通道选择信号选择主通道工作时，扩频码为63位和127位的pn码模“2”后的8001位的复合码，码速：6.4512m；当通道选择信号选择副通道工作时，扩频码只为127位的单码，码速：102.4k。 同步电路的作用是，使扩频码和6.4512的时钟电路严格同步，从而保证加密指令和扩频码的同步。同步电路通常由74hc74触发模块实现。 由于，epm7128slc84-5输入、输出引脚的最大时延为5ns，所以，实际应用时，同步电路可以去除。而为了减少时延，可以将全局时钟引脚，作为6.4512m时钟输入端。 5总结 在无人机的综合无线电系统扩频电路设计中采用cpld器件，并借助max+plus 软件，减少了机载机密扩频板的尺寸、提高了整个无线电系统的可靠性，为未来无人机综合无线电系统的电路设计，提供了新的思路和途径。 参考文献:[1]. cpld datasheet http://www.

  • 单片机多机并行通讯的一种方法

    检测和控制系统中充当通信控制器的角色；也适合于用作单片机串行口扩充电路。 图1 芯片的逻辑图及四种工作状态 图2 单片机并行通信原理框图 2 三态总线缓冲寄存器74hc646 在单片机构成的多机并行通讯系统中，总线上的信息交换一般采用pio（并行接口）和双端口寄存器等方法，并辅助以总线仲裁电路。通常使用的并行接口芯片有8155，8255等。本文介绍一种简单的并行接口电路，它既能取代8255等芯片，还能使电路结构更加简单和紧凑。该电路由一片74hc74和一片74hc646（300mil窄封装）构成。 74hc646是三态总线缓冲寄存器，其实也是一个双端口共享存储器，只是共享存储区很小的，仅有一个数据输入寄存器与一个数据输出寄存器，用它作为单字节通信数据的临时中转站，每传送一个字节，主从机间握手一次，把数据取走后再继续下一字节的通信。74hc646可以将两条总线的数据分别锁存，再由芯片内部总线进行数据交换。74hc646具有四种工作状态，利用对这四种工作状态的控制，可以实现多个单片机利用数据口进行数据交换，省下其余口线做其他的工作，如驱动

  • 基于VHDL的DRAM控制器设计

    的性价比，其性能和功能是80c31、80c196等单片机无法比拟的，并能充分利用大量的pc平台软件。本解决方案已在家庭电子证券产品中采用，获得了良好的经济效益和社会效益。 掌握cpld技术和vhdl语言设计技巧是提升产品技术含量的重要途径。上述cpld还留在一些引脚和内部资源未使用，只要设计者将vhdl源代码稍微作一些修改，就可以用这些引脚控制新增加的dram，提供总线准备输出信号或dma响应信号。 如果采用引脚数和宏单元较多的xc9672或xc95108cpld，就可以将d触发器（74hc74）、多路地址切换器（74hc157）、数据收发器（74hc245）和地址总线锁存器（74hc373）等其它分立逻辑器件的功能全部集成到cpld中，这样系统集成度和可靠性将更加提高。参考文献:[1]. 80c186xl datasheet http://www.dzsc.com/datasheet/80c186xl_103667.html.[2]. cpld datasheet http://www.dzsc.com/datasheet/cpld_1136600.html.[3]. 80c31 d

  • 74HC74D PHILIPS公司芯片

    74HC74D PHILIPS公司芯片.

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