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基于DSP的新型多功能电能质量监测仪表的设计
信号mclk可以由dsp分频得到，也可以由晶振直接产生，ad73360的最高输入时钟为16.384 mhz。 2.2 锁相倍频电路及频率测量傅里叶变换要求每周期采样点数等间隔，且采样时间要涵盖整周期。因此对采样点数的要求非常严格。实现同步采样的方式有软件同步和硬件同步两种，硬件同步采样比软件同步采样响应迅速，能实时追踪频率变化。本装置中采样脉冲产生电路由过零比较器、锁相器以及分频电路组成。锁相电路选择了一种性能优良的cmos锁相环路cd4046，同时cd4046提供给计数器74ls393来产生所需的分频信号。倍频锁相电路如图3所示，首先将所检测的信号送入方波发生器，输出一个与输入信号同频率的方波f 1，然后送入由锁相环cd4046和计数器74ls393构成的128倍频锁相电路。将74ls393分频后的输出信号接到cd4046比相器输入端3，与f 1进行比较，直至3端和4端的输入信号相位差不再随时间变化，进入锁定状态。此时vout输出端对方波信号实现了128倍频,依此方波对ad73360进行数据采集触发。同时，74ls393的9脚输出信号送入dsp的捕获端口，用于测量频率
基于单片机高性价比频率计的设计与实现
被测信号和时钟信号的周期数进行累计。在t内，事件计数器的累加数为na；时间计数器的累加数为nb。再由单片机运算得出被测频率为（na/nb）×f。由于d触发器的同步作用，计数器所记录的na值已不存正负1误差的影响。但由于时钟信号与闸门的开和关无确定的相位关系，计数器所记录的nb值仍存在正负1误差的影响，由于时钟频率很高，正负1误差影响小，所以测量精度与被测信号频率无关，且在全频段的测量精度是均衡的。 2 系统硬件设计在频率计设计中，硬件电路采用了8051单片机、双四位二进制计数器74ls393、缓存器74ls244、8155带ram和定时器/计数器的可编程并行接口芯片、16k程序存储器扩展芯片2716、十倍分频器74s196、反向器74ls14、反向驱动器7406、7407等。所采用的芯片技术成熟，性能可靠，性价比较高。系统硬件主要由四部分组成:通道部分、计数器部分、单片机控制和接口部分、显示部分。 2.1通道部分本频率计的输入通道由两部分组成，第一部分就是常见的信号预处理电路，包括对被测信号的放大、整形、滤波等等。第一级由开关三极管构成的零偏置放大器，三极管采
中规模时逻辑集成计数器
同理，如果将74ls16l换成74ls160，也可构成九进制加法计数器。 4，数字钟数字钟由石英晶体振荡器、分频器、计数器、译码器、显示器和校时电路组成，石英晶体振荡器产生的信号经过分频器变为秒脉冲，秒脉冲送人计数器计数，计数结果通过“时”、“分”、“秒”译码器显示时间，电路如图4所示。 ①振荡器：由cc4069非门ic1-1，ic1－2，f0＝32768hz的石英晶体振荡器、电阻和电容组成。由icl－2 的4脚输出的频率为32768hz的方波。 ②分频器：由两个74ls393 ic2，ic3组成，74ls393是双4位二进制计数器，32768hz的方波与ic2的i脚相连，输人时钟脉冲，两个74ls393组成分频器，32768＝215，因此，由9脚输出秒脉冲。 ③计数器：由6个74ls160 ic4，ic5，ic6，ic7，ic8，ic9和相应的门电路四2输人与门74ls08、四2输人与非门74ls00等，分别组成60进制“秒”计数器电路、60进制“分”计数器电路和24进制“时”计数器电路。 ④译码和显示电路：由6个74ls247 ic10，ic11
74系列芯片资料
ttl 三态同相八d锁存器74ls374 ttl 三态反相八d锁存器74ls375 ttl 4位双稳态锁存器74ls377 ttl 单边输出公共使能八d锁存器74ls378 ttl 单边输出公共使能六d锁存器74ls379 ttl 双边输出公共使能四d锁存器74ls38 ttl 开路输出2输入端四与非缓冲器74ls380 ttl 多功能八进制寄存器74ls39 ttl 开路输出2输入端四与非缓冲器74ls390 ttl 双十进制计数器74ls393 ttl 双四位二进制计数器74ls40 ttl 4输入端双与非缓冲器74ls42 ttl bcd—十进制代码转换器74ls352 ttl 双4选1数据选择器/复工器74ls353 ttl 三态输出双4选1数据选择器/复工器74ls365 ttl 门使能输入三态输出六同相线驱动器74ls366 ttl 门使能输入三态输出六反相线驱动器74ls367 ttl 4/2线使能输入三态六同相线驱动器74ls368 ttl 4/2线使能输入三态六反
基于等效和实时采样的数字示波器设计
3166，其特点是低导通电阻、电容，低漏电流，低捕获时间和通断孔径时间，但只工作在正电压范围，故需前级加法器。开关前再加一级射极跟随器，采用带动容性负载强宽带运放ths3001做前后级的隔离。 3．3 整形及测频电路高频段整形采用高速比较器max913，低频段采用低速比较器lm311。为提高输入max913信号的信噪比，在其前级加一级无限增益放大，采用高频率运算放大器lm7171，放大倍数50，这样减小max913输出脉冲边沿抖动。同时，为避免高频整形方波的谐波发射，比较器输出均经74ls393分频后送入fpga进行等精度测频，脉冲边沿更陡峭，便于测量。 3．4 a／d采样电路 a／d转换器采样是信号处理的重要部分，是对模拟信号进行数字量化。采用max118的流水线工作模式，该模式下max118的工作直观，控制简单。图3为max118的实现电路。 4 系统软件设计简化后的系统软件流程如图4所示。系统主体功能采用模块化的设计思想，通过按键进行选择，且菜单界面良好，具有较强的人机交互性。为了在示波器上显示稳定的波形，采用内触发方式进行扫描，软件对触发电平的

74LS393
二进制计数器

多输出晶体振荡器电路图
如图所示为多输出晶体振荡器。主要是由al的三个门、四个电阻、二个电容和一块晶体所组成。rl～r4将两个反相器偏置在线性范围内，并由晶体sjt连接在a1的4脚与1脚之间，用以提供反馈回路，仅在晶体的基频上产生振荡。元器件选择：电容cl为15p(微调电容器)。电阻rl、r3为220ω，r2为560ω，r4为1．8kω，r5为1kω，其标称功率均为l／8w。集成电路al为7404，a2为74ls74，a3为74ls393。石英晶体sjt为sw60a-4096khz。开关sa为knx(1×3)。来源:university
多输出晶体振荡器
如图所示为多输出晶体振荡器。主要是由al的三个门、四个电阻、二个电容和一块晶体所组成。rl～r4将两个反相器偏置在线性范围内，并由晶体sjt连接在a1的4脚与1脚之间，用以提供反馈回路，仅在晶体的基频上产生振荡。元器件选择：电容cl为15p(微调电容器)。电阻rl、r3为220ω，r2为560ω，r4为1．8kω，r5为1kω，其标称功率均为l／8w。集成电路al为7404，a2为74ls74，a3为74ls393。石英晶体sjt为sw60a-4096khz。开关sa为knx(1×3)。来源:university
多输出晶体振荡器电路
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74LS393分频给5V器件提供CLK信号，高电平输出只有4V，如何提高它
74ls393分频给5v器件提供clk信号，高电平输出只有4v，如何提高它74ls393分频给5v器件提供clk信号，但是高电平输出只有4v，而我需要5v的。有什么简单的方法解决这个问题呢？此前，我用了10k的电阻上拉到74ls393的vcc端，试图将‘1’逻辑电平提高到5v，但是没有观察到任何变化，我失败了。
跪求高手帮做个占空比可调的方波发生器设计
要求：通过电位器w1产生的0～5v的电压，控制p1.0和p1.1产生互为反相的占空比可调的方波（其中，p1.0为正向输出）。w1的输出电压为0v时，p1.0输出方波占空比为0（p1.1输出方波占空比为100％）；w1的输出电压为5v时，p1.0输出方波的占空比为100％（p1.1输出方波占空比为0）。控制功能：通过拨动开关k1控制输出信号的频率。k1＝0时，输出信号频率为50hz，否则为100hz。w1产生的输出电压接入adc0809的in0进行采样，根据采样结果输出相应占空比的方波。注意：利用74ls393对4mhz晶振产生的脉冲信号进行八分频做为a/d的时钟信号。使用的主要元器件：8031、6mhz的晶振、74ls138、2764、4mhz晶振、74ls04、74ls393、拨动开关k1、电位器w1等。好了，这就是全部条件，跪求高手帮我做作，附上程序，硬件图最好。可以发我邮箱luodeyou@sina.com
谁来推荐一款8bit计数器
74hc393，74ls393等。

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多输出晶体振荡器

多输出晶体振荡器电路

74LS393分频给5V器件提供CLK信号，高电平输出只有4V，如何提高它

跪求高手帮做个占空比可调的方波发生器设计

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