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SN65LVDT250中文资料

  • SN65LVDT250

    SN65LVDT250引脚图运行大于2.0Gbit/s；充许每个输出可连接到任何输入的无阻塞架构；pk-pk抖动:在2.0Gbit/s时60ps(典型值),2.5Gbit/s时110ps(典型值)；兼容ANSITIA/EIA-644-ALVDS标准；38引脚TSSP封装；输入电压阈值迟滞25mV；传播延迟时间：800ps(典型值)；输入电气兼容LVPECL,CMP和LVDS信号水平；单一3.3V的操作电源；低功耗：典型值；集成110Ω线路终端电阻器可用SN65LVDT250

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