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利用FPGA实现异步FIFO设计
sp处理器做各种预处理。 ti公司推出的高性能数字信号处理芯片tms320c6000系列，工作频率最高可达到1ghz，具有处理速度快、灵活、精确和可靠性高等优点，作为数据采集系统中的主处理器，可以满足实时性的要求。基于以上考虑，北京合众达公司开发了采用tms320c6416和fpga的高速高精度双通道数据采集系统，每个通道的采样率为3msps，最高可达10msps，采样精度为14b。系统主要包括以下几部分：高速a/d转换、fifo数据缓存和edma数据传输，系统结构框图如图1所示。 ad9243及转换控制设计中采用的模数转换器芯片是ad9243。ad9243是adi公司生产的14位、3msps高性能模数转换器。ad9240与ad9243完全兼容，因此系统的最高采样率可兼容到10msps。模数转换器ad9243的时序控制与传统的a/d有所不同，完全依靠时钟控制采样、转换和数据输出，在第一个时钟的上升沿开始采样转换，第四个时钟上升沿到来时，数据将出现在d1~d14端口上。本文采用系统自通电时起，a/d和时钟电路始终处于工作状态，对数据不停进行转换，以减少误码率，提高采样
DRM测试接收机的设计方案
模块是接收机的关键模块，其性能好坏直接影响接收效果，并且根据今后现场测试的情况，其算法存在调整的可能性.因此这些模块通过arm实现。需要对算法进行调整时，只需修改软件程序，重新载入arm即可，硬件部分无需改动。以实现测试接收机便于对各种算法的性能进行验证和比较的目的。 4.2 硬件平台结构测试接收机硬件平台如图3所示。fpga采用xilinx公司的virtexⅱxc2v500型芯片;arm采用三星公司的s3c4510b型arm7 tdmi芯片;adc模块采用了ad公司14-bit的ad9243。fpga与arm之间通过双口ram进行数据交互，使用hc245芯片作为地址和数据总线的驱动。 a/d采样后的中频数据送入fpga做正交解调;fpga将解调后的数据写入双口ram同时给arm产生中断信号;arm响应外部中断，将数据读入、进行后续处理。如图2中的流程，arm在处理完解交织后，将处理后的数据写入双口ram，同时向特定的地址写控制字，fpga检测到控制字后，将数据读入.进行viterbi译码。fpga将viterbi译码结果写入双口ram，向arm发出中断信号，arm

AD9243
单片的电路14位3MSPS模数转换器；低功耗：110mW；单＋5V电源；积分非线性误差：2.5LSB；微分非线性误差：0.6LSB；输入参考噪声：0.36LSB；完整：片上采样和保持放大器和电压参考；信号与噪声及失真率：79.0dB；无寄生动态范围：91.0dB；超出指标范围；直二进制输出数据；44引脚MQFP封装

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