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高性能手持示波表低功耗设计中的关键技术
d，示波表中大多采用320×240的分辨率；电源模块通常由开关电源ic实现，当然这里要求电源转换效率尽可能的高。通常高采样率示波表与低采样率示波表的关键差别在于数据采集模块的不同，数据采集模块中adc采样率的提高，必然带来其功耗的增大，这也必然要求电源模块的输出功率增大，而其他模块相对于采样率的高低是独立的，其功耗相对差异较小，不会因为采样率的提高而有变化。 2.1 高速adc与功耗数据采集模块中的adc决定了系统的采样率，采样速率不同，adc的功耗差异是非常大的，如表1所示，其中ad9288与at84ad004功耗相差有1.5w之多，而这仅仅是adc之间的差异，实际上，根据cmos集成电路平均动态功率消耗的经典公式：p=fcv2 可知，当在电源电压和负载电容确定的情况下，工作频率直接影响着系统功耗，采样率不同的adc输出不同数据带宽的数据流，后端fpga接收这些不同速率的数据流，其相应消耗的功耗因为工作不同，而也有较大差异的，另外，考虑到电源效率也不可能是100%，这种功耗差异就会被放大，整机功耗差异也就会增大，所以决定着系统高采样率指标的高速adc带来了一系列的功耗
数字FIR滤波器的设计与实现
的采样时间。在此只截取了部分时间结果。基于fpga的数字滤波器的实现为了缩短设计周期，利用fpga自带的ip核进行滤波器的设计，输出取高位。把以上设计的系数加载到ip核中。生成vhdl代码。通过编译后下载到fpga中（altera cyclone ep1c12q240c8）。利用信号发生器产生的f 1 =2mhz和f 2 =5mkhz两个正弦信号进行叠加，用fpga实现的数字滤波器处理的是数字信号，在实际应用中，首先就要用a/d转化器对模拟信号进行采样与量化。本设计通过ad9288采样量化，设置模式为normal，输出为二进制补码。通过singnaltap逻辑分析器，读取并保存结果。上两部分为输入的信号，第三部分为信号叠加后未滤波的结果，最后一部分为滤波后的结果。横轴为采样点的个数，纵轴为幅度（转换的部分程序如下）。 clear,clc; a='0110101。。。。' % fid = fopen('111.txt', 'r');% for i=1:131072 % a(i)= textscan(fid, '%1s', 1); % end;b=zeros(1,8);

AD9288
双8位，40MSPS，80MSPS和l00MSPS模数转换器；低功率：90mW在IOOMSPS每通道；片上参考和跟踪/保持；475MHz模拟带宽每通道；SNR＝47dB在41MHz；IV(峰-峰值)模拟输入范围每通道；单3.0V电源操作(2.7～3.6V)；待机模式为单通道操作；二进制补码或偏移二进制输出模式；输出数据对准模式，引脚兼容10位升级版

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