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务分配方法。三者之间紧密联系，互相依赖。 3.1 处理单元的选择 处理单元的性能可以说是决定处理机性能最基本的因素，高性能的处理单元可以提高系统性能、减少系统体积和功耗、降低结构复杂性和提高软件可维护性。处理单元按应用范围大致可分为中央处理单元、专用asic芯片、fpga/epld、数字信号处理器。在实时数字信号处理应用上，dsp仍具备明显优势。 在并行处理中，更强调dsp是否具有适于构成并行处理机的特殊功能，如高速通信口的通信能力、共享存贮器的接口功能等。tms320c40和adsp21060在结构功能上有很多相似之处，相比较而言，综合性能较好地并行dsp是adsp21060,他的运算速度、数据吞吐能力、片内存贮器容量都远优于tms320c40,相对于其他类型dsp.他的突出特点是：fft速度快、片内存贮器容量大，很好地共享存贮器接口。各种兼容型号adsp2106x的选择余地也较大，他还与最新推出的adsp21160代码兼容，结构与接口形式也类似。 3.2 并行处理机互联结构 并行处理机互联网络的主要功能是为各处理单元提供数据交换的通路并负责子任务传送和控制调度信号的传递
摘要：介绍一种基于adsp21060和virtex ii的星载图像处理系统。分析了图像处理系统的功能和任务，给出了处理系统的硬件结果、fpga的功能模块、dsp的软件框架和模块。通过地面原理样机开发，验证了系统设计的正确性和高效性。 关键词：adsp21060 virtex ii 图像处理系统 积分器 乒乓结构 图像处理系统多采用dsp阵列、dsp加fpga/cpld或单由fpga/cpld器件等方式构成。采用dsp阵列构成的图像处理系统，其优点是处理功能可以通过软件灵活修改，其缺点主要有功耗大、体积大、成本高；采用单由fpga/cpld等可编程器件构成的系统，可以避免dsp阵列系统功耗大、体积大的缺点，并可以根据系统要求，在硬件构造上灵活的配置，但对于复杂的算法，其设计复杂度急剧上升。正因为如此，当前很多设计选择dsp加fpga/cpld的结构来构成图像处理系统。本空间太阳望远镜星载图像处理系统，正是一种基于dsp和fpga构造的图像处理系统。本文讨论了系统的功能任务、系统结构、fpga设计的逻辑模块、dsp的软件结构和原理样机的实验结果。1 图像处理系统的功能和任务 1．1
（zero overhead loop），程序执行时间可预测等。正是由于dsp的诸多优点能够满足密集的数学计算，而且dsp应用的另一个突出特点是实时性，使其在通信、雷达、数字电视等领域得到了广泛的应用，而且日益渗透到人们的日常生活的各个方面。在实时信号处理中已经离不开dsp，这些处理系统中包含了各种数据通信，例如dsp与dsp间数据通信，dsp与pc机间数据通信等。如何能够快速、准确的完成通信是每个硬件工程师所关心的问题。由于dsp的工作频率较高，如tms320c6201时钟频率为200mhz，adsp21060时钟频率为40mhz，故其数据读写周期很短，然而pc机串口读写速度较低，最大数据吞吐量约为115kbps，尽管dsp在与这些慢速外设进行数据交换时可以加入额外的等待周期，但是在实时性要求苛刻，算法复杂的场合，将dsp从这些冗长的等待周期中解放出来，将其时间重点放在处理关键的实时任务中去，有着重要的实际意义。故dsp与pc机之间串口通信的速度匹配是保证快速、准确通信的关键。pc机一般带有一个或两个内置串口，每个端口的机箱背后有一个9针或25针的公插口。串口是以bit来传输数据的，传输速率取决于ua
理的工作时序控制并增强外围通信功能，在其前端配置一块单板机，利用vxworks作为操作系统，并安装控制程序对sharc阵列板实施控制。由于单板机具有良好的通信接口扩展性，该单板机作为信号处理系统的前端机可以外接网络接口、视频接口、i/o接口等等，使得信号处理机可作为一个完整的分系统接入控制网络；利用单板机的强大的实时控制功能和网络功能，使信号处理机发挥最大功效。下面给出sharc阵列板与其前端的单板机组成的通信处理系统，如图1所示。 该嵌入式系统基于标准的vme总线结构，sharc处理器为adsp21060，其时钟频率为40mhz，晶体振荡器的频率为25.6mhz。每一个sharc处理器都支持高达240mb/s的高速通信。对sharc的软件开发采用apex(advanced parallel excutive)，即高级并行执行指令，由signal spectrum公司开发的sharc指令高级开发语言。apex提供了性能优良的、灵活的并行处理器指令集，以及对dsp硬件的便捷访问功能。同时，apex还提供了基于vme总线的通信机制，允许从主机下装sharc代码到客户机，并且具备在主机和客户机之间进行数
如果下一个时钟节拍，bs-cell处于写状态（如处于capture状态），由于数据线的电平保持特性，则有可能在此时间，bs-cell所capture回读的数据为上一个时钟节拍的update数据，造成测试不稳定。解决的办法是在每一次读状态结束后，系统根据读状态的间隔时间，随机产生一组与上一组测试矢量不同的数据，命名为*data，对i/o总线进行间隔刷新。 实验结果及分析 现以某新型雷达点迹处理数字电路为例进行系统功能验证。整个电路采用dsp+fpga的设计架构，其主要芯片包括：5片dsp（adsp21060）、2片 fpga（atlera flex epf10k系列）、8片双口ram（qfp封装），其他e2prom、hc244（sop封装）、hc245（sop封装）等。电路设计复杂，芯片多，pcb布局布线密度大，采用ict、功能测试tps开发难度大。 利用本边界扫描自动测试系统，结合merge方法，对上述电路板进行tps开发实验及故障诊断，测试结果如图4所示。 插入模拟故障（u8-6 stuck to 0），重新仿真：扫描链测试→pass→b-scan器件簇测试→pass→nb-scan器
摘要：介绍一种基于ADSP21060和Virtex II的星载图像处理系统。分析了图像处理系统的功能和任务，给出了处理系统的硬件结果、FPGA的功能模块、DSP的软件框架和模块。通过地面原...
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