ALTERA
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一站式BOM配单，原装现货，价格优势
ALTERA
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亚洲权威代理商，现货在库，欢迎咨询
ALTERA
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24727
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旋尔只做进口原装，假一赔十...
Altera Cyclone
基本涵盖了Cyclone的所有芯片
ALTERA
Altera CyclonePDF下载
assp 重制的完成。结果，很多优秀的视频技术assp 供应商在这一领域未能及时跟上市场的脚步，被消费类电子芯片生产商收购，为消费类市场提供视频处理专业技术。例如， gennum （vxp）、genesis、silicon optix 和letit wave 分别被sigma designs、st micro、idt 和zoran 收购。 在这一assp 行业合并和重新定位过程中， fpga 视频处理功能不断增强，成为定制图像格式转换应用的理想平台。为支持加速实现fpga 图像格式转换， altera 开发了本白皮书介绍的1080p 视频设计工作台，帮助系统设计人员轻松开发定制图像格式转换信号链。本文所讨论的图像格式转换参考设计可以作为起点，适当修改后用于定制视频处理应用开发。本设计经过硬件验证，可以提供给授权用户。 1 视频设计工作台 altera 视频设计工作台集成了各种工具和构建模块视频功能，有助于加速定制图像格式转换设计的开发和实现。它包括以下组成： ■ 构建模块视频知识产权（ip） 内核 ■ 格式转换参考设计，展示fpga 功能，提供设计起点。 ■ 低
altera推出首个45纳米fpga。45纳米将继续实现成本和功耗降低、性能提升，但会同时带来设计和工艺挑战，需要fpga供应商和晶圆代工厂间更紧密的合作。altera宣称其和台积电（tsmc）这种“1+1排他性合作”模式在45纳米节点显示现更大优势。 45nm（1μm=1000nm，1nm为10亿分之一米）不是指的芯片上每个晶体管的大小，也不是指用于蚀刻芯片形成电路时采用的激光光源的波长，而是指芯片上晶体管的栅极宽度，衡量半导体制程的参数很多，比如芯片上晶体管和晶体管之间导线连线的宽度，简称线宽。（此处应为连线的高度，线宽在一个技术时代里（比如45nm工艺）是可以不断缩小的，而线的高度是不变的）。半导体业界也经常用线宽这个工艺尺寸来代表硅芯片生产工艺的水平。早期的连线采用铝，后来很多国外的大公司采用铜导线了。 在摩尔定律指引下，过去10多年来，半导体产业仍是每两年推出一个新工艺，预计这还会在未来10年内持续，从目前的65纳米到45纳米再到32纳米以下。这背后的驱动力是每一代新工艺会将片上晶体管密度翻倍这意味着更高性能，更低成本和功耗。 altera公司技术开发副总裁mojy ch
当altera公司为下一代fpga着手开发90nm工艺时，这项工艺正处于广泛的业界争论之中，恰恰反映了新的亚微米工艺之路的坎坷。向90nm点的转换不一定很顺利，尚需要进行比上一个工艺点更深入的分析、研究和测试。然而，altera从以往产品推出和近乎无瑕疵的0.13um技术中获得了经验，再一次证明了经细致考量的设计方法和主流工艺的选择是成功的关键因素。公司选用tsmc经验证的90nm和low-k介电质工艺获得了极好的产量和优质的器件，这些器件超过了对功率和性能的预期值。 · altera现在正在制造和测试大量的stratix® ii器件，坚信它能在比预期更早的时间内达到极具竞争性的成本目标。这样，它将以即将降价的形式为客户节省成本。· 工作在533mbps规范之上的ddr2存储器接口现在可以运行到640mbps，为客户提供了巨大的保护带宽，更容易进行设计 · lvds工作在1.5gbps，大大地超过了1gbps的规范。这也具有极大的时序/性能优势。· 比预计更好的工艺控制结果使得泄漏功率小于预期值。新的升级后的功率计算器为用户
成熟和用量的上升，要求不断降低成本。由于可编程逻辑器件(pld)可以为这些需求提供解决方案，因此可以在新兴的数字视频广播基础系统设备中发挥重要的作用。 图1：广播基础系统架构示意图 视频内容的产生 视频广播链的第一环是用专业数字视频摄像机捕捉音视频内容。视频可以是标清或高清。这种数字摄像机一般都有一个摄影与电视工程师协会(smpte)定义的sdi输出。sdi是一种未经压缩的视频流，速度可以是270mbps(标清)、1.485gbps(高清)或2.97gbps(1,080p高清)。altera公司的stratix ii gx fpga自带串行/解串器(serdes)和时钟/数据恢复(cdr)电路，可以用来处理摄像机sdi输出口上的视频流。 视频预处理/后处理 北美地区使用的电视广播标准ntsc中每个信道的带宽为固定的6mhz，欧洲和其他地区用的pal标准中每个信道带宽为8mhz。这种带宽的限制规定远早于数字电视的出现时间，这种模拟带宽限制也影响到目前数字电视的广播标准。数字视频质量要比传统的模拟视频好得多，数字分辨率越高，传送或发送视频数据所需的带宽也越大。发送高质量视频需要
统设计；④dsp系统设计；⑤计算机处理器设计；⑥与asic市场的竞争技术。以下将分别予以说明。 1、新器件 由于市场产品的需求和市场竞争的促进，成熟的eda工具所能支持的，同时标志着最新eda工具所能支持的，同时标志着最新eda技术发展成果的新器件不断涌现，其特点主要表现为： （1）大规模。逻辑规模已达数百万门，近10万逻辑宏单元，可以将一个复杂的电路系统，包括诸如一个至多个嵌入式系统处理器、各类通信接口、控制模块和dsp模块等装入一个芯片中，即能满足所谓的sopc设计。典型的器件有altera的stratix系列、excalibue系列；xilinx的virtex-ii pro系列、spartan-3系列（该系列达到了90nm工艺技术）。 （2）低功耗。尽管一般的fpga和cpld在功能和规模上都能很好地满足绝大多数的系统设计要求，但对于有低功耗要法语的便携式产品来说，通常都难于满足要求，但由lattice公司最新推出的ispmach4000z系列cpld达到了前所未有的低功耗性能，静态功耗20微安，以至于被称为0功耗器件，而其它性能，如速度、规模、接口特性等仍然保持了很好的指标
艾睿电子公司（Arrow Electronics, Inc.）与ADI公司（Analog Devices, Inc. ）和Altera今天共同宣布，推出一款名为BeScope子卡的高精度评估板。该产品与BeMicro Cyclone V现场可编程门阵列开发套件的结合，有助于实现...
艾睿电子公司（Arrow Electronics, Inc.）与ADI公司（Analog Devices, Inc. ）和Altera今天共同宣布，推出一款名为BeScope子卡的高精度评估板。该产品与BeMicro Cyclone V现场可编程门阵列开发套件的结合，有助于实现...
Altera公司日前宣布推出可编程逻辑业界的顶级软件Quartus II开发软件10.0版，为其CPLD、FPGA以及HardCopy ASIC设计提供最高的性能和生产效率。Quartus II软件10.0版可以为高密度设计提供比主要竞争对手快2到3倍的编译时间，从而能够继续保...
Altera公司今天发布业界第一款单片FPGA高清晰(HD)互联网协议(IP)监视摄像机参考设计，进一步为监视市场提供扩展FPGA解决方案。这一独特的解决方案采用了Altera低成本Cyclone III或者Cyclone IV FPGA以及Eyelytics和Apical的知识产权，支持...
Altera公司近日发布业界带宽最大的FPGA——下一代28-nm Stratix V FPGA。Stratix V FPGA具有1.6 Tbps串行交换能力，采用各种创新技术和前沿28-nm工艺，降低了宽带应用的成本和功耗。
Stratix V FPGA系列采用TSMC 28nm高性能(H...
“我到现在都不明白，为什么我们会在65nm市场上取得98%的份额”，赛灵思亚太区高端市场产品经理梁晓明半开玩笑地对电子工程世界说，他说这话时是2008年5月21日上午11点半，此时距离其最大的竞争对手altera在北京发布40nm的产品仅17个小时。 梁的话在外人听来难脱酸葡萄的干系，因为到现在为止，赛灵思在45nm这个工艺节点上的产品没有对外透露任何细节。但你又不得不承认，虽然梁有意或无意地没有提及这个98％指的仅是高端市场，在低成本65nm市场上，altera的cycloneiii是目前市场上惟一的产品，但无疑在65nm市场上，赛灵思取得了完胜。 当altera以这次盛大的40nm发布摆脱一段时间以来被赛灵思压着打的被动局面，一抒胸中恶气时，赛灵思显然不愿意给对手任何情面，一方面继续高调宣扬自己在65nm的绝对领导地位，另一方面称现在进军40nm显然过早，“你可以继续观察这个40nm的神话接着如何发展下去”，梁晓明的“神话”用词显然别有深意。 然而不可否认的是，40nm这个标杆已是如此眩目地插在了fpga的阵地上，这究竟会带来什么呢？ 40nm，
altera是一个团结紧密的团体，每一个成员都有共同的坚定的信念和为此信念奋斗不息的激情。我从john daane身上也看到这一点。daane是一位年轻的ceo，在加入altera之前，他在lsi logic公司工作了15年，负责asic技术的研发。这又是他们的一个共同特点，这些投身fpga事业的人物，几乎都曾是asic行业的专家。看来他们的确是一群志同道合的人，在若干年前看到fpga行业发展的大好前景，所以聚到一起来了。 如果现在让我历数采访过的altera公司的人物有哪些，我确实有些搞不准了。从2001年第一次接触ltera采访当时的亚太区副总裁李彬到现在，恐怕有七、八位了吧？这几年来，整个半导体行业经历了从低谷慢慢走出来的艰难历程，而我的目光也一直追随着altera公司的发展脚步，它的每一次生产工艺的更新和每一代新产品的问世无不历历在目。作为fpga领域双雄之一，altera每推出一个创新性的方案都会多多少少影响人们对fpga产业的看法。fpga产业近几年来发展趋势迅猛，吸引了越来越多人的眼球。遗憾的是我却一直没有跟altera的ceo先生直接对话的机会。
由于altera公司在新产品创新上取得成功并与台积电(tsmc)之间建立的强大合作关系，从2009年第四季度到刚刚过去的2010年第二季度，该公司业绩连续三个季度创造历史新高。 40nm器件应用全面开花 “40nm产品是altera历史上最成功的产品之一。”altera公司亚太区高级市场经理罗嘉鸾对《中国电子报》记者说，“到目前为止，40nm产品在中国的应用情况非常好。尽管大部分项目仍然处于原型开发阶段。我们认为，今后几年，当我们赢得的客户项目开始投入量产时，我们在这方面的投入会有令人满意的回报。” 据悉，altera 40nm stratix iv已于2009年8月全部实现量产，而另一个40nm系列arria ii也于今年上半年全部实现量产。 “实际上，altera 40nm fpga器件已经伴随客户的批量生产步入实际应用阶段。在刚刚结束的中国移动td四期招标中，采用altera 40nm fpga器件的td基站中标，目前已随基站开始发货。”骏龙科技有限公司altera产品事业部经理胡晟对《中国电子报》记者说，“而且，在我们接触的客户中，很多客户在几个项目或几十个项目
室，负责dsp（数字信号处理）和低成本解决方案的开发和客户支持。他们的主要业务包括dsp、嵌入式、无线、视频和监测等应用的ip（知识产权）开发、参考解决方案设计和整体解决方案设计。 目前在中国内地市场，赛灵思公司与三大分销合作伙伴包括安富利、好利顺和世健科技一起为该地区日益增长的fpga用户需求提供专业快捷的支持。同时，作为一家知名的无生产线半导体企业，赛灵思公司将其低成本的cpld(复杂的pld)系列的生产外包给国内领先代工厂———和舰科技。 拓展业务领域加大中国投入 altera亚太区副总裁兼董事总经理erhaanshaikh altera很早就认识到了中国的发展潜力，自进入中国之日起，就一直不断加大在中国市场的投入。早在2000年，altera公司就宣布在中国上海成立亚太区技术支援中心，这一举措体现了altera对亚太区特别是中国的长期投资策略。 近年来，全球半导体产业整体增长速度在5%-7%之间，而整个可编程逻辑器件(pld)产业的增长速度约为10%-15%，几乎是整个半导体产业增速的两倍。与此同时，在技术创新的推动之下，中国市场对可编程逻辑器件的需
短短几天之内，先是altera宣布取得mips32架构的授权，接着xilinx又和arm全面合作。两个消息的接踵而至，让利用fpga进行设计的工程师得有一段时间进行消化。毫无疑问，当fpga的两大巨头和微控制器最流行的两大架构分别迅速达成了协议，这会对他们产生切身的影响，但影响究竟会有多大，恐怕一时半会儿很难看清楚。 股市是晴雨表，美国时间19日，当xilinx和arm合作的消息公布后，xilinx的股票涨了1.6%，而arm的涨幅则超过3%。这表明了金融界对此事前景的看法。 但必须承认的是，fpga与微控制器两个产业的合作并不新鲜。熟悉altera产品线的工程师们都清楚，除了altera自己的nios核之外，还有arm的cortex m1、飞思卡尔的coldfire。而xilinx本身，也是在自产自销的microblaze核之外，还有powerpc核。即使是arm公司与fpga的合作，就能数出一堆来，从altera到actel，再到今天的xilinx。 不过，中国人做事讲究的是“天时、地利、人和”，同样的一件事在不同的时期做，不同的环境，结果也许会完全不同。 金饭碗
块的逻辑控制电路，并在fpga上实现。该自动售货机能够根据投入硬币额度，按预定的要求在投入硬币大于规定值时送出饮料并找零。 设计方案 本文所设计的简易自动售货机可销售矿泉水，假设每瓶1.5元。设两个投币孔，分别接收1元和5角两种硬币，两个输出口，分别输出购买的商品和找零。假设每次只能投入一枚1元或5角硬币，投入1元5角硬币后机器自动给出一瓶矿泉水；投入2元硬币后，在给出一瓶矿泉水的同时找回一枚5角的硬币。另外设置一复位按钮，当复位按钮按下时，自动售货机回到初始状态。 开发软件选用功能强大的altera公司的最新可编程逻辑器件开发工具quartus ii 8.0，实现芯片选用altera公司flex10k系列的epf10k10lc84-4；首先在计算机上完成程序设计、编译及时序仿真，然后将经过验证的设计文件下载到选择的可编程逻辑器件中，并在电子设计自动化实验系统中进行硬件模拟和测试。 状态机vhdl程序设计 有限状态机fsm(finite state machine)及其设计技术是实用数字系统设计中实现高效率、高可靠逻辑控制的重要途径。传统的状态机设计方法需进行繁琐的状态分配、绘制状态表、
的典型最佳工作频率为l mhz，该器件具有2160位有效像元，正常工作时要有52个虚设单元输出(dummy 0utputs)信号(含暗电流信号)。因为该器件是二列并行传输，所以在一个周期内至少要有1 106(2 212/2=1 106)个φ1脉冲，即tsh>1106tφ1。另外，由时序图可以看出，当sh信号为高电平期间，ccd积累的信号电荷包通过转移栅进入移位寄存器，移位脉冲φ1、φ2要求保持一个高和低的电平状态。 3 fpga器件的选择 根据设计要求和工程需要，本设计选用altera公司cyclone系列产品中的eplcl2q240c8型嵌入式可编程逻辑器件。eplcl2q240c8采用基于1.5 v、0.13μm及全层铜sram工艺，其密度增加至20 060个逻辑元件(le)，ram增加至288 kb。它具有用于时钟的锁相环、ddr sdr和快速周期ram(fcram)存储器所需的专用双数据率(ddr)接口，具有在系统可编程特性。其配置方式有被动型和主动型，被动型配置是在上电后由计算机通过编译后产生sof文件利用专用的下载电缆配置电路。主动型配置是在上电后由专门的可编程配
ll 的捕捉时间和捕捉带宽。为提高相位跟踪的精度以降低数据接收的误码率，时钟信号clk的取值应尽量高。本设计中取高速时钟信号clk的振荡频率为64mhz。数控振荡器可由一个可逆计数器实现。 n分频器的设计 n分频器则是一个简单的除n计数器。n分频器对脉冲加减电路的输出脉冲再进行n分频，得到整个环路的输出信号fout。同时，因为fout=clk/2n=fc，因此通过改变分频值n可以得到不同的环路中心频率fc。另外，模值n的大小决定了dpll的鉴相灵敏度为π/n。 环路实现 本设计在altera公司quartusii5.0 开发软件平台上，利用vhdl语言运用自顶向下的系统设计方法， 在altera最新cpld芯片maxii240上设计全数字锁相环。将锁相环路设计完毕后，并通过quartusii5.0集成环境进行仿真、综合、验证，dpll设计结果如图3。图3 改进型异或门鉴相器dpll原理图 其中，可逆计数器counter2为环路滤波器dlf，预设初值为12，加法进位模值为4，减法进位模值为12。可逆计数器lmp_counter2为数控振荡器，其预置值为time[3..0]，其输
dac7714的接口电路图如下所示： 图是dac7714应用于质谱仪器测控模块中的新产品电路图。该系统中采用了altera公司的ep1c3型fpga的i/o资源丰富，但是由于整个仪器的检测控制信号数量很大，因此在设计各部分时应尽量在满足要求的前提下节约fpga的i/o资源，考虑上述原因，我们在设计离子源的部分地象控制中选用了dac7714。本系统采用ref01通过运放为dac7714提供双极性基准电压，片选择端接低电平，通过软件对地址的操作实现对器件或通道的直接选择。、sdi、clk、接fpga，由于fpga产生相应的时序实现其工作输出-10v~10v控制电压。其中fpga选择的是altera公司cyclone系列中的ep1c3t144。 来源:雪儿
频电源部分滤波用。 上海勤宏电子科技有限公司是一家集多家国际品牌的电子产品代理销售为一体的原厂授权代理商,负责在中国内地及香港市场的销售推广和技术支持工作,本公司位于上海浦东张江高科技园内,依托于原厂一级代理优势,立足于中国大陆。同时在深圳，杭州，南京等地设立办事处，利用完善的服务网络建立强大的优势为客户介绍引进各类先进高科技电子元件，协助各厂家生产品质优良的产品并提供完善的服务。 目前本公司主要代理分销的品牌有：rubycon,littelfuse,仙童， ti， atmel，maxim，altera，nxp，st，sst等国际知名半导体元器件，产品微控制器，dsp数字信号处理器，eeprom非易失存储器，混合信号ic等等，涉及行业有电源、家电、pda、音响功放、电话机、移动通讯、闪光灯、节能灯、电表、电脑及其周边设备、pda、照相机、手机、太阳能等市场。公司在上海，深圳均设有仓库备有大量现货库存，以供客户急单之用，欢迎客户来函来电咨询！ 尧凯 电子销售一部经理 上海勤宏电子科技有限公司 地址：上海市浦东张江高科蔡伦路333号创新港a楼208室 tel: 021-3392
altera nios介绍！在二○世纪九十年度末，可编程逻辑器件（pld）的复杂度已经能够在单个可编程器件内实现整个系统。完整的单芯片系统（soc）概念是指在一个芯片中实现用户定义的系统，它通常暗指包括片内存储器和外设的微处理器。最初宣称真正的soc――或可编程单芯片系统（sopc）――能够提供基于pld的处理器。在2000年，altera发布了nios处理器，这是altera excalibur嵌入处理器计划中第一个产品，它成为业界第一款为可编程逻辑优化的可配置处理器。本文阐述开发nios处理器设计环境的过程和涉及的决策，以及它如何演化为一种sopc工具。 altera很清楚地意识到，如果我们把可编程逻辑的固有的优势集成到嵌入处理器的开发流程中，我们就会拥有非常成功的产品。基于pld的处理器恰恰具有应用所需的特性。一旦定义了处理器之后，设计者就“具备”了体系结构，可放心使用。因为pld和嵌入处理器随即就生效了，可以马上开始设计软件原型。cpu周边的专用硬件逻辑可以慢慢地集成进去，在每个阶段软件都能够进行测试，解决遇到的问题。另外，软件组可以对结构方面提出一些建议，改善代码效率和/或处理器性能，
转贴一个好贴，绝对有帮助！！！from edacn探讨一些容易被忽略的数字电路设计要点提要最近看到论坛上对fpga的讨论越来越偏重于嵌入式系统设计，在altera论坛上开始看到对nios感兴趣的人也越来越多。然而，过分倾向于sopc与dsp builder的应用毕竟不是很好的学习方法。要知道，这些都是一种实现工具，而实现的构思则源于逻辑算法的创造与模仿。在这论点上，硬件描述语言为我们提供一个很好的管道，来表达我们理想的数字系统设计。至于从硬件描述语言到门级电路的转换，则得依靠于合成工具，对各种不同的描述方式提供相对应的门级电路模式。愈精确的描述，才能产生更接近于理想的数字系统，因此一个有异于软件编程的论点出现了，行数越多的设计描述，有时反而让门级电路更为精简。至此，门级电路在可编程逻辑里的实现这关键部分得完全依赖于工具来完成。我们知道时序的吻合将决定一个数字系统的可行性，因此除了精确的硬件描述之外，正确的添加约束可有效的提高数字系统的实现可能性。当我们再为深入的做思考，芯片与芯片的时序如何达到吻合，电路板在什么操作频率上应该把传输线特性作为考究，fan-out与gound bounce的关系应该如
(哈尔滨)altera.html">altera nios ii 嵌入式处理器介绍及应用研讨会altera.html">altera nios ii 嵌入式处理器介绍及应用研讨会(哈尔滨)主办单位: altera.html">altera时代益华元件中国有限公司(achieva)哈尔滨工业大学 时间: 2006年11月29日 14:00-17:30 地点: 哈尔滨工业大学科学园c1栋机器人所4楼第一会议室 演讲人: altera.html">altera 销售经理(北方区): 林斌 先生altera.html">altera 现场技术应用经理(北方区): 蒋治 女士achieva 现场应用工程师(北方区): 耿四军 先生 研讨会报名联系人:李志勇 13910840743 david.li@achieva.com.hk耿四军 13810683565 sijun.geng@achieva.com.hk 内容安排: 时间 内容 14:00 --14:30 altera.html">altera及achieva公司介绍 14:30 --15:15 pld的发展方向及altera产品介绍及应用 15:15
采用altera max ii cpld, 降低便携式应用系统总成本随着市场对小型低廉产品需支持高性能，电池供电时间较长的需求不断增长，使便携式应用日渐广泛成本、功耗和电路板空间成为设计便携式产品时需要考虑的关键因素。在业界具有最低成本的cpld ，max® ii cpld现提供最新的超小封装以及新颖的节电功能，与同类cpld相比，成本和功耗平均降低50%。altera公司将于8月1日举办关于采用altera max® ii cpld, 降低便携式应用系统总成本 -- 在线研讨会。在此次研讨会上, 您将了解便携式应用市场动态, 如何利用altera的低成本小封装max® ii cpld来降低系统成本和功耗及减小电路板空间，并有机会与顶尖技术专家进行互动问答式的课题交流和探讨。 立即注册 主题： 采用altera max® ii cpld, 降低便携式应用系统总成本 时间： 2006年8月1日 上午10：00~11：30 (北京时间) 主讲： 王冬刚先生 - altera亚太区产品和渠道营销工程师简介：王冬刚毕业于上海交
谁有maxplus2下的drivers\win2000\win2000.inf[source media descriptions] 1 = "altera.html">altera programmer driver" , tagfile = disk1 2 = "altera.html">altera byteblaster driver" , tagfile = disk1[installable.drivers]driver1 = 1:pgdnt.dll, "altera", "altera.html">altera programmer" , , ,driver2 = 2:pgdhdlc.dll, "altera", "altera.html">altera byteblaster" , , ,[driver1]1:pgdnt.sys1:pgdnt.hlp[driver2]2:pgdhdlc.sys
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