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便可最多到数百米。采用lvds接口芯片的系统如果必须进行长距离的数据传送，便应采用专为驱动较长电缆而设的芯片，并将之搭配lvds芯片一起使用，以便互相支持。图2所示的通信通道采用10位的lvds串行/解串器，以及串行数字接口电缆驱动器/均衡器芯片组，驱动经同轴电缆传送的信号。 这条传输通道采用美国国家半导体10位的串行/解串器(可以有很多选择，国家半导体推出了10位/16位/18位的serdes，maxim也推出了自己的这类产品)以及串行数字接口电缆驱动器/均衡器芯片组(比如clc001和clc012，现在国家半导体又推出了一系列这类产品，如clc005和clc014，性能有了很大提高)。这组串行/解串器可以缩小连接器及电缆的体积，有助降低系统成本。此外，串行/解串器还可充分利用低电压差分信号传输的优点，例如卓越的抗噪声干扰能力、低功率操作、低电磁干扰以及简单的终端设计。 在利用10位的lvds串行/解串器以及串行数字接口电缆驱动器/均衡器芯片组驱动，经由双绞线电缆传送的信号的例子中，除了采用的电缆有所不同之外，这条通道与图2所示的通道只有一个区别，就是r1～r6的电阻值。这些电阻值的
500e的配置文件大小为2 mb，本系统采用存储量为16 mb的m25p16作为配置存储器。 2．2 传输部分电路设计 传输部分设计包括选择同轴电缆和设计相应的发送接收电路。本系统选用的同轴电缆型号为svy-50-3，成本低、性能好。这款电缆的特征阻抗为50 ω，速率150 mhz时信号传输100 m的最大衰减为18．01 db。它具有良好的屏蔽特性，可以在复杂的电磁环境中正常工作。电缆驱动电路和接收均衡电路分别选用national semiconductor公司的芯片clc005和clc012。clc005支持lvds电平输入，最高传输速率达到622 mb／s，输出信号峰一峰值从o．7～2 v。clc012可以自动均衡频率在50～650 mhz的信号。时钟恢复器件选用clc016，它的输入信号来自clc-012，输出时钟和数据接fpga，恢复的时钟在数据上升沿有效。clc005和clc012用于特征阻抗为75 ω的传输系统，针对本系50 ω特征阻抗的同轴电缆，需要改动外围电阻配置，否则会因为阻抗不匹配引起信号反射，最终导致信号传输质量下降。相应的配置方式如图2所示。 通过测
s接收器可以承受1 v的驱动器与接收器间对接地的电压差。由于lvds驱动器典型的偏置电压为1．2 v，所以其电压差驱动器典型的偏置电压以及轻度耦合噪声之和范围为0．2～2．2 v。建议接收器的输入电压范围为0～2．4 v。 3 总体设计方案 系统设计要求传输速度应在1~16 mb／s自动适应，传输距离不小于300 m，且必须与其他系统电磁隔离，避免电磁干扰。因此，该系统设计采用集成的lvds接口器件ds92lvl021，其数据传输速度是1*0 mb／s，10位数据位。而clc001，clc012为专用长线电缆驱动器，与光模块相结合可将传输距离扩展2 km，且外部电路简单，功耗低。fpga选用spartan一2系列器件，其最高工作速度为200 mhz，逻辑宏单元丰富，满足系统设计要求。因此，该系统设计选用lvds接口器件实现lvds长线传输，而记录器、测试台和lvds器件接口的时序匹配则选用fpga实现。 图1为系统设计的框图，测试台发送的state、ctll、ctl2等状态及控制信号传送至记录器，并将记录器发送的数据及同步时钟传送至地面测试台。其中，记录器、lvds发送端、lvd
引言 毫无疑问，在clc014和clc012自适应电缆均衡器实现良好性能的时候，它们同时也给数字视频设计工程师带来了最大的挑战。使用中的困难是因为没有能正确地认识这些器件，事实上它们是高性能的模拟器件而不是简单的数字器件。更确切地说，clc014和clc012是高增益、大带宽、模拟、射频、带自动增益控制的（agc）放大器-滤波器。为了获得最佳的性能并避免一些觉的问题，必须仔细小心地开发电路和pcb布局。本应用注释是对已经难的实用技术的使用指南，在设计过程中使用该技术，能帮助消除棘手的难题并可以提供最佳的电路性能。查看详细说明：应用在自适应电缆均衡器的pcb布局技术.pdf 来源:ddcode
自动均衡的同轴电缆和双绞线电缆；信号损失的检测和输出静音；输出眼监控；单电源操作：＋5V或－5.2V，单端或差分输入；低成本
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