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  • 采用FPGA的振动模拟器设计

    沿，就拉低cs片选，第二次探测到sclk上升沿时已经至少是下一个240mhz的上升沿了，从而满足tlead（见图3、图4）参数的要求。cs低时，一旦240mhz时钟探测到sclk下降沿，将register的最高位数据赋给sda，将register左移一位，sda保持不变，直到下一个sclk下降沿。当捕捉到sclk的第17个下降沿时，将cs拉高。由此即可满足以上的图3、图4对时序的要求。 图3 dac8581 时序图 图4 dac8581时序要求 4．3 fpga对dac8820芯片的控制 dac8820产生振动噪声。16位并行，最高数据更新率4mhz，是电流输出型。本系统设有2个用户按键，分别表示产生40khz～100khz，100khz～200khz的噪声频率范围，fpga接收按键信号确定噪声的频率范围，在此频率范围内产生一个随机频率，由此计算得到dac8820的数据更新率，fpga按此频率准备数据以更新并行dac的数字输入。由dac8820将其进行数模转换，模拟实际振动台在可能受到外界各种干扰信号后产生的噪声情况。 dac8820的引脚wr（低有效）是

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