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时产生行脉冲信号，对行脉冲信号计数产生帧周期；在电荷转移阶段帧转移脉冲φp1～φp4(行转移控制信号φm1～φm4)组成第二部分内循环，信号间的时序关系由主时钟分频、移位实现。 在设计上，需要注意以下两点： (1)帧转移脉冲φp1～φp4的占空比为5：3，因此先用一个八进制的计数器设计出占空比为5：3的脉冲，再由帧时钟φa的控制及移位操作来实现其严格的时序。 (2)对于φa和φp1～φp4，手册上对其波形的边沿变化时间有限制，对于时间上限，由于信号从fpga输出之后是通过驱动器el7212驱动后送入ccd的，而el7212输出波形的上升及下降时间的最大值已满足此上限要求；对于时间下限，可在ccd管脚附近增加电容和电阻调节波形边沿的陡峭度来满足要求。 1．3 ccd驱动时序的仿真 设计采用ise 10．1自带的仿真工具对时序进行仿真，并对xilinx公司的fpga芯片xc3s50进行配置下载，通过功能仿真验证设计的可行性。驱动时序的仿真结果如图2，图3所示。 由图可见，设计完成了ccd对驱动信号的要求。 2 电源变换电路 ccd电路的工作电压取
ccd512h正常工作时需要11路驱动信号，这包括加在感光区的三相时钟脉冲a1，a2，a3;加在存储区的三相时钟b1，b2，b3；加在读出寄存器的三相时钟c1，c2，c3；清除残留电荷的复位脉冲ret；箝位脉冲clamp。以上驱动信号均由fpga产生时序，但其时序不能直接输送给ccd芯片，一方面因为ccd驱动电平比较特殊；另一方面，ccd各移位寄存器等效于容性负载，而且各级容性负载不尽相同，所要求的驱动电流也不相同。所以在驱动电路的选择上，应选择具有较高电容负载驱动能力和较高工作频率，该设计选用el7212。 3 数据采集处理 3．1 a／d变换电路 3．1．1 a／d芯片介绍 a／d芯片是数据采集系统的核心器件，数据采集系统性能在很大程度上取决于a／d芯片的性能。根据项目要求a／d器件的分辨率应为12位，转换速率为16 mhz，共16路，故选用高速a／d芯片ad9942。因它可实现两路模拟信号的40 mhz速率相关双采样(cds)，0～18 db 9 b可变增益放大(vga)，40 msps模／数转换器(adc)，多极暗电平箝位控制。ad9942功能框图如图2所示。
单端输出模式下， 水平移位时钟对应图像传感器的管脚连接如下： h1=h1s(5)+h1bl(4)+h2br(9); h2=h2s(7)+h2bl(3)+h1bl(8)。h1，h2，r 共用一片74ac04 驱动器，每个时钟使用两个门驱动，再配合滤波电容和钳位电路便可以实现对面阵ccd 的水平 和复位驱动。 垂直转移需要 v1、v2 两相驱动时钟，其中v2 为三电平，因为fpga 产生的信号只有‘0’ 和‘1’两种状态，所以需要将信号v2 分解成v2hm 和v2ml 两个信号。v1 通过一片el7212 进行驱动，配合滤波电容和钳位电路实现。 v2 驱动器选用一片max4426，通过v2hm 控制其 电源端（将v2hm 反向）。当v2hm 为高的时候，max4426 产生峰峰值9v 的输出信号，当 v2hm 由高变低时，max4426 的电源端被升到18v，从而产生出满足要求的三电平信号v2。 电子快门脉冲电压为 vab~vab+40v（峰峰值为40v），使用分立元件产生，具体电路的原 理图如图2 所示。 5、ccd 驱动时序设计 kai-0340s工作需要6路驱动信
ccd out通常需要做电压转换及驱动你可能是用了不同的测试仪器或是不同阻抗的输入端。由于ccd的负载能力过弱，因些业界采用pin－driver的方式做缓冲处理，el7202，el7212，el7457是较常用到的驱动转换芯片。
用场效应管和电感使用一个比较大的高频电感作为场效应管的漏极负载，这样可以在开关工作状态的场效应管漏极产生很高的输出电压，之后是阻抗匹配电路和压电陶瓷连接。电压不够可以采用两个这样的电路推挽输出。场效应管驱动可以采用el7212。
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