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图1所示。 图1 系统主要硬件功能框图 本测频系统中fpga芯片是采用altera公司cyclone系列的ep1c3t144,该器件采用tpfq封装,拥有100个i/o口和2910个逻辑单元。本系统采用verilog hdl和blockdiagram/schematic相结合的方法来对各功能模块进行逻辑描述,然后通过eda开发平台,对设计文件自动地完成逻辑编译、逻辑化简、综合及优化、逻辑布局布线、逻辑仿真,最后对fpga芯片进行编程,实现系统的设计要求。fpga配置采用了专用配置芯片epcs1,用byteblaster ii对其进行下载编程。 mcu主要实现的功能有32位计数值的浮点转换及运算、预置闸门和将测量结果送至液晶显示。高频分频主要针对50mhz以上的频率测量,电路中采用分频比可编程的微波分频芯片mb510,最高工作频率达2.4ghz,它自带放大整形电路,输出为ecl电平,应用十分简单。整形电路前级采用了高速场效应管放大,所以对于被测信号的灵敏度很高,可达20mv左右,因此本系统对于电路板的设计要求是十分严格的。 fpga的模拟仿真 本系统fpga开发软件采用alt
图1所示。 图1 系统主要硬件功能框图 本测频系统中fpga芯片是采用altera公司cyclone系列的ep1c3t144,该器件采用tpfq封装,拥有100个i/o口和2910个逻辑单元。本系统采用verilog hdl和blockdiagram/schematic相结合的方法来对各功能模块进行逻辑描述,然后通过eda开发平台,对设计文件自动地完成逻辑编译、逻辑化简、综合及优化、逻辑布局布线、逻辑仿真,最后对fpga芯片进行编程,实现系统的设计要求。fpga配置采用了专用配置芯片epcs1,用byteblaster ii对其进行下载编程。 mcu主要实现的功能有32位计数值的浮点转换及运算、预置闸门和将测量结果送至液晶显示。高频分频主要针对50mhz以上的频率测量,电路中采用分频比可编程的微波分频芯片mb510,最高工作频率达2.4ghz,它自带放大整形电路,输出为ecl电平,应用十分简单。整形电路前级采用了高速场效应管放大,所以对于被测信号的灵敏度很高,可达20mv左右,因此本系统对于电路板的设计要求是十分严格的。 fpga的模拟仿真 本系统fpga开发软件采用al
上加一个低电平脉冲,随后发送数据,从而完成对fpga的重新配置。 本设计是通过dsp处理器来接收pc主机的fpga配置数据流,并开发cpld器件以实现控制逻辑,最终把所需的fpga配置数据流存储到支持as配置模式的epcs配置芯片中,并实现fpga配置数据流的更新,从而达到fpga的重新配置,实现整个系统的可重构。其可重构电路由dsp与cpld串行通讯电路、cpld读写epcs配置芯片电路和epcs配置fpga电路组成。 2.2 epcs配置器件 fpga的串行配置芯片主要包括epcs1,epcs4,epcs16,epcs64,epcs128等。它们的主要区别是容量不同,分别为1 m,4 m,16 m,64 m,128 m bits的容量,可配置的fpga器件也有所不同,用户可根据不同需求来选择。epcs配置芯片的擦除或编程次数可以达到十万次左右,一般情况下足以满足用户需求。epcs器件电平的选择包括3.3 v、2.5 v、1.8 v、1.5 v,主要可参考对应的fpga所用i/o bank的vccio引脚电平的选择。 epcs芯片的内部结构框图如图1所示,epc
环,13个18x18的乘法器模块。 在fpga硬件电路设计中需要注意的问题就是jtag下载电路、配置芯片eeprom电路与fpga的连接关系。fpga每次上电后都需要进行配置,从eeprom中将数据读入,然后开始运行。根据fpga在配置电路中的角色,其配置数据可以使用3种方式载入到目标器件中,分别是:fpga主动(active)方式;fpga被动(passive)方式;jtag方式。在fpga主动方式下,由目标fpga来主动输出控制和同步信号(包括配置时钟)给altera专用串行配置芯片(如epcs1、epcs4等),在配置芯片收到命令后,就把配置数据发送到fpga,完成配置过程。要注意的是:altera fpga所支持的主动方式,只能够与altera公司提供的主动串行配置芯片(epcs系列)配合使用。这种配置模式只有在stratixⅱ和cyclone系列(cyclone和cycloneⅱ)的器件中支持。在被动方式下,是由系统中的其他设备发起并控制配置过程。比较常用的是jtag配置方式jtag是ieee 1149.1边界扫描测试的标准接口。绝大多数的altera fpga都支持由jtfag口
图1所示。 图1 系统主要硬件功能框图 本测频系统中fpga芯片是采用altera公司cyclone系列的ep1c3t144,该器件采用tpfq封装,拥有100个i/o口和2910个逻辑单元。本系统采用verilog hdl和blockdiagram/schematic相结合的方法来对各功能模块进行逻辑描述,然后通过eda开发平台,对设计文件自动地完成逻辑编译、逻辑化简、综合及优化、逻辑布局布线、逻辑仿真,最后对fpga芯片进行编程,实现系统的设计要求。fpga配置采用了专用配置芯片epcs1,用byteblaster ii对其进行下载编程。 mcu主要实现的功能有32位计数值的浮点转换及运算、预置闸门和将测量结果送至液晶显示。高频分频主要针对50mhz以上的频率测量,电路中采用分频比可编程的微波分频芯片mb510,最高工作频率达2.4ghz,它自带放大整形电路,输出为ecl电平,应用十分简单。整形电路前级采用了高速场效应管放大,所以对于被测信号的灵敏度很高,可达20mv左右,因此本系统对于电路板的设计要求是十分严格的。 fpga的模拟仿真 本系统fpga开发软件采用alt
【请教】fpga的配置问题小弟正在学fpga,用cyclone的ep1c3t144和51单片机做了一块板子。其他功能都正常,现在配置时有个问题:如果用jtag在线调模式,电路就正常工作。而如果用主动(active)串行方式配置电路就非常不稳定,时好时坏。不知是何缘故?望各位高手指点。其中fpga的配置芯片是epcs1n.html">epcs1n,配置电路是参考一个开发板的电路图(见附图)。由于自己没有epcs1的datasheet,所以也不知道电路是不是接错了。如果哪位仁兄有epcs1的datasheet,请发一份给我参考参考,我的邮箱是:yi.xiang@163.com谢谢!
烧写epcs1哪有一个page0脚呀?倒有一个data脚,用data0 作这配置epcs1的数据脚。
=============================================================================底板==============================================================硬 件 部 件 功 能 描 述 备 注fpga altera cyclone ep1c6 12万门,兼容ep1c12,门数加倍;epcs1 ep1c6 上电配置芯片 兼容epcs4rom nor flash, am29lv160 同时兼容am29lv320,4m bytesram 61lv25616 512k byte以太网芯片 10mbps cs8900a 带变压器内置的rj45接口音频a/d、d/a uda1341 i2s接口,双声道输出,mic输入eeprom 存储设备 符合iic总线接口红外接收器 红外信号接收设备
=============================================================================底板==============================================================硬 件 部 件 功 能 描 述 备 注fpga altera cyclone ep1c6 12万门,兼容ep1c12,门数加倍;epcs1 ep1c6 上电配置芯片 兼容epcs4rom nor flash, am29lv160 同时兼容am29lv320,4m bytesram 61lv25616 512k byte以太网芯片 10mbps cs8900a 带变压器内置的rj45接口音频a/d、d/a uda1341 i2s接口,双声道输出,mic输入eeprom 存储设备 符合iic总线接口红外接收器 红外信号接收设备
cyclone ep1c6q240c8error: can't recognize silicon id for device 1请问是否我的器件可能坏了,说明一下,我的jtag口能够正常工作,在选择主动串行下载epcs1时出现上述错误,查看帮助后否定了帮助所列出的所有可能,不知各位大峡可有良策!