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ut控制的开关电路组成,同时控制输出的sload 信号的脉宽为半个16 fc的周期。图7为图5和图6电路的仿真波形。 6结束语 本文给出了一种适用于cdma2000 bts时钟同步的解决方案,主要给系统提供10mhz,2s,16 fc和48 fc等频率的时钟。该解决方案使输出时钟具有gps/glonass接收信号的长期稳定性和由ocxo提供的短期稳定性,完全满足cdma2000协议所规定的同步精度。整个数字逻辑电路用一片altera公司的epm7256aetc100-5。该方案已在实际工程中运用。 来源:零八我的爱
电路和一个由detout控制的开关电路组成,同时控制输出的sload 信号的脉宽为半个16 fc的周期。图7为图5和图6电路的仿真波形。 6结束语 本文给出了一种适用于cdma2000 bts时钟同步的解决方案,主要给系统提供10mhz,2s,16 fc和48 fc等频率的时钟。该解决方案使输出时钟具有gps/glonass接收信号的长期稳定性和由ocxo提供的短期稳定性,完全满足cdma2000协议所规定的同步精度。整个数字逻辑电路用一片altera公司的epm7256aetc100-5。该方案已在实际工程中运用。 来源:零八我的爱