带有此标记的料号:
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850
PGA/1001+
全新原装现货库存 询价请加 有其他型号也可咨询
IDT7025L55PF
5000
QFP/10+
原装IDT系列量多从优新亚洲4B025
IDT7025L55GB
260
PGA68/21+
全新原装可含税
IDT7025S55GB
210
CPBGA/15+
原装现货假一罚十
IDT7025L25GB
28
PGA/84/1549+
全新原装,现货库存
IDT7025L55GB
608
PGA/1011+20+
专营品牌质保壹年
IDT7025S20PF
2560
TQFP100/19+
现货+库存优势出
IDT7025S55PFI
1650
QFP/24+
100%原装进口现货特价,长期供货
IDT7025L20PFI
4218
QFP/22+
市场价原厂原装假一罚十
IDT7025L30G
8000
PGA/22+
原装现货
IDT7025L55GB
18
PGA/0939+
0939+
IDT7025L55GB
52
PGA/-
自己现货,深圳交易
IDT7025L20JI
100000
-/21+
只做原装
IDT7025S35PFI
1
QFP100/9948+
-
IDT7025S35JI
15
PLCC/13+
量大可供 配单/陈店贵屿一手货源
IDT7025L45G
4
CPGA/94+
只有全新原装
IDT7025L55GB5962-9161704MXA
-
0749/1
-
IDT7025S25PF
50
QFP/22+
原装现货
IDT7025L25J
8
PLCC/-
深圳现货
IDT7025L55PF
39
QFP/11+
-
用于制造业自动化控制各个领域。 1 硬件电路总体设计 为实现对多电机的半闭环控制提供了一个良好的开发平台。本项目是设计一款基于pci总线的,以dsp芯片tms320f2812为核心的多轴运动控制卡。将pc机的信息处理能力和开放式的特点与运动控制器的运动轨迹控制能力有机地结合在一起,利用双口ram作为公共存储单元实现上/下位机的通信。 系统硬件总体设计功能框图如图1所示。 2 双口ram接口电路设计 2.1 双口ram与dsp和ch365的连接 本系统选用双口ram芯片idt7025作为dsp与ch365双向通信的缓冲芯片。idt7025芯片是一款高速的8k×16位双口静态ram,它提供2个独立的端口,允许两个(左、右)端口同时读/写数据,每个端口具有自己独立的控制信号线、地址线和数据线,可高速存取数据,可与大多数高速处理器配合使用,而无需插入等待状态。 双口ram允许2个cpu同时读取任何存储单元(包括同时读同一地址单元),但不允许同时写或一读一写同一地址单元。本系统采用基于邮箱机制的int中断法处理双口ramd地址竞争冲突现象,避免由此而产生的读/写错误。 下面
c104总线访问sram时,数据吞吐率约为2.5mb/s,满足系统要求。所以系统设计时采用了基于pc104总线的数据传输方式。信号处理机和工控机通过pc104总线的数据传输方法有多种。例如,可以采用dma方法,但是同时只能有一个系统访问存储器;还可利用并口锁存方法传输数据。但是这两种方法都不能获得高数据吞吐率。为了解决这个问题,可采用双口sram实现adsp-21062向工控机进行高速数据传输。系统设计时采用的双口sram可以是16bit或8bit。在本系统采用了8k×16bit的双口sram—idt7025。系统以16bit的数据进行传输,相比8bit的方式而言,有更高的数据吞吐率。 双口sram的工作原理双口sram的存储器阵列,有左右两套地址和数据总线。这样,位于两个端口的左右系统可以共享一个存储单元。当两个端口对双口sram进行读写时,存在下列可能情况:a:不同时对相同地址单元读/写操作;b:同时对相同地址单元读数据;c:同时对相同地址单元写入数据。idt7025内部有8个独立于双端口存储单元的锁存逻辑单元,作为令牌使用,可将空间划分成1~8个区段。使用这些单元产生一个使用标志,向另一个端
(如数据抽取、积分等)。整个电路系统采用模块化设计,便于调试及扩展。信号处理模块原理框图如图2所示。 在图2中,tmc2310和tms320c25之间设计了一个以乒乓方式工作的双口ram阵列,其作用有四:(1)存放待处理的数据(实部数据放在rem块,虚部数据放在imm块);(2)存放tmc2310所需的系数或参数(放在wdm块);(3)存放tmc2310的输出结果并作为tmc2310中间结果缓存;(4)构成tms320c25的运算内存。为了便于构成系统及满足实时需要,用一片idt7025双口ram(8k×16)构成一个tms320c25与外部共享的ram区,以便实时地与外部进行数据交换和通讯。这个双口ram区也以乒乓方式工作,以增强模块的宽容性。电路的乒乓工作方式控制逻辑是由tms320c25根据系统的节拍时序进行控制的。控制电路确保caa12与cab12互斥,cal12与car12互斥。整个电路简单、紧凑、协调有序。由于采用了vlsi器件设计,电路设计大大简化,调试方便、功能强大、性能可靠、吞吐量大(完成1024点fft的数据通过率为2.343m字/秒)。 3 软件设计
续处理及辅助运算(如数据抽取、积分等)。整个电路系统采用模块化设计,便于调试及扩展。信号处理模块原理框图如图2所示。 在图2中,tmc2310和tms320c25之间设计了一个以乒乓方式工作的双口ram阵列,其作用有四:(1)存放待处理的数据(实部数据放在rem块,虚部数据放在imm块);(2)存放tmc2310所需的系数或参数(放在wdm块);(3)存放tmc2310的输出结果并作为tmc2310中间结果缓存;(4)构成tms320c25的运算内存。为了便于构成系统及满足实时需要,用一片idt7025双口ram(8k×16)构成一个tms320c25与外部共享的ram区,以便实时地与外部进行数据交换和通讯。这个双口ram区也以乒乓方式工作,以增强模块的宽容性。 电路的乒乓工作方式控制逻辑是由tms320c25根据系统的节拍时序进行控制的。控制电路确保caa12与cab12互斥,cal12与car12互斥。整个电路简单、紧凑、协调有序。由于采用了vlsi器件设计,电路设计大大简化,调试方便、功能强大、性能可靠、吞吐量大(完成1024点fft的数据通过率为2.343m字/秒)。 3 软件
其主要接口电路如图2所示。 由dsp接口电路图可以看出,dsp模块为整个系统提供了时钟电路,dsp芯片的中断由ep20k200产生,一方面通知f206读取数据,一方面通知dsp进行错误处理,由于dsp芯片的流水线操作方式,数字信号处理速度功能强大,满足了1553b协议传输速率大的特点。 3.4 双口ram和显示模块 由于在高速数据处理和采集系统中容易造成数据堵塞现象,高速数据接口的设计对整个系统数据传输的畅通起着重要的作用,该设计中采用的美国ddc公司的8k双口静态ram idt7025解决了数据堵塞的问题。 在该设计中显示模块采用了一种内存接显示模块的硬件连接方式。dsp将欲显示的数据送入双口ram,51单片机不断扫描内存,根据内存中的数据做出相应的处理,不断刷新显示屏上的内容,双口ram的busy信号线为避免左右端口同时对同一存储单元写操作提供了硬件支持。设计中液晶显示模块采用16×16点阵的中文显示模块。 4 系统软件设计 该1553b航空电子总线检测仪软件设计主要包括3大部分,用以驱动数据采集板卡,完成对各寄存器的配置,实现数据的收发检测。 4.
口电路如图2所示。 由dsp接口电路图可以看出,dsp模块为整个系统提供了时钟电路,dsp芯片的中断由ep20k200产生,一方面通知f206读取数据,一方面通知dsp进行错误处理,由于dsp芯片的流水线操作方式,数字信号处理速度功能强大,满足了1553b协议传输速率大的特点。 3.4 双口ram和显示模块 由于在高速数据处理和采集系统中容易造成数据堵塞现象,高速数据接口的设计对整个系统数据传输的畅通起着重要的作用,该设计中采用的美国ddc公司的8k双口静态ram idt7025解决了数据堵塞的问题。 在该设计中显示模块采用了一种内存接显示模块的硬件连接方式。dsp将欲显示的数据送入双口ram,51单片机不断扫描内存,根据内存中的数据做出相应的处理,不断刷新显示屏上的内容,双口ram的busy信号线为避免左右端口同时对同一存储单元写操作提供了硬件支持。设计中液晶显示模块采用16×16点阵的中文显示模块。 4 系统软件设计 该1553b航空电子总线检测仪软件设计主要包括3大部分,用以驱动数据采集板卡,完成对各寄存器的配置,实现数据的收发检测。