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idt72v2113中文资料

  • IDT72V2113在高速数据采集系统中的应用

    idt72v2113在高速数据采集系统中的应用 华中科技大学电子与信息工程系 侯利军 王 殊 汪安民 高速数据采集是目前数据采集的发展方向。随着微电子技术飞速发展，电子器件运行速度有了很大的提高，几十兆采样频率的ad逐渐得到广泛的应用。但是，数据传输和存储一直制约着数据采集系统向更高速度上的发展。因此，如何进行高速的数据传输和存储是大容量连续数据采集系统的技术关键。目前一般是从两个方面进行考虑：1 采用高速传输协议，例如pci、usb2.0、1394等高速的数据传输协议，将采样数据传送到主机，然后进行后续处理；2 采用高速度、大容量的存储器件，如sdram、sbsram、fifo等,将采样数据存储在采集板上直接进行处理。其中高速fifo就是硬件上得到广泛使用的一种存储器件，本文详细介绍了美国idt公司的idt72v2113的内部结构、主要功能及其使用方法，并就如何实现多片72v2113的字长和深度扩展的软件和硬件连接给出详细的说明，最后讨论了fifo和数字信号处理器（dsp）的连接原理与方法。idt72v2113功能介绍idt72v2113是由美国idt公司生产的高速大容量先

  • USB2.0接口和DSP构成的高速数据采集系统

    统原理及器件选用整个高速数据采集处理系统的硬件构成为：高速adc、高速大容量数据缓冲、高性能dsp和usb2.0接口。系统的原理框图如图1所示。高性能dsp采用ti公司的tms320c6000系列定点dsp中的tms320c6203b；高速adc采用ti公司的ads5422，14位采样，最高采样频率为62mhz；pc机接口采用usb2.0，理论最大数据传输速率为480mbps，器件选用cypress公司ez-usb fx2系列中的cy7c68013；数据缓冲采用idt公司的高速大容量fifo器件idt72v2113；程序存储在flash存储器中，器件选用sst291e010。下面逐一介绍各个器件的主要特性。（1）tms320c6203btms320c6203b是美国ti公司高性能数字信号处理器tms320c6000系列的一种，采用修正的哈佛总线结构，共有1套256位的程序总线、两套32位的程序总线和1套32位的dma专用总线；内部有8个功能单元可以并行操作，工作频率最大为300mhz，最大处理能力为2400mips；内部集成了外围设备接口，如外部存储器接口（emif）、外部扩展总线（xb）、多通道缓冲串口

  • DSP嵌入式系统主程序代码

    系统上电后，ads5422一直工作，采样产生的数据是否存储到idt72v2113中，由tms320c6203b的dx0引脚状态来决定。tms320c6203b进行初始化，外部扩展总线的xce3设置为同步fifo读操作模式。dma通道0配置为每次传输1帧，每帧1024个半字（hw，halfword），同步事件设置为外部中断4，触发极j性为高电平，初始化定时器0，定时间隔为22 ms。 当外部同步信号到来时，启动定时器0，手动启动dma通道0，同时设置dx0为低电平。ads5422采样产生的数据开始写人idt72v2113，当定时器0中断到来时，设置dx0为高电平，关闭idt72v2113的写使能，采样数据不再存储到idt72v2113内。随着数据不断写入idt72v2l 13，当其内部的数据量大于1023 hw时，idt72v2113的将空标志信号（pae）由低电平变为高电平，使得tms320c6203b的外部中断信号有效，从而触发dma传输。tms3⒛c6203b的dma通道0通过外部扩展总线（xb）读取1024 hw的数据，存储于内部ram中，传输结束后向tms320c6203b发送中断，通知

  • FIFO的选择

    fifo大致可以分为3种类型，异步fifo、触发fifo、同步fifo。fifo一般都提供状态标志信号，这些状态信号包括空标志、满标志以及半满标志。此外，大部分fifo还提供专门的字长和字深扩展引脚。 根据ad和dsp的接口，可选择美国idt公司的fifo芯片idt72v21 13，idt72v21 13具有512k×9bit的数据空间、133mhz的操作时钟、最快5ns的读写周期、单－3. 3v电源供电、80脚tqpf封装的同步fifo。目前idt72v2113的国内价格为300元左右。 由于有1m多的数据量，而且idt72v2113只有512k×9bit的数据单元，所以必须做字长和字深扩展。如果不做字长和字深扩展将选择更大数据空间的fifo，而目前更大的fifo市场上很少，价格也很高。 idt72v21 13和dsp的接口使用dsp的扩展总线接口，可以方便地实现两者之间的连接。idt72v2113的写时钟和ad的采样时钟一样由dsp同一个引脚提供，dsp的该引脚可以同时驱动这两个芯片；idt72v21 13的读时钟由dsp的扩展总线接口提供；idt72v2113的其他控制信号，包

  • 基于PXI 总线的水声目标回波模拟模块的设计

    块包括模拟输入、数据采集、数据存储、数据回放、dds 方波产生器、pxi接口六部分。系统结构如图1 所示。其核心部分是ad 转换、da 输出、pci 接口及fifo的实现。模拟输入部分由运放直流耦合放大电路组成，主要功能是向后级电路提供可靠的模拟信号。系统中的ad 转换器采用analog device 公司生产的ad9709。采样时钟由高精度dds 芯片ad9850提供，并由cpld 进行控制，最高采样频率可达40mhz，并可实现逐hz可调。数据缓存采用异步fifo，系统选用两片512k×9 的idt72v2113，通过深度扩展，实现1m×9 的fifo。数据d/a 采用burr-brown 公司的ads831 芯片。fifo 的读写时钟、状态控制、ad 控制、da 控制以及dds 频率控制均由cpld 实现。 在采集波形存取中，采用了fifo 存储发射信号，主控模块通过读写地址产生电路对波形存取的过程进行控制。时钟产生模块为读写地址产生电路提供独立的读、写fifo 时钟，通过读、写fifo 时钟的频率差来实现回波信号的伸缩设置。fifo 存储器的读、写时钟由数字频率合成器(dds)ad9851 产

idt72v2113替代型号

IDT72V2105 IDT72V05 IDT72V04 IDT72V02 IDT72V01 IDT72281 IDT72220 Idt72205 IDT72105 IDT7208

IDT72V215 IDT72V231 IDT72V235 IDT72V36100 IDT72V36110 IDT72V3640 IDT72V3650 IDT72V3660 IDT72V3670 IDT72V3680

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