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摘要：提出了利用多软件平台进行fir数字滤波器的协同设计，改变了传统的只用硬件电路设计的方法，将整个数字滤波系统的硬件设计趋于软件化，采用lattice公司的可编程模拟器件isppac20和altera公司的fpga设计架构整个fir滤波器实验系统。由于isppac20和fpga器件的高度集成化以及结构的可重构、可编程，使开发人员随时可重复配置满足各种性能要求的滤波器系统，将整个系统变得更小型化、更易于升级维护且更灵活。 0 引言 1992年美国lattice公司发明了在系统可编程技术，彻底改变了传统数字电子技术系统的设计和实现方法，开创了数字系统设计的革命性时代。在1999年，lattice公司又推出了在系统可编程模拟电路，为电子设计自动化技术的应用开拓了更为广阔的前景。 随着信息科学和计算机技术的迅速发展，数字信号处理在20世纪末期得到了飞跃式的发展。在数字信号处理中数字滤波是重要的环节，经典数字滤波器从实现的网络结构或者单脉冲响应长度分类，主要分为有限脉冲响应（fir）和无限脉冲响应（iir）两大类；与hr滤波器相比fir滤波器的计算工作量稍大，但是在保证幅度特性满足技术要
创了数字系统设计的里程碑。1999 年lattice 公司又推出在系统可编程模拟电路(programmability programmable analog circuits)，翻开了模拟电路设计方法的新篇章，为电子设计自动化(eda)技术的应用开拓了更广阔的前景。 与数字的在系统可编程大规模集成电路(isplsi)一样，在系统可编程模拟器件 允许设计者使用开发软件在计算机中设计、 修改模拟电路，进行电路特性模拟， 最后通过编程电缆将设计方案下载至芯片中。当时仅推出了 isppac10、isppac20 两种器件，随后于2001年又推出了isppac80。2002年年初lattice 公司又推出了两种新器件isppac30和isppac81，极大地丰富了在系统可编程器件的种类。本文仅就 isppac30的特点及应用作一介绍。 支持isppac30 的开发软件为 pac designer1.3，对计算机的软、硬件配置要求为：windows 95/98/ nt，16mb ram，10mb硬盘，pentium cpu。软件支持原理图输入方式，可模拟观测电路的幅频和相频特性。 2 器件的基本
常用的isp器件，其中，lattice公司是isp的率先提出者，在这方面的技术比较成熟。它的isp芯片属于中小规模clpd，包括6个系列，产品种类丰富、价格便宜、开发灵活，能直接应用于系统上;开发平台ispdesign expert和pacdesigner功能强大，使用简洁。该公司还在1999年率先推出了在系统可编程模拟器件(isppac)，给模拟电路的接口设计带来了革命性突破。为此，文中信号调理平台的控制电路和数字信号调理电路采用lattice公司的isplsi032实现，模拟信号调理电路采用isppac20实现。 . 3.2.2 设计流程 本系统中信号调理模块的设计包括两部分：isp器件的功能设计和isp器件外围电路的设计。其中isp器件的功能设计是主要的，它决定着其外围电路的设计。 isp器件的功能设计也分为两部分：基于ispdesign expert平台的数字部分—isplsi1032的功能设计和基于pac-designer平台的模拟部分—isppac20的功能设计。isp器件的设计流程如图5所示。其中“行为分析”确定器件所要完成的功能和指标要求，对输入和输出信号进行定
模拟电路设计方法的新思维，为电子设计自动化（eda）技术开拓了更为广阔的前景。 同数字系统内可编程大规模集成电路（isplsi）一样，它使设计者用开发软件在计算机中设计、修改，并能进行电路特性模拟，最后通过下载电缆将设计下载至芯片中。 系统内可编程器件可以实现三种基本功能：（1）信号调整；（2）信号处理（3）信号转换。信号调整主要是对信号进行放大、衰减、滤波。信号处理是人才济济对信号进行求和、求差、积分运算。信号转换是把数字信号转换成模拟信号。目前已推出了三种器件：isppac10、isppac20和isppac80。它的开发软件为lattice公司的pac-designer。 系统内可编程模拟电路具有可模拟信号进行放大、转换、滤波的功能，是通过器件内的多个功能块的互联并能对电路进行重构以达到能调整电路的增益、带宽和阈值。编程次数可达1万次。其内部结构及电路如图1、2所示。 isppac10器件的结构由四个基本单元电路（pac）、模拟布线池、配置存储器、参考电压，自动校正单元和isp接口所组成。器件用5v单电源供电。基本单元电路称用5v单电源供电。基本单元电路称为pac块（
数据qb[11..0]经外部dac转换和低通滤波得到调频信号波形。其中，在两个累加器后相连的dff缓冲器有助于消除毛刺的影响，进一步确保系统的稳定性和可靠性。 4仿真及实验 取载波系统时标频率1mhz，调制信号系统时标频率100khz，相位累加器位数8位，两个波形存储器地址位数和数据位数都为8位。用quertus ⅱ 3.0 仿真，见图3；用matlab 6.5仿真见图4；用aedk-eda实验箱下载（其fpag芯片为epf10k10tc144-4），d/a转换及单极性输出电路用isppac20芯片实现，通过tektronix tds3054b示波器观察波形，结果见图５。其中d/a位数为8，测量范围-4-+4v，载波信号峰值1．414v，由图4和图5频率调制解调波形数据可得载波频率为14.2khz，误差-3．06％；调制频偏为480hz,误差-1．69％；调制度为m＝10．21％，误差2．1％,调制频率为4.82khz，误差-1．23％。从实验结果可以看出本文提供的设计理论及设计电路的不但正确、可行，并具有良好的性能参数。所有设计、仿真及实验结果的一致，为dds调频信号发生器fpga实
请教;da的问题在用dac0800做dds时，应该出来正弦波，可是频率在45k时出来三角波一样的，相同的采样点数用isppac20出来的波形很漂亮。郁闷了......多谢！
最近刚好做了一个最近刚好做了一个，学校的板子上用的是lattice的可编程模拟器件isppac20，利用器件内建的dac，在#cs的上升沿将8位数据并行读入dac。这样可以：1.fpga的8位波形数据输出直接接到pac的8位数据端口2.将clk接到pac的#cs最后测试波形比较完美。(fpga芯片是altera flex10k10)
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