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CPLD在水下冲击波记录仪中的应用
得到且采样频率可编程。可编程延时电路是通过一个四路拨码开关对cpld输入不同的电平组合实现的，通过设定cpld数字逻辑对产生延时计数时钟的1mhz晶振计数，输入不同的电平组合从而译码产生不同的延迟时间，而更改电平组合只需对记录仪的面板操作即可。cpld器件配以ise开发系统可完成设计输入、编译、验证及编程,设计校验可进行完整的模拟, 最坏情况下的定时分析和功能测试。设计人员无需编程器就可重构数字系统,具有“硬件软做”的特点。3.2 功耗低,集成度高图2中电源管理电路中的电源芯片主要包括max1658、max1659和max1616，它们的共同点就是都有一个shdn输入端，当shdn端为低电平时，无论电压输入端输入多大电压，输出电压均为0v，而只有当shdn端为高电平，输入端接入合适电压时，输出端才能产生相应的电压值供系统正常工作。由于装置最终工作在水下，需要电池供电，这就要求电路必须低功耗。记录仪工作时共有5个状态：低功耗延时设置待上电状态、低功耗待触发状态、数据记录状态、数据保持状态、读出数据状态。状态的转换是在中心控制模块的控制之下完成的。系统自带了一个数据保持电源，因此不用时
USB读数装置及上位机的设计
flash存储器模块 flash存储器存储着记录器的数据，本设计的目的就是从flash中读取数据并传入计算机进行保存。本设计采用samsung公司的k9f5608uo d nand flash存储器。其特点如下：存储单元阵列为（32m+1024k）bit×8bit;总共64k的块，每块含32页，每页为512+16字节；以页为单位编程（200μs典型编程时间），以块为单位擦除（2ms典型擦除时间）；命令、地址、数据复用端口；提供硬件数据保护功能。本设计的硬件连接电路如图3所示。其中max1658为k9f5608uod提供电源，排阻起到耦合限流作用。 2 软件程序设计 2.1 fpga各模块程序设计本设计的fpga程序采用xilinx公司的ise软件。它提供给用户一个从设计输入到综合、布线、仿真、下载的全套解决方案，并可以很方便的与其他eda工具接口。本设计中原理图输入采用其中的第三方软件ecs,hdl综合使用xst,测试台输入是图形化的hdl bencher,仿真使用modelsim se.简要的流程如下：建立工程项目；综合；仿真；定义输入输出管

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