当前位置:维库电子市场网>IC>pll1708 更新时间:2024-03-28 03:22:17

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pll1708中文资料

  • 基于TMS320DM642的网络摄像机设计

    m642 的i/o电压兼容,可以实现与dm642的mcasp接口无缝连接。 在本系统中,aic23工作于主模式,左右声道的采样字宽均为16bit。数据接口为dsp mode模式。通过i2c总线设置内部寄存器的工作参数和反馈状态信息。 因为网络传输的固有特点,音频数据和视频数据从网络摄像机端到达监控中心不可能是均匀的,如果网络摄像机端不做任何纠正处理,则很难保证音视频的同步输出。为了实现音频和视频的采样同步,本文利用锁相环pll1708,从saa7115的llc引脚输出27mhz时钟,经pll1708产生aic23的主时钟mclk。由于音视频采样信号采用同一个时钟源,就不会出现音视频不同步的问题。pll1708的scko3引脚输出默认时钟频率18.433mhz,作为aic23的输入主时钟mclk。aic23内部采用的时钟可通过设置寄存器由主时钟mclk分频得到。 以太网接口电路 本系统用lxt971作为快速以太网物理层自适应收发器。由于lxt971支持ieee 802.3标准,提

  • 基于DSP/ARM的网络硬盘录像机的设计方案

    时钟和行/场同步信号。dm642 有3 个视频口,每个都可以配置为上下两个通道,但vp0、vp1 的两个通道必须同时为视频输入口或输出口。结合实际应用,在本系统中vp0 和vp1 的 a 通道配置为8-bitbt.656 视频输入口,vp2 a 和b 通道配置为2 个8-bit bt.656 视频输入口,vp0 和vp1 的b 通道配置为mcasp,接四个音频codec. 音频部分采用tlv320aic23b 型音频编/解码器,它支持麦克风/立体声模拟输入/输出和数字音频数据流输出/输入。pll1708 型可编程视频/音频同步数字锁相环给mcasp 和tlv320aic23b 提供时钟信号,sck02 端口接mcasp 的ahclkx,sck03 端口接tlv320aic23b 的主时钟mclk.pll1708 的时钟输入为27mhz.dm642 与tlv320aic23b 的对应引脚功能见表1. 表1 dm642 与tlv320aic23b 的对应引脚。 2.3 存储模块 dm642 的emif 在内存中的地址映射分为4 个可独立寻址的空间ce[3:0],自地址0x80

  • 一种CCD图像采集系统的设计和实现

    的接口和控制,其中包括saa7115与i2c总线的接口、复位控制信号以及与tms320dm642的emif接口和外设接口等,其体系结构图如图6所示。本系统的osd fpga功能模块的芯片型号为xilinx xc2s300e-6pq208c[5],主要用来完成以下工作: (1)通过寄存器使用tms320dm642外部存储器接口(emif); (2)通过可编译寄存器使用tms320dm642的emif接口控制gpio; (3)产生emif缓冲控制信号(dir和oe); (4)提供对于pll1708的连续控制接口; (5)为flash产生3页bit空间; (6)使用saa7115的同步信号。 2.5 电源和复位模块 该系统通过单+5 v供电,在板子内部转换为+1.4 v和+3.3 v,为各器件供电。+3.3 v为tms320dm642的i/o口、解码器及其他芯片的电源,+1.4 v为tms320dm642 cpu内核电源。tms320dm642内核电压+1.4 v,外设i/o电压+3.3 v,降低内核电压主要是降低功耗,外部接口引脚采用+3.3 v电压,便于直接与外部

pll1708替代型号

PLL1707 PLCC-84 PLCC84 PLCC-68 PLCC68 PLCC52 PLCC-44P PLCC-44 PLCC44 PLCC-32

PLM-1 PLM1000 PLOT PLX9052 PM0001 PM1000 PM100CSA060 PM100CVA120 PM100DSA120 PM10CSJ060

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