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基于DM642的多路音/视频采集处理的硬件设计
式，分辨率为352288）和1路模拟视频输出。 vpo a通道配置为8-bit bt.656视频输入或输出口，接第一通道视频输入或视频输出。vpl a通道配置为8-bit bt.656视频输入口，接第二通道视频输入。vp2 a和b通道配置为2个8-bit bt.656视频输入口，接第三和第四通道视频输入。vp0和vpi的b通道配置为mcasp，接4个音频codec。 tvp5150型视频编码器支持pal/ntsc、cvbs或y/c模拟视频输入，8-bit bt.656数字视频数据流输出。saa7105型视频解码器支持8-bit bt.656数字视频数据流输入，pal/ntsc cvbs或y/c模拟视频输出。通过dm642的i2c总线对视频编/解码器的内部寄存器进行编程，实现不同的输入输出。dm642和tvp5150的对应引脚功能见表1。视频编解码器的参数通过i2c总线配置，由于tvp5150的i2c从地址只有2种选择，因此需要用cbt3257型2选l转换开关来切换。作为视频输入口时，视频数据的行/场同步又包含bt.656数字视频数据流中的eav和sav时基信号控制
基于BF561的智能视频监控仪的设计
公司推出的9位视频解码器，提供6路模拟输入和2个增强型的模数转换器。通过配置saa7111将pal制式的模拟基带信号转化为itu-r bt65*:2:2格式的yuv信号，并将其送入fpga中进行预处理。经过预处理后的图像数据再由fpga重新打包成bt656格式的数据送入到bf561的ppi口。具体连接图如图2所示。图中，vpd[0..7]是数据输出管脚与fpga相连，时钟同步信号bf561采用mdma的方式将原始图像信号存入sdram中，供视频跟踪算法使用。视频输出模块采用飞利浦公司视频编码芯片saa7105将输出信号转化为pal制式的cvbs信号。标准的yuv数据从fpga的引脚输出，送到saa7105的数据管脚上，场、水平和垂直同步信号分别接到fpga的控制引脚上。saa7105的参数配置都是通过fpga产生i2c总线来实现的。 1.2 存储模块 bf561的片上存储器分为两个部分:每个内核各使用100 kb的专用、高速l1存储器和128 kb的大容量共享l2存储器。本系统通过ebiu接口外扩了sdram和flash两种存储器。选取2片mt48l32m16a2来构成sdram存储
基于DM642的嵌入式网络视频服务器的设计
获端口1通过一个rca类型的视频插座j15和一个4针的低噪声s-video接口j16，连接到视频源。输入的必须是合成的视频源，例如dvdplayer或视频相机。saa7115h是可通过dm642的i2c总线进行编程的，并且可以连接所有的主要合成视频标准，例如ntsc，pal和secam，这些都可以通过解码器的内部寄存器进行适当的编程。 (10)视频编码器端口。本系统设计视频端口2被用来驱动视频编码器。它通过fpgau8发送，以实现高级功能，例如osd。但它在默认方式下是直接通过视频，连接到saa7105视频编码器。这个编码器可以进行rgb、hd合成视频，ntsc/pal复合视频的编码，也可对依靠saa7105内部寄存器进行编程的s-video进行编码。saa7105的内部编程寄存器通过dm642的i2c总线进行配置。编码器连接到合成的或rgb显示单元。通过标准的rca插座j2、j3和j4提供rgb图像。j3的绿色输出也可以被用于接口到合成显示单元。4针的低噪声s-videoj1也可用。15针的高密度db接口允许系统驱动vga种类的监视器。本系统设计高清晰tv输出，但要求更换一些支持hdtv的特
改进的基TMS320DM642的疲劳检测系统
摘要：针对疲劳检测算法中大数据量、高速传输、复杂运算的实际需要，设计了以saa7115为视频采集a/d、dsp tms320dm642为核心处理器、saa7105为视频输出d/a，并以fpga控制输出来实现增强显示功能的实时视频处理系统。该系统采用双摄像头控制采集数据，可以满足多路视频的实时采集、处理、显示需求，可以作为疲劳检测算法、视频处理和图像处理的硬件平台。关键词：tms320dm642；疲劳检测；eddds；fpga；osd 驾驶员疲劳、睡眠不足是引发严重交通事故的重要诱因之一。统计表明，由于疲劳/瞌睡造成的交通事故在交通事故总数中占7%左右，在严重交通事故中占40%，而在重型卡车和高速路上的交通事故中则占到35%左右。因此许多国家对司机在驾驶中的“瞌睡”检测的研究非常重视。为了适应多媒体通信的发展，美国德州仪器公司推出了新一代数字多媒体处理器tms320dm642（以下简称dm642）。它是tms320c6000家族中性能最高的定点dsp，基于c64x cpu核，具有极强的处理能力、高度的灵活性和可编程性，同时又集成了音视频和网络通信等外设，特别适用于多媒体通信应用。dm6
基于DSP/ARM的网络硬盘录像机的设计方案
预览、录像或通过网络传输，视音频处理的核心部件为数字信号处理器（dsp）。系统资源的管理与调度由主控模块完成，其核心部件为arm 芯片。 2.2 视频和音频采集和处理模块本系统采用模拟摄像头进行视频数据采集，然后将采集到的模拟数据通过ti 公司的tvp5154 芯片进行数字化，tvp5154 视频编码器支持pal/ntsc、cvbs 或y/c 模拟视频输入，8-bit bt.656 数字视频数据流输出，其输出的数字视频流可以与dm642 实现无缝连接。在本地预览和本地回放模块，采用saa7105 视频解码器进行解码，saa7105 型视频解码器支持8-bit bt.656 数字视频数据流输入，pal/ntsc、cvbs 或y/c 模拟视频输出。通过dm642 的i2c 总线对视频编/解码器的内部寄存器进行编程，实现不同的输入输出，视频编解码器的参数通过i2c 总线配置。作为视频输入口时，视频数据的行/场同步又包含bt.656 数字视频数据流中的eav和sav 时基信号控制，视频口只需视频采样时钟和采样使能信号（控制采样起始），tvp5154 用系统时钟sclk 提供采样时钟，用可编程引

DM642 DSP摄像机系统
关于video port 的时钟问题我想用dm642加上saa7105做视频输出，dm642的video port的时钟输入vclk1频率该怎么定，是不是由不同的d/a转换芯片（encoder）来决定，直接接到saa7105的时钟输出引脚pixclko行吗，video port的时钟输出引脚vclk2由vclk1产生吗？同频率吗？还有时钟输出vclk2是不是直接接到saa7105（encoder）的时钟输入pixclki，作为encoder的时钟基准？谢谢
dm642访问不了Saa7105
dm642访问不了saa7105我现在想通过i2c控制saa7105，但是奇怪的是：当执行i2c_start(hi2c)后，scl信号变为低，而sda信号一直为高，并且程序停在 i2c_xrdy(hi2c)；这是什么道理？请过来的兄弟指点，谢了！
[原创]公布DM642EVM的PCB
续上文局部，视频da saa7105附近../uploadfile/200705142126238549.jpg
DM642(EVM) Ver1.1多路实时图像处理开发平台[提供CPLD源代码]
视频处理芯片跟官方evm不一样了输入用了saa7113,输出用了saa7121，功能分别比saa7115和saa7105（官方板用的）简化了，比如7121不能支持vga输出。不过其实这样也好，已经够用了。
[原创]调试中的DM642EVM的PCB
这一版的原理图和前面公布的v1.0版本稍有区别，增加了fpga（xc2s300e）；替换了原图的线性电源为tps54310、54316；替换了网口芯片为ltx971a；增加了iic接口的pll，简化了时钟设计但本版保留了各部分时钟源；增加了扩展接口并修正了几处错误。经过半个多月的紧张调试，板子的sdram、flash和uart终于可以正常工作了，视频口的通道2已经调通，但是通道1还有些问题；网口和音频部分还有待于继续调试；由于芯片供货的问题，pll（cy27ee16fzec）和视频da（saa7105）暂时没有买到，所以调试视频ad和其它部分的时钟只好用晶体，还有一根飞线（不要砸我:））。现在把前一段时间调试的结果公布出来，这次公布的主要是板子的图片，等调试结束后我将公布新版的原理图（测试中发现个别问题，改正后再发以免误导大家）以及所有自己写的测试程序源码。目前已经完成的6个测试程序分别是（1）板子各模块测试（2）视频口捕获并实时在tv上显示（3）在tv上显示彩条（4）tv上显示照片（5）两路视频ad采集在tv上画中画显示（6）fft32×32快速傅立叶变换fir、iir滤波

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DM642 DSP摄像机系统

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DM642(EVM) Ver1.1多路实时图像处理开发平台[提供CPLD源代码]

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