SAA7105H/V1
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信号。因此,tvp5150apbs的hsync(行同步信号)、vsync(场同步信号)、avid(行消隐指示信号)以及fidfig.5 colleetion bet-ween tvp5150apb5 and dm642(奇偶场指示信号)这几个引脚并不需要与tms320dm642连接, 只需要将tvp5150apbs的interq引脚与tms320dm-642的vpoctl0引脚连接起来。 1.5.2 视频输出模块设计 在系统设计中,视频输出模块中的视频编码芯片选用的是philips公司的saa7105h,它同时具有sdtv(标准清晰度电视)和hdtv(高清晰度电视)信号编码能力,可以广泛用于视频输出的设计中。视频输出模块的电路如图6所示。 从图6中可知,将dm642的vp2端口配置成视频输出端口。由于vp2端口的数据线与saa710sh的数据线相互错位,因此这会造成无法正常显示视频输出。为了解决这个问题,在将vp2端口配置成itu-r bt.656视频输出时,数据就会从vp2 a通道的vpd02-vp2d09输出,vp2d00-vp2d 01则输出无效,因此就需要将vp2d02-vp2d
l(x=a、b)中的vcen、exc、hrst、vrst、fldd等控制位组合控制。当配置为单通道视频输出口时,vpxclk1作为视频源输出时钟,vpxclk0作为输入时钟。而vpxctl0、vpxctll和vpxctl2分别作为输出视频的hsync/hblnk/avid/fld、vsync/vblnk/csync/fld、cblkn/fld。3个vp口均作为8位视频接口,使用lo位数据总线中的高8位,即vpxd[9:2]。系统的视频解码和视频编码器分别选用philips公司的saa7l13h和saa7105h,图2给出视频解码和dm642的连接图。图3给出视频编码和dm642的连接图。 当saa7105h工作在vga输出时,其工作时钟的上升沿和下降沿都要接收数据,图3中vp2与saa7105h的连接方式,只用到vp2的8位数据线,因此vp2在每个时钟周期只有在上升沿输出8位数据,无法满足saa7105h的工作要求。 2.4 地址空间映射 dm642的程序/数据空间以字节为单位进行统一编址,整个寻址空间为4 g字节。其片上存储器,片上外设及外部存储器接口(emif)均映射到此4 g字节空
制云台运动,使运动目标随时在视场范围内,本文选用max488芯片实现bf561内的uart接口的电平转换;网络接口的功能是通过系统的嵌入式web服务器,实现智能监控仪的远程配置、传递监控参数等,采用dm9000即可满足系统需要。 1.4 dsp双核以及fpga之间的通信 在本系统中,涉及到bf561两个核之间的通信以及bf561与fpga之间的通信。fpga给dsp提供图像数据和经过背景提取之后的二值化图像数据,dsp将绘制的波门数据传输到fpga,fpga将波门叠加到原始图像后送给saa7105h显示。常见的双核通信主要采用中断、轮询两种通信方式[2]。中断是利用2个核的中断机制来实现fpga与dsp之间的通信;轮询是通过在双核的共享寄存器里设置一些信号量,供双核通信与访问。考虑到本系统的应用条件,本文采用轮询的通信方式,将信号量定义存放在l2空间。dsp的异步存储器的地址空间映射到fpga,通过fpga操作数据线和地址线,即可完成fpga与dsp之间的数据交互。 2 软件算法实现 在本设计中,a核运行μclinux操作系统,b核运行视频监控算法。μclinux操作系统主要实
有没有用过saa7104作dm642的输出编码器的网友?有没有用过saa7104作dm642的输出编码器的网友?我们用的是7104,开发板是7105,硬件基本一致,可程序上去,显示完全不对。我们照着瑞泰的dm642的evm做了一个dm642的系统,当然,根据我们需要,适当做了修改,大体一致。视频输出部分按照开发板,用视频口2扩展,开发板上用的是saa7105h,因为当时没买到7105,看datasheet,7105h跟7104h是一样的,只是chip id等几个小地方不同,管脚也兼容,就买了7104。现在在调试输出部分,用的程序是用开发板的改的,底层驱动没改,因为硬件连接都跟开发板一样,只是输出没有用osd fpga,而是用一块cpld把视频数据和控制信号直连了。程序用的是一个pal制的输出彩条桂东的程序,采用bt.656格式,而开发板的fpga在同样的程序下是直连的,只是因为后级输出处理的关系,在控制线做了适当延时。其他的,bsl板级支持库也做了相应修改。显示效果是:写入的彩条数据成了背景,不动,而只有两条saa7104上电时屏幕最右边的彩条在动,而且每走一遍,在某处还会出现有规律的抖动。改变写入彩