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。设计上采用专用视频解码芯片,以cpld器件作为控制单元和外围接口,以fifo为缓存结构,能够有效地实现视频信号的采集与读取的高速并行,具有整体电路简单、可靠性高、集成度高、接口方便等优点,无需更改硬件电路,就可以应用于各种视频信号处理系统中。使得原来非常复杂的电路设计得到了极大的简化,并且使原来纯硬件的设计,变成软件和硬件的混合设计,使整个系统的设计增加柔韧性。 1 系统硬件平台结构 系统平台硬件结构如图1所示。整个系统分为两部分,分别是图象采集系统和基于dsp主系统。前者是一个基于saa7110a/saa7110视频解码芯片,由复杂可编程逻辑芯片cpld实现精确采样的高速视频采集系统;后者是通用数字信号处理系统,它主要包括:64k word程序存储器、64k word数据存储器、dsp、时钟产生电路、串行接口及相应的电平转换电路等。 系统的工作流程是,首先由图象采集系统按qcif格式精确采集指定区域的视频图象数据,暂存于帧存储器fifo中;由dsp将暂存于fifo中的数据读入dsp的数据存储器中,与原先的几帧图象数据一起进行基于h.263的视频数据压缩;然后由dsp将压缩后的视频