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  • PXI总线仪用模块的设计与实现

    。如果利用10mhz参考时钟,还必须通过pll进行倍频,显然倍频系数不是整数。当不同的模块利用pxi_clk10获取65mhz采样钟作为时基时,不同模块间的采样钟很难达到相位同步。为了保证所有模块同步,如前所述,可将这个采样钟通过pxi_trig[7]、pxi_star[0:12]传送给其他外设槽。对于多台仪器的同步应用,最好通过用户前面板由外部提供时基源。 由于有多个时基源,且通常时钟的电平是ttl电平,可采用5v耐压的电平转换多路复用/解复器进行选择。这里选用sn74cb3t3253和sn74cbt16244,其传播时延均小于0.25ns。ep1c6q248内部有两个pll,一个pll用来从10mhz参考钟获取时基,一个用于获取数据传输和sdram控制器的80mhz时钟。精密时基的获取和源出电路如图3所示。时基源的选择和时基信号的源出由用户通过软件进行配置。 3.2 触发控制器的设计 除了上述的精密时基,仪器同步机制的另外一个关键是触发系统。不论是简单测试系统还是综合测试系统,一个测试系统的动作起点(epoch)依赖于一定的事件。事件有简单的,如一个信号电平的变化,较为复杂的是多

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