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基于CPLD的高压电力线FSK MODEM设计
-0.4-0.20.4fin=0.97fc-0.40.20.4fin=fc-0.7-0.20.2fin=1.25fc -38.5-34fin=1.43fc -37.2-35fin=3.25fc -37.2-35我们的截止频率是4000hz，即4000=1.25×fc。所以fc=3200hz。该频率由cpld产生。为了能够推动后级设备，必须在滤波器之后加上输出放大器，这里采用fc411。电路为普通的反相放大器电路。4.3 输入放大器和波形变换电路如图4所示，输入的fsk和正弦信号经过运放tle2037放大后，输入比较器lm311进行过零点检测。由于在接地处有较强的噪音，因此必须在电路设计上考虑抗干扰的问题，如采取隔离、浮地等措施。lm311是一款高速比较器，比较速度最在为165ns，它的输出兼容ttl和mos电路。lm311通过过零检测，把fsk波形转换成方波输入cpld，由cpld进行频率分析，从而实现解频的目的。5 软件设计该系统软件最主要的部分就是调制和解调软件的设计，还有一部分是滤波器的时钟产生及工作状态指示与工作模式选择。此系统可以选择300bps、600bps、1200bps三种
用集总LC元件的VCO构成155.520MHz锁相时钟频率源
-10dbm～+5dbm，输入阻抗为50ω。内置vco的分频器工作于前置预分频模式时，工作频率可高达2ghz。由内部的除10/11前置分频器、4位的低位a计数器和9位的高位m计数器所构成的吞脉冲计数器来完成总分频n。当不用前置预分频时，q3236的工作频率最高为300mhz。1/r为参考源分频器。q3236分频器的置数方式有三种：串行模式、8位总线模式以及并行直接置数模式。 q3236需要外接环路滤波器。在本设计中采用一阶有源比例低通滤波器，如图5所示。采用低噪声运放tle2037及r、c元件构成环路滤波器，r、c等元件值由锁相环参数求出。已知：式中：τ1=(kdk0)/nωn τ2=2ξ/ωn 对于点频时钟电路，稳定度高，所以选择锁相环3db带宽b3db=1khz，阻尼系数ξ=0. 707。已知q3236的鉴相系数kd=302mv/rad，vco在155.520处的压控灵敏度k0=2π×80rad/s.v。在设定c=0.1μf和预滤波截止频率为2.5khz的条件下，代入上面的公式算得元件值如下： r1/2=1

TLE2037CD的技术参数
产品型号:TLE2037CD
通道数:1
关断功能:No
工作电压Max. (V):38
工作电压Min. (V):8
每通道IQ(典型值)(mA):5.300
带宽GBW(典型值)(MHz):50
转换速率(典型值)(V/us):7.500
输入失调电压(25℃)(Max.)(mV):0.100
失调漂...

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