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用DSP实现多目标实时跟踪
动态目标的重心跟踪技术能够完成快速变化图像的实时、准确地定位和跟踪，因而在许多领域得到了广泛的应用。特别是在一些需要无人干预的情况下自动完成任务的环境中，多目标重心跟踪作为定位和识别的核心作用显得更为重要。但一直困扰人们的是由于运算量太大而实时性受到了一定的影响，从而视窗无法开大。这样势必造成多目标的定位和跟踪受到局限，甚至无法实现"。本文从硬件和软件两方面同时着手，有效解决了上述问题。硬件方面采用ti公司的tms320c6203，该产品是目前数字信号处理器中性能最高的产品之一，比tms320c6202在存储容量上有较大提高，他所带来的新的系统设计方法使得传统的基于硬件设计变为软件设计，c6000的开发工具使得软件开发易于实现。软件方面将耗时较大的重心算法用线性汇编来完成。实验证明，速度有较大提高，满足了系统的要求。 1 系统资源 1．1 tms320c6203介绍
高速G．729ab声码器设计及其在媒体网关中的应用
励线性预测编码”(cs-acelp)算法，算法帧长为lo ms，编码后速率为8 kb／s。g．729有两个附件：附件a给出一种低复杂度的算法，可应用于多媒体同步语音和数据；附件b在标准算法的基础上增加了静音检测压缩算法以降低平均传输率，包括静音检测(vad)和舒适噪音产生(cng)。文献对g．729语音压缩编码算法的具体原理中有详尽的描述，本文的论述重点在算法的汇语言优化、声码器的dsp硬件接口设计，以及其在媒体网关中的应用。 1 g．729ab编解码核心算法优化本文选择ti公司的tms320c6203芯片为核心，实现g．729ab声码器设计。tms320c62xx系列dsp的集成开发环境code composer studio(简称ccs)支持标准c语言和汇编混合编程的方式编程，为了提高编解码算法的效率，本文对itu_t的标准g．729ab的c语言原码进行汇编指令优化设计。同时，对于上层编解码器控制函数，采用c语言开发，以提高声码器的可维护性。 c62xx采用6级流水线结构，提供了a，b两组(共32个)通用寄存器，8个功能单元(．l1，．l2，．s1，．s2，．m1，．m2，．d1和．
基于TMS320C6416的3G基站设计和应用
，移动终端发出的信号通过空中接口到达无线基站。在基站中经过射频接收、中频处理、rake接收，然后进行信道解复用、解交织和viterbi/turbo译码处理。在没有采用tms320c6416的系统中，两种译码可以由dsp软件来实现，但这会大大降低dsp处理其它业务的能力；译码也可以由外部fpga/asic硬件实现，但这会增加单板器件的密度和功耗。tms320c6416除了具有比一般dsp更强大的处理能力外，内部还集成了一个viterbi译码处理器和turbo译码协处理器，提供的符号率处理性能几乎是tms320c6203的十几倍，因此tms320c6416十分适合3g基站基带符号速率级处理。 tms320c6203现已用在大多数无线设备制造商的3g基站设计中。为了在低功耗和低成本下具有更大的通道密度，这些厂商需重新设计他们的设备。而tms320c6416目标代码与tms320c6203兼容，软件移值方便，再加上tms320c6416具有的强大处理能力和低功耗特性，目前已有很多无线设备制造商打算在3g基站设计中采用tms320c6416. 参考文献: [1]. tms320c6416 data
基于双DSP平台的实时跟踪系统设计
摘要：本文以两片定点dsp tms320c6203为核心，设计了一个用于处理1024×1024大小图像（12位数字相机）的电视跟踪系统，并对系统的硬件设计和软件设计分别进行了详细介绍。对实时图像序列进行预处理后，dsp1进行捕获和图像增强、显示，dsp2用于实时跟踪。主要解决了两个关键问题：第一，采用分段投影的方法，解决了对于大图像大数据量的目标全屏捕获问题，并满足实时要求；第二，根据目标大小动态调节跟踪窗，对目标进行实时跟踪。实验表明系统对目标的实时跟踪有很好的性能。关键字：双dsp平台，实时跟踪系统设计，12位数字相机引言实时跟踪系统中目标的捕获和跟踪是图像处理、计算机视觉和模式识别等领域的重要课题，在军事、工业、医学和交通等方面有着广泛的应用前景。传统的图像处理系统是一般是针对8位的数字图像，大多数的跟踪器采用ti公司所推出的优秀的高速数字信号处理芯片c6x系列dsp，ti公司提供了很多针对处理256灰度级图像的图像处理支持库，用户可以方便的调用里面的api函数，并通过ccs自带的调试工具进行简单快捷的调试，缩短程序的开发周期。由于信息技术的不断发展，人们越来越注重跟踪的精
软件无线电设计中ASIC、FPGA和DSP的选择策略
或fpga实现。通常asic可为任何指定的功能提供最佳性能，其执行时间可参见下述数据表单。对dsp和fpga功能实现的性能进行比较相当困难，因为这些器件的结构分别用于处理不同类型的问题。dsp工作于非常高的速率条件下，但在某一时刻只能完成有限的处理任务。另一方面fpga的工作速率通常低于dsp的速率，但对同时可完成的处理任务则几乎没有限制。为了说明上述这些差异，考虑如图2所示的具有16个抽头的简单fir滤波器。该滤波器要求在每次采样中完成16次乘积和累加(mac)操作。德州仪器公司的tms320c6203 dsp具有300mhz的时钟频率，在合理的优化设计中，每秒可完成大约4亿至5亿次mac操作。这意味着c6203系列器件的fir滤波具有最大为每秒3,100万次采样的输入速率。但在fpga中，所有16次mac操作均可并行执行。对于xilinx的virtex器件，16位mac操作大约需要配置160个结构可重置的逻辑块(clb)，因此16个并发mac操作的设计实现将需要大约2,560个clb。xcv300e可轻松地实现上述配置，并允许fir滤波器工作在每秒1亿个样本的输入采样速率下。附加

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基于双DSP平台的实时跟踪系统设计

软件无线电设计中ASIC、FPGA和DSP的选择策略

tms320c6203替代型号

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