当前位置:维库电子市场网>IC>xc3s100e-4vq100c 更新时间:2024-04-24 07:48:24

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xc3s100e-4vq100c中文资料

  • 直接数字频率合成器DDS的优化设计

    component rom--波形存储器模块 port(phase:in std_logic_vector(7 downto 0); gen:in std_logic_vector(0 downto 0); amp_out:out std_logic_vector(9 downto 0)); end component; 为了对dds进行*估,将以上设计在xilinx公司的开发软件中进行了设计及优化,目标器件为其最新的90nm工艺器件spartan3e中最小器件xc3s100e-4vq100c,该设计所占用的fpga资源如表2所示。 由表2可以看出,本文给出的dds设计占用资源很少,由于xc3s100e的市场价格在2美金左右,故本设计所占的硬件成本可以缩减到0.2美金左右。同时在ise8.2中该设计的系统时钟最大达到159.6mhz。以上的设计性能几乎和现有的专用芯片相当,但成本下降很多。 为了进一步验证本文给出的dds设计系统在功能和时序上的正确性,对其进行了时序仿真,使用的仿真软件为modelsim6.1。仿真结果表明,该dds系统可以运行在较高的工作频率下。

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