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一个信号有多个驱动怎么解决？ |
| 作者：hiker000 栏目：EDA技术 |
我试着用VHDL描述计数器74LS192。 输入：清零端CR，置数端LD，加的clk：CPu，减的clk：CPd。 显然优先级：CP〉LD〉CPu，CPd。 我用if嵌套来描述的。不过编译时候总是通不过。提示对于定义的信号有多个驱动。 请各位大虾指点，碰到这种情况一般怎么解决？？有别的办法能绕过去吗？？ |
| 2楼： | >>参与讨论 |
| 作者： 弄月书生 于 2007/4/17 11:16:00 发布：
也许我们碰到了相同的问题 |
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| 3楼： | >>参与讨论 |
| 作者： mybao 于 2007/4/17 19:18:00 发布：
说明你程序写错了 一个信号有多个驱动，本来就是矛盾的。 |
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| 4楼： | >>参与讨论 |
| 作者： 王紫豪 于 2007/4/17 22:17:00 发布：
或一下不久好了？ |
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| 5楼： | >>参与讨论 |
| 作者： txmfxf 于 2007/4/18 10:29:00 发布：
回复 我也遇到了同样的问题 |
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| 6楼： | >>参与讨论 |
| 作者： carl.lee 于 2007/4/18 21:46:00 发布：
建议在同一个进程中只对一个信号进行处理。 这样可能有效避免出现多个驱动的错误程序 |
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| 7楼： | >>参与讨论 |
| 作者： jmwolf 于 2007/4/22 14:23:00 发布：
这就是分辨信号 一个信号有多个驱动源,那么他就是分辨信号 有对应的规则的,自己可以去搜索下 |
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| 8楼： | >>参与讨论 |
| 作者： yh-dz 于 2007/4/22 23:02:00 发布：
还需要加深理解沙～ |
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| 9楼： | >>参与讨论 |
| 作者： hiker000 于 2007/4/24 10:04:00 发布：
各位能帮我想想办法吗？ 被驱动的信号只有一个，是用来计数的。不过由于控制它的比较多，而且有优先级。所以很难在不同的进程中描述。 或者谁能帮我写一下74LS192。只要大概的一写，能看清楚怎么驱动用来计数的那个信号就行了。 小弟不胜感激。 |
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| 10楼： | >>参与讨论 |
| 作者： guolh 于 2007/4/24 10:25:00 发布：
使用一个时钟！ 加减使用一个时钟，另外一个信号控制加减！ |
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