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EDA技术 |
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自己定义的IP核怎么用？？？？ | aliao2003 | 4 | 2024/3/6 16:13:19 |
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关于MODELSIM的仿真的问题！！ | jean_hz | 9 | 2024/3/6 15:44:16 |
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大虾帮忙啊！一个时钟和显示电路用EPM7128SLC-15编译居然通不过 | bg4ajb | 6 | 2024/3/6 14:46:35 |
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急切求教：epm7128 几个引脚的接法 | zhubaojun | 3 | 2024/3/6 14:24:43 |
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CPLD 与51接口 急请教各位大侠！！！！！ | wujianbo | 6 | 2024/3/6 13:19:30 |
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求助！vhdl中的inout怎么使用？ | 雨后 | 10 | 2024/3/6 13:18:33 |
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大虾帮忙看个程序！谢谢先！ | wolfqfy | 3 | 2024/3/6 12:35:47 |
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请问哪里有ISE的使用教程啊? | roseting | 4 | 2024/3/6 12:26:00 |
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请教protel99se仿真时的一个错误问题：Iteration limit reached | yoohoo | 4 | 2024/3/6 12:01:57 |
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一个信号有多个驱动怎么解决？ | hiker000 | 10 | 2024/3/6 11:50:30 |
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电路驱动能力如何计算？ | tianfeiyu | 4 | 2024/3/6 11:43:41 |
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FPGA的延时是不是很严重？ | gwtaa | 4 | 2024/3/6 11:34:04 |
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Verilog的函数和任务在maxplush不能编译 | 54liugang | 3 | 2024/3/6 10:36:41 |
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如此简单的程序,但是有毛刺,如何解决?高手请进! | debugtwo | 16 | 2024/3/6 10:19:20 |
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各位好，有问题请教大家 | 剑寒情暖 | 2 | 2024/3/6 10:02:03 |
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多位计数器分成两个小计数器来提高速度是否用的是流水线的思想？ | hhblxm | 6 | 2024/3/6 9:30:35 |
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最近用CYCLONE 做了一个112路8Bit的PWM输出51的扩展电路 | cyjun99 | 5 | 2024/3/6 4:37:09 |
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ISE7中的错误，大家帮着看看吧 | errisa | 3 | 2024/3/6 4:20:30 |
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用FPGA制作频率计_除法器的实现 | monisfic | 8 | 2024/3/6 4:18:19 |
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protel99se中的不明丝印，放大后却看不到。是什么原因？ | rebude | 2 | 2024/3/6 3:51:08 |
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cpld或fpga的晶振一定要接入全局时钟引脚吗?和接在普通IO的区别 | jiaojian | 7 | 2024/3/6 3:20:00 |
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pspice | gang_ming | 2 | 2024/3/6 3:15:35 |
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我想利用时钟的上升和下降沿干事，是否可以这样判断？ | hhblxm | 11 | 2024/3/6 2:59:38 |
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VHDL“算术左/右移”和“逻辑左/右移”的区别是什么？ | 温柔的毒药 | 6 | 2024/3/6 2:53:34 |
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请教一个VHDL小程序 | Lyang03 | 2 | 2024/3/6 1:57:24 |
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请教使用IP核设计FIR滤波器 | hailsh | 5 | 2024/3/6 1:17:43 |
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请教：这个计数器的VERILOG怎样处理 | 32位处理器 | 5 | 2024/3/6 0:13:34 |
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求教：PLD设计 | liyun022 | 2 | 2024/3/5 23:51:34 |
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protel仿真时遇到一个问题：好像是器件设置方面的，无助中…… | acparmalat | 1 | 2024/3/5 22:36:12 |
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我的protel99se怎么打不开后最缀为pcb的文件 | kingpcb | 8 | 2024/3/5 22:15:32 |
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