当前位置:维库电子市场网>IC>em8500 更新时间:2026-05-24 15:18:00

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  • 利用FPGA平台解决接口的总线速度瓶颈

    内存的过程中,cpu是不参与传输数据的。值的注意的是:高片中只用了两个高bank,低片中只用了两个低bank。 其次,我们已经把一片sdram用两片来代替,分别为外部输入数据缓存和系统程序运行空间;可是对cpu来讲,它认为它的外存只有一片,它从两个高bank取数时认为是从同一片sdram的两个高bank取数,因此,需要在cpu访问两个高bank时将数据线、地址线和控制线切换到高片sdram;反之,在cpu访问两个低bank时,将数据线、地址线及控制线切换到低片sdram。这个切换是无法用em8500的cs来完成的。因为它只有一个cs信号,只允许挂一片sdram。所以,我们用cpld来完成这个切换工作。cpld根据输入到它的sdram地址线和控制线,在cpu发布acttive命令时,根据地址线中的两位bank地址线确定是访问两个高bank还是访问两个低bank,如果是访问两个低bank,cpld输出控制信号,关断连到高片sdram数据线和地址命令线的两个高速数据开关,同时打开连到低片sdram的高速数据开关,这样cpu就访问低片sdram;反之,如果cpu要访问两个高bank,则cpld输出

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