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  • 一种2 Gsps数字示波器数据采集系统的设计

    fine sampling delay adjustment on channel q)功能,通过调整q通道的采样时刻,有效地避免了因为采样时钟的占空比不等于50%而造成的误差,保证了采样精度。 高速高精度的adc对采样时钟的精度要求非常高,时钟电路一般的设计方法是直接利用fpga内部的锁相环倍频电路产生,但是目标系统要求采样时钟频率达到1 ghz,而目前altera和xilinx公司的高端fpga其i/o输出频率最高只能达到800mhz。经过综合评价,最终选定了美国ns公司的高频时钟芯片lmx2531lq1910e。其输出低段频率为917 mhz~1 014 mhz,满足设计要求,此外,lmx2531具有非常低的抖动和相位噪声。而且还集成了低噪声、高性能的低压差线性稳压器ldo(low drop out regulator)元件,使电路的抗干扰性和稳定性得到了提高。 fpga的可编程性以及丰富的内部逻辑资源和外部i/o资源,用来作为数字存储示波器数据采集与控制系统。特别地,单片at84ad001量化输出是16路1 gbps速率、lvds格式的差分数据,目标系统双输入通道同时工作,这就要求fpga具有

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