基于NIOS II的导航系统平台的设计

...键按下，以及是哪个按键。本文采用型号Optrex 16027的LCD屏，头文件pio_lcd16027.h定义了九个控制子程序，通过这些程序完成对LCD的控制。标准VGA画面大小是640*480，每秒60帧左右。像素时钟高达25.175MHZ。如果每个点都由Nios软件扫描实现，那么在40ns的间隔内，最多能让共作在50MHZ的CPU执行两条指令。所以，我们采用DMA控制器在流模式VGA控制器和SRAM之间建立一条DMA传送通道，让硬件完...
基于Nios II的多生理参数处理系统的设计

...部分是VGA时序的产生，它是正常输出显示的关键，包含在VGA控制器中VGA控制器是用SoPC Builder中的interface to user logic生成的，首先用硬件描述语言定义一个时序输出和RGB信号输出模块，点时钟25.175MHZ由开发板提供的时钟经锁相环分频产生锁相环是通过MegWizard工具加入系统的该模块实现了VGA输出所需的点时钟、复合同步控制信号、复合消隐控制信号、行同步和场同步信号；同时也完成了...
基于FPGA实现的计算机与HDTV显示器测试信号发生器

...晶体.MC10ELT21是一个差分PECL电平到TTL电平的转换器,其特点是具有3.5ns的典型传输延迟,差分PECL输入,SOIC封装,24mATTL输出,+5V供电.需要说明的是,MC12429与MC10ELT21组成的频率合成系统无法产生25.175MHZ(VGA60Hz)的时钟频率,因而还需要外加一个25.175MHZ的晶体振荡器为VGA60显示格式提供时钟.此外,THS8134的最大输入频率是80MHz,所以对像素时钟大于80MHz的显示格式(XGA85Hz、SXGA60Hz和U...
基于FPGA的液晶显示驱动IP核的实现

...FPGA的驱动方法能够满足液晶显示驱动时序上的要求，且具有控制灵活的特点，在外扩片外SRAM 或SDRAM 后，容易移植在更多可变宽度像素点的液晶显示器的驱动上。因FPGA 液晶显示驱动器的像素时钟为25.175MHZ ，普通的单片机难以满足要求，故选用ALTERA 公司的ACEX 系列FPGA 作为驱动电路的核心部件。FPGA即现场可编程门阵列器件，是一种超大规模集成电路，具有在电路可重配置能力(in circuit...
VGA图像控制器的CPLD/FPGA设计与实现

...信号、场同步信号等信号的控制，并参照有关标准，可以实现对VGA显示器的控制。由此可见，了解接口标准，控制时序和设定恰当的参数是系统设计的关键。参照VGA主要参数的工业标准，像素输出频率为25.175MHZ；行频(线频率)为31.469KHz；场频(刷新率)为59.94Hz。参数设计原理以及行同步信号(Ts)与显示信号(Tdis)的关系如图1所示。 VGA 图像控制器的设计方案 VGA图像控制器是一个较大的数字系...

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