24.576M
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以准确计算出脉内信号频率，从而达到测频的目的。 2系统硬件电路设计 基于ad10200和fpga芯片ep2s30f48414的脉冲信号测量系统的硬件电路原理如图2所示。此系统的输入信号要求为两路正交信号，正交信号在基带数字信号处理中经常要用到，它可以通过多种方法来实现，如模拟器件下变频或者是数字正交下变频等技术。iq两路正交信号的特点为幅度相仿，相位相差90度。ad采样芯片负责将模拟信号转换为数字信号；电源芯片用于为ad、fpga和max232供电；晶振用于提供工作时钟，选择24.576 mhz晶振的原因是因为fpga与计算机串口通信时还要实现一个模拟串口，而选用24.576 mhz可以刚好模拟出9600 bit／s的波特率，从而可减少误码率：外部复位可为fpga提供外部复位信号。max232是一个常用的电平转换芯片，可以将fpga输出的lvttl 3.3 v电平转换为串口电平，以便被计算机uart口所识别和接收。由以上芯片组成的系统工作频率为100 mhz，可实现快速、高精度地脉宽和频率测量。其中采样芯片和fpga的硬件连接图如图3所示。 3fpga软件设计
6727的mcasp口完成。tms320c6727有3个mcasp口：mcasp0、mcaspl、mcasp2口。其中mcasp0口有16个串行数据口axr0～axrl5，mcaspl有6个串行数据口（共用axr8～axrl3），mcasp2有2个串行数据口（共用axrl4、axrl5）。音频采集与回放使用mcaspo的axr0～axr7，音频数据通信发送采用mcasp0的axrl4，接收采用mcasp2口。 pcm4204与pcm4104的时钟由pll1707组成的时钟电路产生，时钟频率为24.576 mhz（256fs，fs为采样频率）。每个mcasp口的接收数据时钟和发送数据时钟是相互独立的，并且都有自己的主时钟（ahclk），当mcasp接口为i2s提供时钟信号时，bck和lrck除可以从系统时钟得到外还可以从ahclk分频得到。 2.1 音频采集电路 音频采集电路连线图由图2给出。图中只给出了pcm4204与tms320c6727的measp0口之间的硬件连接关系。 以ti公司浮点dsp芯片tms320c6727为核心，利用片上多通道音频串口mcasp与4路专业音频ad
要是这些人机交互设备，只要符合hid设备级定义规范要求的都可以认为是hid设备。hid设备有以下主要特点： ① 交换的数据存储在报告的结构内，设备必须支持hid报告格式。 ② 每笔事务可以携带小量或中量的数据。低速设备每笔事务最大为8字节，全速设备每笔最大为64字节，高速设备最大为1 024字节; ③ 有最大传输速度的限制。低速设备最快10ms一笔事务，最高速度为800 b/s;全速设备最快1 ms一笔事务，最高速度为64 kb/s;高速设备最快125 μs一笔事务，最高速度为24.576 mb/s。 ④ 没有传输速度的保证。 当插入usb设备后，主机会向设备请求各种描述符来识别设备。为了把一个设备识别为hid类别，设备在定义描述符的时候必须遵守hid规范。图1显示了hid各种描述符之间的关系。事实上，每个设备可以有多个接口描述符来实现多接口设备，而且每个接口描述符下应该有多个端点描述符。 图1 hid各种描述符之间的关系 从图1中可以看出，除了usb标准定义的一些描述符外，hid设备还必须定义hid描述符。另外设备和主机的通信是通过报告的形式来实现的，所
1510mpeg-1 a／v编码芯片进行图象压缩。saa7113的主要作用是把输入的模拟视频信号解码成标准的8位“vpo”数字信号，它相当于一种“a／d”器件，是一种可编程视频处理芯片，可通过i2c总线实现编程控制，并具有4路视频输入、抗混叠滤波、自动钳位和增益控制、多制式解码以及亮度、对比度和饱和度控制等功能。它对输人的pal制式视频信号进行采样和解码后，可将生成的ccir-601数字视频流（色度空间为ycbcr，取样为4：2：2）送到视频压缩芯片sz1510的数字视频输入接口。它的输入时钟由24.576 mlhz的有源晶振提供，并可分别从rts1和rts0管脚输出为sz1510提供的行同步信号hs和场同步信号vs，其中行同步信号hs又可作为行有效象素识别信号输入到sz1510的vihact管脚；并从llc脚输出27 mhz的像素时钟，作为sz1510内部的数字视频流的采样时钟和芯片的主时钟。系统初始化可通过arm芯片的i2c总线来实现。片选信号由arm产生 reset信号来提供。 系统中的压缩编码芯片sz1510是zapex公司生产的一款高性能的mjpeg、mpeg-1编码芯片，可对视频信号
ower modes and power “scalability” fractional-n synthesizer with fully integrated vco and loop filter pll reference frequency between 19 mhz and 39 mhz supported crystal frequencies supported : 16 / 16.384 / 19.2 / 20.333 / 20.48 / 24.576 / 26 /38.4mhz idle to active receive time < 1 ms integrated, programmable 7th order chebyshev channel filter for 5, 6, 7 and 8 mhz channel bandwidth fully differential analog i/q interface 优势: optimized low pow
ulator)接口。 3 系统硬件设计 该系统是由一个spce061a精简开发板(61板)、dsl8b20型l-wire数字温度传感器、sprl024型128 kx8 bit flash、1602型液晶显示器和外扩uart串口电平转换电路组成，可以实现温度的测量、显示、存储与pc通信等功能。此系统以spce061a为核心，其硬件结构框图如图2所示，spce06la与其他器件的连接。 4 系统软件的设计 4.1 主程序的设计 主函数比较简单，在程序开始后将系统时钟调到24.576 mhz，程序中控制1602型液晶显示器与dsl8b20需要严格的读写控制时序，其中软件延时就是按照这个时钟计算的。然后初始化i/o端口，打开2 hz中断，为定时lomin做准备。调用开机显示界面，在液晶1602上显示所需字样，持续一段时间，重新初始化1602，初始化sio和uart，为使用sio和uart做准备。然后进入循环，调用测温函数测温，调用显示函数显示，调用发送数据函数发送数据，判断是否为设定的时间(10 min)，如果是，调用存储函数存储数据；如果不是，直接执行下一步清看门狗操作，然
老问题，24.576不准
thanks学习了， after reset# signal deasserted |24.576mhz.html">24.576mhz crystal present? --yes -- 24.576mhz.html">24.576mhz crystal on xtl_in and xtl_out | no |24.576mhz.html">24.576mhz oscillator present? --yes -- 24.576 mhz signal on xtl_in | no————————————————————————————从yes 方向来看， oscillator好像只有一个脚输入？
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