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晶振全称为晶体振荡器，其作用在于产生原始的时钟频率，这个频率经过频率发生器的放大或缩小后就成了电脑中各种不同的总线频率。而常用的有16m晶振、65.536mhz晶振等等。晶振的技术参数包括频率特性参数，波形参数，压控（或调制）参数，环境（条件）参数等。 一、频率特性参数 1、标称频率：是技术条件所指定的频率，即晶振输出频率的名义值。 2、频率准确度：在标称电压、标称负载阻抗、基准温度以及其他规定条件下，晶振输出相对标称频率的最大偏离值。 3、频率调整范围：不打开晶振的外壳用某个可变元件来改变输出频率的范围。 4、重现性：石英晶体振荡器断电存放一段时间后再加电输出频率返回到原现稳定输出频率规定范围之内的能力。 5、频率稳定度：有两种表征方法时域和频域。 时域表征 ① 频率老化率：在规定的外界条件保持不变的情况下，晶振内部元件由于老化而引起的输出频率随时间的漂移，通常可用某一时间间隔内的老化频差的相对值来量度（如日、周、月或年老化率等）。对于高稳晶振的频率老化率常常会呈现出单方向准线性的变化规律。 ② 开机特性：当晶振接通电源后，输出频率随时间逐渐达
如今的科技是越来越发达，很多生产工厂都有自己一套独特的线路设计，都在不断的创新，希望能使原有的零部件性能更精确，体积更小化。晶振又可以分为普通晶振、温补晶振、压控晶振、温控晶振等。而常用的晶振有100m晶振、65.536mhz晶振等等。而声表面（ saw ）晶振是一种采用叉指结构的频率选择性很好的器件， 通过精确设计两边的叉指换能器的叉指对数及间距后， 再通过蒸发光刻等工艺制成。声表面谐振器（ sawr ） 是一种高q 值的谐振器， 在很多方面都与石英晶体谐振器相似。 与声表面波延迟线（ sawdl）振荡器相比， 双端谐振器的传输特性类似于高q 值延迟线的特性， 但它有以下几个显着特点： 一是谐振器的尺寸很小； 二是谐振器的插损要小得多； 三是谐振器的调频范围比延迟线窄， 但是调频范围增加的同时稳定度会降低。 对于基于谐振型saw 器件的传感器来说， 基线频率稳定度是最重要的技术指标之一。对于声表面波气体传感器， 声表器件上需加敏感膜， 这样会增加器件的插损， 过大的插损会降低稳定度， 因此saw滤波器本身的插损不能大。 声表面谐振器也可以根据叉指换能器的对数分为单端谐振器和双端谐
em on programmable chip)系统。fpga设计结构如图3所示。 考虑到本设计所占用资源，包括逻辑单元、嵌入式存储器的多少，以达到资源充分利用，选用了altera公司的cyclone ii系列fpga ep2c20开发板，此款开发板具有512kbyte的片外ram空间，可以作为nios的程序存储器和usb接口的数据缓冲区，以保证数据的实时传输。fpga各模块设计综合后占用了15000多个逻辑单元(含niosii模块)， 占用了82%(52个m4k)的存储器位，整个系统使用65.536mhz的时钟，有效地利用了开发板的资源，结果良好。 pcb的设计 pcb的设计包含usb模块和dac模块两部分。 (1) usb模块主要是实现pc与fpga之间的高速通信，考虑到传输速度要达到300kb/s才能实现数据的实时传输，所以选用了ft245bl作为usb接口芯片。 (2) dac模块是为了将数字滤波器输出的数字信号转换成模拟信号。编码器输出的是数字的中频信号，采样频率16.384mhz，带宽1.536mhz。经过dac转成模拟信号后还需要对其放大，滤波，最后输出峰峰值为1v的
，当modem的cd信号为高的时候，表示没有有效的数字码流输入声码器，故在此时可以将d/a部分设为idle状态。通过对着这个芯片的低功耗模式的操作，进一步降低了系统的功耗。 动态频率控制：这种方法的及根据预测的算法运算量的大小，动态的调整芯片的运行频率，从而达到节省功耗的目的。在本文设计的平台上运行的三种低速率语音编解码算法中，600bps、1200bps、2400bps的峰值运算量分别为37.4mips、59.2mips、44.8mips，因此将dsp的工作频率分别设置在40.096mhz、65.536mhz、49.152mhz。实验证明，这样处理能够很有效地降低dsp的内核功耗。4． 小结 该平台具有强大的语音信号处理能力，较低的功耗以及加密等特点。实践证明，该平台在其应用场合完全达到了原先的这些设计目标，具有广阔的应用前景。参考文献：[1]tms320vc5510ai datasheet(sprs076i); ti corporation; april 2004[2]using the tms320vc5510 bootloader (spra763a); ti corporation; ma
。fpga设计结构如图3所示。 图3 fpga设计结构框图 考虑到本设计所占用资源，包括逻辑单元、嵌入式存储器的多少，以达到资源充分利用，选用了altera公司的cyclone ii系列fpga ep2c20开发板，此款开发板具有512kbyte的片外ram空间，可以作为nios的程序存储器和usb接口的数据缓冲区，以保证数据的实时传输。fpga各模块设计综合后占用了15000多个逻辑单元(含niosii模块)， 占用了82%(52个m4k)的存储器位，整个系统使用65.536mhz的时钟，有效地利用了开发板的资源，结果良好。 pcb的设计 pcb的设计包含usb模块和dac模块两部分。 (1) usb模块主要是实现pc与fpga之间的高速通信，考虑到传输速度要达到300kb/s才能实现数据的实时传输，所以选用了ft245bl作为usb接口芯片。 (2) dac模块是为了将数字滤波器输出的数字信号转换成模拟信号。编码器输出的是数字的中频信号，采样频率16.384mhz，带宽1.536mhz。经过dac转成模拟信号后还需要对其放大，滤波，最后输
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