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74LS241 Octal 3-STATE Buffer/Line Driver/Lin... FAIRCHILD 74LS241PDF下载
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74LS241 Octal TRI-STATE Buffers/Line Drivers... NSC 74LS241PDF下载
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74LS241DC Dual 4-Bit Non-Inverting Buffer/Driv... ETC 74LS241DCPDF下载
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74ls241价格行情

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历史最低报价：￥0.5000 历史最高报价：￥10.0000 历史平均报价：￥2.1055

型号厂家封装批号数量日期价格
74LS241 AN DIP 2006/9/6 0:00:00 0.5000/pcs
74LS241 AN 2006/3/27 0:00:00 0.5000/pcs
74LS241 MIT 2006/9/6 0:00:00 0.8000/pcs
74LS241 AN 2006/4/25 0:00:00 1.0000/pcs
74LS241 ST DIP 2006/3/27 0:00:00 1.2000/pcs
74LS241 2006/4/25 0:00:00 1.5000/pcs
74LS241 HIT DIP 05+ 2006/4/25 0:00:00 1.5500/pcs
74LS241 PH/FSC DIP 94 2006/4/25 0:00:00 1.9000/pcs
74LS241 2005/3/28 0:00:00 10.0000/pcs

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引脚图及结构图

基于ISA总线的高速同步数据采集系统设计
s，分辨率为8位。利用高速双极工艺制造，采样速率快，频带宽，无代码遗失，输入电容小（仅为16pf），功耗低（为500mw）。ad9048内部时钟锁定比较器可使编码逻辑电路和输出缓冲寄存器作在35msps的高速，并避免了多数系统对取样保持电路（s/h）和跟踪保持电路（t/h）的需要。数字输入、输出及控制电平与ttl兼容。ad589和ad741、2n3906等构成稳压可调电路，提供给9048的rb、rt接地。ad9618作为输入缓冲放大器[3]。由于ad9048的数据输出没有三态门控制，故在输出加上74ls241作三态门控制。ad9048是否工作取决于输入转换脉冲信号，在脉冲信号上升沿取样。转换脉冲来自采样频率控制电路中的8254分频器的输出。 1.2 高速寻址对于高速数据采集系统，a/d转换应不受cpu控制。每当adc转换一次后，由控制电路发出相应的信号，将adc转换结果写入高速缓存ram某单元中，再使地址计数器加1，直到地址计数器记满后产生采样结束信号，封锁ram写信号，利用二进制地址发生器的最高位通过中断方式通知主机采样已完成。地址计数器可根据地址位数由若干同步记有选举
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四位二进制双时钟可逆计数器74ls194 ttl 四位双向通用移位寄存器74ls195 ttl 四位并行通道移位寄存器74ls196 ttl 十进制/二-十进制可预置计数锁存器74ls197 ttl 二进制可预置锁存器/计数器74ls20 ttl 4输入端双与非门74ls21 ttl 4输入端双与门74ls22 ttl 开路输出4输入端双与非门74ls221 ttl 双/单稳态多谐振荡器74ls240 ttl 八反相三态缓冲器/线驱动器74ls241 ttl 八同相三态缓冲器/线驱动器74ls243 ttl 四同相三态总线收发器74ls244 ttl 八同相三态缓冲器/线驱动器74ls245 ttl 八同相三态总线收发器74ls247 ttl bcd—7段15v输出译码/驱动器74ls248 ttl bcd—7段译码/升压输出驱动器74ls249 ttl bcd—7段译码/开路输出驱动器74ls251 ttl 三态输出8选1数据选择器/复工器74ls253 ttl 三态输出双4选1数据选

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