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DS90LV032A 3V LVDS Quad CMOS Differential Line ... NSC DS90LV032APDF下载
DS90LV032A 3V LVDS Quad CMOS Differential Line ... NSC [National Semiconductor] DS90LV032APDF下载
DS90LV032ATM 3V LVDS Quad CMOS Differential Line ... NSC DS90LV032ATMPDF下载
DS90LV032ATM 0/4 Receiver LVDS DS90LV032ATMPDF下载
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DS90LV032ATMX Line Receiver DS90LV032ATMXPDF下载
DS90LV032A MDC DS90LV032A 3V LVDS Quad CMOS Differe... National Semiconductor Corporation DS90LV032A MDCPDF下载
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历史最低报价：￥3.0000 历史最高报价：￥15.0000 历史平均报价：￥6.7500

一种从SDTV到HDTV的解决方案设计
过程中受到的干扰；需要采用差分信号传输(实际中采用了lvds信号)，输入电路板后再转换为普通ttl数字信号。根据标准［3］，差分信号的物理接口需要采用db25的形式。实际使用中，考虑成本因素，视频信号采用8bit量化方式，其数据位最低的两位不用(如图2所示)，因而图2中pin脚11、24、12、25直接悬空。 1．1．2 信号电平转换模块经db25接口输入的信号为lvds格式，必须经过电平转换变成ttl信号后才能输出给后续的模块处理。对此，在实际设计中，采用了国家半导体(ns)专用芯片ds90lv032a实现lvds到ttl信号的转换。经过接口模块后，实际输出8bit的视频数据和时钟信号(27mhz)到后续处理模块；其中，视频数据直接进入格式转换模块，而时钟信号进入锁相模块转化成两种相位锁定的时钟信号再输出到格式转换模块。 1．2 时钟锁相模块对于格式转换模块而言，输入的视频数据，其对应的时钟频率为27mhz；而根据smpte-274标准［4］，高清数字电视信号(1080i)采样时钟，即vtp芯片输出的高清数据对应时钟必须为74．25mhz。由于vtp芯片内部并未含有时钟锁相功能，

DS90LV032A
大于400Mbit/s(200MHz)开关率；0.1ns通道至通道偏斜(标准值)；0.1ns差分偏斜(标准值)；3 3ns最大传播延迟；3.3V电源设计，掉电高阻抗LVDS输入；低功耗设计(40mW、3.3V静态)；兼容现有的SVLVDS网络；接收小摆幅(350mV标准值)VID；符合ANSI/TIA/EIA-644；工业温度操作范围：－40～＋85℃；可用SOIC和TSSOP封装

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