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ad6640价格行情

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ad6640中文资料

  • 基于AD6620和AD6640的数字中频接收系统实现

    摘 要：ad6620、ad6640分别是美国adi公司推出的功能强大的数字下变频信号处理器和高速高精度a/d转换器，提出了一种基于这两块专用芯片的通用数字中频软件无线电接收系统的设计及应用方案。 关键词：软件无线电； a/d转换；数字下变频器；正交解调 引 言 软件无线电(software radio)是由jeomitola于1992年提出的。它的基本思想就是通过构建一个标准、开放、模块化的通用硬件平台，将无线通信系统中诸如调制解调、加密等各种功能利用软件编程来实现，并使宽带a/d和d/a转换尽可能靠近天线。经过多年的发展，现已取得许多瞩目的成果，它以其极强的灵活性和开放性代表着无线通信的发展趋势。 数字下变频技术（ddc）是软件无线电的技术核心之一。在传统的模拟接收系统中由于器件的固有缺陷使得模拟正交解调方法很难保证i、q两路信号具有精确的幅度一致性和相位正交性，从而降低了整机性能。近年来随着数字处理芯片技术的不断提高，出现了不少如快速傅里叶变换法、数字混频正交变换法等的数字正交解调方法，其中数字混频正交变换法与

  • 基于DDS与USB技术的通信对抗教学演示系统中硬件的设计与实现

    电子侦察模块利用高速a/d采样技术与高速fft实时处理技术可以快速地捕捉并计算出发射信号的工作频率点，同时将侦察到的跳频数据送至电子干扰模块。接收到侦察数据的干扰模块在计算机控制下利用fpga控制频率合成器件产生各种调制信号，选择不同的干扰方式对通信电台实时有效的干扰。干扰信号与实际跳频信号分别送人合路器中，由合路器送至接收机比较各种不同干扰方式的实际效果。 3器件的选择 3．1 a/d芯片与fpga芯片 a/d芯片选用的是为宽带和多信道数字无线接收机系统而推出的12位中频快速采样芯片ad6640。 ad6640是一个高速度、高性能、低功耗，单片式12位ad转换器，内含采样保持电路和基准源。他由单电源+5 v供电，ttl/cmos兼容电平输出，中频采样频率的典型值为70 mhz(多信道时)和200 mhz(单信道时)，采样速率可达65 mb/s，信噪比snr的典型值为68 db，sfdr值为80 db，功耗为710 mw。ad6640采用两级子区式的转换结构，既保证了精度又降低了功耗，其功能模块如图2所示。从图2可以看出adc所有需要的功能，包括输入缓冲，跟踪保持放大，数字纠错以及

  • 基于DDS与USB技术的通信对抗教学演示系统中

    电子侦察模块利用高速a/d采样技术与高速fft实时处理技术可以快速地捕捉并计算出发射信号的工作频率点，同时将侦察到的跳频数据送至电子干扰模块。接收到侦察数据的干扰模块在计算机控制下利用fpga控制频率合成器件产生各种调制信号，选择不同的干扰方式对通信电台实时有效的干扰。干扰信号与实际跳频信号分别送人合路器中，由合路器送至接收机比较各种不同干扰方式的实际效果。 3器件的选择 3．1 a/d芯片与fpga芯片 a/d芯片选用的是为宽带和多信道数字无线接收机系统而推出的12位中频快速采样芯片ad6640。 ad6640是一个高速度、高性能、低功耗，单片式12位ad转换器，内含采样保持电路和基准源。他由单电源+5 v供电，ttl/cmos兼容电平输出，中频采样频率的典型值为70 mhz(多信道时)和200 mhz(单信道时)，采样速率可达65 mb/s，信噪比snr的典型值为68 db，sfdr值为80 db，功耗为710 mw。ad6640采用两级子区式的转换结构，既保证了精度又降低了功耗，其功能模块如图2所示。从图2可以看出adc所有需要的功能，包括输入缓冲，跟踪保持放大，数字纠错以及

  • 中频数字化接收机系统设计与实现

    为：-50～-10dbm/50ω。 2 中频数字化单元设计该单元是接收机的核心部件，主要完成几种信号(am、fm、ssb、cw、fsk、bpsk，qpsk)的解调工作，同时负责对模拟前端提供agc控制用电平强度值和afc控制用载波频率误差值。8031主控电路板则要为中频数字化单元提供：信号类型、中频带宽、agc时间常数、bfo值、psk信号波特率等控制命令。中频数字化处理单元硬件系统大体构成如图2所示1。 2.1 数据采集部分该部分电路主要由数控放大器和模/数转换器ad6640构成，负责完成数据采集工作。固定增益放大器18db的中频输入信号为：(21.4mhz，-50～-10dbm/50ω 0.7mv～70mv)，输出为(-38dbm～+2dbm/50ω2.8mv～0.4v)。ad6640是ad公司生产的新一代模数转换器件，分辨率12bit，输入动态范围±1v，采样速率可达65msps，在5v供电时功耗仅为710mw。注意a/d前采用固定增益放大电路，并不影响对模拟接收机的agc输出。因该放大电路的增益是已知的，检测出信号电平后可以倒推出放大前的电平变化情况。至于采

  • 基于FPGA的DS/CDMA解扩解调模块设计与实现

    与干扰的情况下，该系统的输入信号=，经正交下变频到基带： 将上式中各相关运算项分别记作： 2 基于fpga来设计cdma解扩解调的过程无线soc开发 平台499元 s3c4 设备实现基于第三代移动通信系统实现的关键技术基础，采用大规模fpga作为设备实现的硬件平台，可作为直接序列扩频/码分多址信号接收的通用处理平台。拟定cdma解扩解调模块的总体方案框图如图2.1所示。 中频agc单元控制70mhz中频输入信号的输入能量，经器件ad6640采样后送入fpga信号处理模块进行数字下变频到i/q路基带，再将i/q路基带信号送入并行检测模块进行用户检测；并行检测模块采用大规模可编程逻辑器件altera公司的ep2c70f672来实现，主要是通过并行匹配滤波器来完成搜索范围之内的pn码，被检测出来的pn码再反馈送入fpga信号处理模块进行解扩解调处理。fpga信号处理模块采用altera公司的ep2s60f672来实现，该部分由16个模块组成，每一个模块都可以完成地址码捕获与跟踪、相关解扩、相位估计、基带解调等功能，输出维特比软判决数据信

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