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基于FPGA的IIR数字滤波器的快捷设计
3 滤波器matlab设计的fpga实现下面以一个简单的低通滤波器设计实例来说明从matlab设计到fpga实现的整个过程。该低通滤波器的系统采样频率为40 mhz，通带截止频率为1 mhz，阻带截止频率为5 mhz，通带内最大衰减为3 db，阻带内最小衰减为40 db，而对相位不作要求。而其硬件平台上的主要器件有xilinx公司的spartan2e系列30万门fpga芯片xc2s300e及prom器件xc18v04，模数转换芯片则采用ad公司的ad9218，数模转换芯片选用ad公司的ad9765，另外，还有40 mhz晶振等。其系统框图如图1所示。 3.1 matlab设计 matlab设计的具体代码如下：这样，在运行之后，便可得到：图2是由系数b和a绘出的幅频特性曲线。下面是递推算法的matlab描述：若以输入分别为0.5 mhz、3 mhz、6 mhz的正弦波来测试滤波器输出，则可得出如图3所示的仿真结果。可见，该系数b和a可以满足低通滤波器的技术指标。
CDMA2000基站系统中基带分配卡的设计与实现
2s同步信号分发给各mcc卡和bbx。bdc根据需要对相关信号提供差分驱动以及电平转换。2.4 bdc备份设计时，bdc卡考虑备份，主、备两个bdc通过三态门插入背板总线，同一时刻只有一个bdc卡在工作，三态门的控制由amr根据报警情况来设置完成。当工作中的bdc卡出现故障时，将立即报警，然后amr通过报警情况，马上改变三态门的设置，启用另一个bdc卡。这种关键部件采用备份设计的思想，可大大提高系统的安全性和可靠性。3 bdc卡的硬件实现根据上述设计方案，选择apex20k100、ad9058、ad9765和ad9632作为该基带分配卡的主要部件。其单个扇区的硬件框图如图4所示。图4中，apex20k100是altera公司推出的一种可编程逻辑器件，它具有规模大、时间可预测性好等优点。ad9058是adi公司推出的一种双通道、高性能8bit模-数转换器（adc）。采样时钟频率可达50msps，其独特的结构参考电压，能驱动两片adc。ad9765是一种双端口、高速率、双通道、12bit的cmos数模转换器（dac）。它在很小的48路lqfp包中集成了2个高性能的12bit txdac和磁心，1个电压
基于FPGA的OFDM系统研究
宽，因此每个子信道上的可以看成平坦性衰落，从而可以消除符号间干扰。而且由于每个子信道的带宽仅仅是原信道带宽的一小部分，信道均衡变得相对容易。本文基于802.16a协议的原理架构，建立了一个基于fpga的可实现流水化运行的ofdm系统的硬件平台，包括模拟前端及ofdm调制器及ofdm 解调器，用来实现ofdm的远距离无线传输系统。 1 模拟前端模拟前端主要包括发送端da模块、接收端ad模块和射频模块。发送端da模块主要由xilinx公司的fpga－xc2v1000芯片和数模转换芯片ad9765、滤波器和放大器构成，基带处理调制后数据在控制时钟同步下送入fpga进行降峰均比等算法的处理，然后经过交织将其送入ad9765进行数模转换并上变频到70mhz，输出的模拟信号再经声表滤波器后放大进入下一级射频模块。发送端da模块硬件结构框图如图1所示。接收端ad模块主要由增益放大器、带通滤波、采样芯片ad9238和数字下变频器gc1012构成。ad模块的主要功能是完成中频信号的采样和数字下变频，在fpga xc2v1000中完成符号同步算法，其输出送ofdm解调器。接收端ad模块硬件结构
基于FPGA的IJF数字基带编码的实现
他是随输入数据变化的随机序列，其波形可视为4个基本波形的组合，即：由此可得出非线性转换滤波器ijf编码信号形成的方案，如图1所示。 3 ijf编码的fpga实现首先给出一个ijf－oqpsk调制器的组成原理框图如图2所示。其中的串并变换、延时、差分编码和ijf编码采用xilinx公司的fpga器件spartanii xc2s200来实现。i，q两支路经ijf编码成形的数据通过数/模转换器ad9765转换为模拟幅值送入正交调制器ad6122后得到70mhz中频的ijf－oqpsk调制信号。有上述的分析可以看出，ijf－oqpsk调制的关键在于ijf编码。下面重点讨论ijf编码的fpga实现方法。由式（9）和图1可看出，ijf编码的过程就是根据前后码元的组合关系去波形系数表中查表，以一定的采样时钟取得相应的波形系数从而实现波形成形。因此首先需要建立波形系数表。假设原始输入数据信息速率为2mb/s，经过串并转换后i，q支路码速率为1mb/
基于FPGA+DSP的雷达回波发生器设计
件实现简单，只要改变底层软件而不用更改硬件电路就可以适应不同体制的雷达，因而这种方法具有较好的灵活性和通用性； (3)对外具有丰富的接口，既可以当作一块独立的板卡使用，也可以在cpci机箱上作为标准板卡使用； (4)利用其丰富的底层软件库，可以提供良好的二次开发空间。 2 系统硬件设计雷达回波发生器在硬件实现时，fpga选用xilinx公司virtex-4系列的xc4vsx55芯片， dsp选用ti公司的tms320c6416芯片，数模转换器和放大器分别选用adi公司的ad9765和ad8044，时钟选用adi公司的超低抖动时钟icad9510，时钟配置电路选用altera公司max7000s/ae系列的epm7128s。sx55是xilinx公司的一款高性能数字信号处理fpga，具有强大的数据处理能力。主要硬件资源为49 152个slice(含一个触发器及一个四输入查找表)，320个block ram(每块18 kb)，512个18×18 bit乘法器，8个dcm，32条全局时钟连线，640个可用i/o。tms320c6416是ti公司的一款高性能定点数字信号处理器，最

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