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收端的电源均由测试台提供,电压为+9 v。 lvds长线传输模块分为lvds发送电路和lvds接收电路。lvds发送电路将从记录器接收到的并行数据进行速度匹配后转换成lvds串行数据流,并通过双绞线发送。lvds接收电路将接收到的lvds串行数据流还原成并行数据进行速度匹配后送至测试台。 4 硬件设计 该系统设计的关键部分为lvds的接口设计,由于传输数据速度很高,因此应按照高速电路的要求进行设计,所有布线应尽量短,传输线路阻抗匹配。传输模块发送端工作时首先由fpga给ds92lv1021的使能端den及tclk-r/f触发沿选择高电平,并向tclk引脚输出20 mhz的工作时钟,接着ds92lv1021将从fpga处接收到的ttl并行信号转换为lvds标准的串行信号,再由do一及do+输出至clc001驱动器,经电光转换后,由光缆传输至接收板电路,并由接收电路的光电转换器送至clc012,从而补偿已衰减的信号,再由ds92lv1212解串器还原出10位并行数据及l位时钟位。图2为发送电路原理图。 传输模块接收端主要由clc012均衡器及ds92lv1212解串器组