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芯片能否正常工作，某些引脚处理不当往往会引起芯片工作不正常或死机。在图1中，9052左上方的信号和pci信号相连，左下方信号和串行eeprom相连，右边的信号和局部总线信号相连，也就是和isa总线信号相连。 pci端主要信号完全符合pci规范要求，直接和pci总线上对应的引脚相连即可。 isa端连接如下：在我们的板卡中由于只涉及到i／o，且为16位宽的数据，因此，memwr＃、memrd＃、sbhe＃和bale信号可以不用。 lad〔15：0〕是16位的数据总线。la〔23：2〕和isaa〔1：0〕共同组成isa的地址总线，对于8位的数据总线，isaa〔1：0〕相当于la〔1：0〕，它们一起进行地址译码。而对于16位的数据线，每次读写两个字节，这时isaa〔0〕不用，isaa〔1〕和la〔23：2〕一起进行地址译码。需要注意的是，并不是所有的地址线都要进行地址译码，这里要根据板卡上实际i／o口空间的大小选择译码地址线的数目。对于我们的板卡，la〔3：2〕和isaa〔1〕地址译码是必需的（isaa〔1〕为低位），当然，所有的地址线都参加地址译码也是可以的。 iowr＃
i信号相连，左下方信号和串行eeprom相连，右边的信号和局部总线信号相连，也就是和isa总线信号相连。 pci端主要信号完全符合pci规范要求，直接和pci总线上对应的引脚相连即可。 isa端连接如下： 在我们的板卡中由于只涉及到i／o，且为16位宽的数据，因此，memwr＃、memrd＃、sbhe＃和bale信号可以不用。 lad〔15：0〕是16位的数据总线。la〔23：2〕和isaa〔1：0〕共同组成isa的地址总线，对于8位的数据总线，isaa〔1：0〕相当于la〔1：0〕，它们一起进行地址译码。而对于16位的数据线，每次读写两个字节，这时isaa〔0〕不用，isaa〔1〕和la〔23：2〕一起进行地址译码。需要注意的是，并不是所有的地址线都要进行地址译码，这里要根据板卡上实际i／o口空间的大小选择译码地址线的数目。对于我们的板卡，la〔3：2〕和isaa〔1〕地址译码是必需的（isaa〔1〕为低位），当然，所有的地址线都参加地址译码也是可以的。 i
52与pci插槽间的连接信号线。这些信号包括地址数据复用信号ad31：0，总线命令信号c/be3：0＃和pci协议控制信号par、frame＃、irdy＃、trdy＃、stop＃、idsel、devsel＃、perr＃、serr＃。第二部分是与串行eeprom的连线。这里有四根信号线：eesk、eedo、eedi和eecs，串行eeprom的数据可以提前用烧写器烧好，也可以在线烧写。第三部分是9052与应用电路的连接。在本例中主要用到的是isa局部总线信号，有数据线lad7：0，地址线isaa1：0、la23：2，i/o读写信号线iowr＃、iord＃，地址锁存bale。2.2.2 软件设计程序分为两部分，一部分为pci9052各配置寄存器赋值并初始化芯片，另一部分为主程序，任务是不断查询注册表中的相关键值，一旦条件满足，即向端口送控制码。程序用delphi语言完成。选用delphi的 主要原因是可编译成独立的可执行文件，不带任何动态连接库，程序短小精悍，并且delphi各版本间的兼容性比较好。程序流程图如图2所示。 来源:零八我的爱
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