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简易USB与LVDS接口转换器
便可实现双视频显示的连接，进一步扩展两种接口的使用范围，从而在一定程度上解决主板插槽与端口日益匮乏的问题。 2 系统概述该系统设计主要由稳压电路，usb接口，基于fpga的协议数据转换以及lvds接口等部分组成，其系统设计框图如图1所示。该系统设计的usb接口使用高速usb物理层收发器usb3300将usb协议的差分信号转换成8位的并行信号后，再与fpga交互数据，从而避免fpga直接与usb协议的物理层交互数据，简化fpga可编程门阵列编程。基于同样思想，系统lvds接口部分采用sn65lv1023与sn62lv1224，将低压差分信号转换成 10位的并行信号再与fpga进行数据交互。通过专用转换器usb3300，sn65lv1023，sn65lv1224使得fpga只与并行信号和相应的控制信号连接，而不与usb协议和lvds协议的复杂物理层信号交互，从而较为简单地实现协议数据转换的软件编程。系统设计使用两片usb3300，其中usb3300 a与主机pc的usb接口相连，将主机传输的usb协议数据转换后，通过与fpga的数据交互以及fpga的协议数据转换，转换成10位并行信号
FPGA处理器在数字光端机系统中的应用
引脚1（db13）：最高输入有效数据位；引脚2~13（db12~db1）：数据输入端；引脚14（db0）：最低输入有效。 4 并串/串并模块低压差分信号是由ansi/tia/eia-644-1995定义的用于高速数据传输的物理层接口标准（lvds）。它具有超高速（速率可达1.4gb/s）、超低功耗和低电磁辐射等特性，因而是在铜介质上实现千兆位速率通信的优选方案。而总线形低压差分信号lvds是lvds技术在多点通信领域的扩展，它要求有更大的驱动电流（10ma）和更好的阻抗匹配设计。 sn65lv1023和sn65lv1224是ti公司推出的10位总线型低压差分信号的应用芯片组。其中sn65lv1023是可将10位并行cmos或ttl数据转换为具有内嵌时钟的高速串行差分数据流的串化器；而sn65lv1224则是接收该差分数据流并将它们转换为并行数据的解串器，它同时又可以重建并行时钟。采用该器件组进行数据串化时采用的是内嵌时钟，这样可有效地解决由于时钟与数据的不严格同步而制约高速传输的瓶颈问题。此处的硬件电路设计如图4所示。图4 并串转化硬件示意图系统软件设计系统软件主要是对系统控制

SN65LV1023ADB的技术参数
产品型号:SN65LV1023ADB
并行输出数:－
并行输入数:10
数据吞吐量(Mbps):660
串行数据接收通道:－
串行数据发送通道:－
线路类型:LVDS
驱动(RL)(Ω):27
工作电压(V):3.300
接收tpd(ns):－
工作电流ICC(mA):55
P...

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