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IDT79RC32T355-180DH Datasheet

  • IDT79RC32T355-180DH

  • IDT Interprise Integrated Communications Processor

  • 991.93KB

  • 47页

  • IDT

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IDT 79RC32355
133MHz
Reference
Edge
Min Max
150MHz
Min
Max
180MHz
Min
Max
Timing
Diagram
Reference
Signal
Symbol
Unit
Conditions
Memory and Peripheral Bus - Device Access
MDATA[31:0]
Tsu1
Thld1
Tdo1
Tdz1
Tzd1
WAITACKN, BRN
Tsu
Thld
MADDR[21:0]
Tdo2
Tdz2
Tzd2
MADDR[25:22]
Tdo3
Tdz3
Tzd3
BDIRN, BOEN[0]
Tdo4
Tdz4
Tzd4
BGN, BWEN[3:0], OEN,
RWN
Tdo5
Tdz5
Tzd5
CSN[3:0]
Tdo6
Tdz6
Tzd6
CSN[5:4]
Tdo7
Tdz7
Tzd7
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Figure 11
Figure 12
Table 6 Memory and Peripheral Bus AC Timing Characteristics (Part 2 of 2)
Note:
The RC32355 provides bus turnaround cycles to prevent bus contention when going from a read to write, write to read, and during
external bus ownership. For example, there are no cycles where an external device and the RC32355 are both driving. See the chapters
鈥淒evice Controller,鈥?鈥淪ynchronous DRAM Controller,鈥?and 鈥淏us Arbitration鈥?in the RC32355 User Reference Manual.
20 of 47
May 25, 2004

IDT79RC32T355-180DH 产品属性

  • 24

  • 集成电路 (IC)

  • 嵌入式 - 微处理器

  • Interprise™

  • RISC 32-位

  • -

  • 180MHz

  • 2.5V

  • 表面贴装

  • 208-BFQFP

  • 208-PQFP（28x28）

  • 托盘

  • 79RC32T355-180DH

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