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IDT79RC32T355-180DH Datasheet

  • IDT79RC32T355-180DH

  • IDT Interprise Integrated Communications Processor

  • 991.93KB

  • 47页

  • IDT

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IDT 79RC32355
133MHz
Reference
Edge
Min Max
150MHz
Min
Max
180MHz
Min
Max
Timing
Conditions Diagram
Reference
Signal
I
2
C
1
SCLP
Symbol
Unit
Frequency
Thigh1
Tlow1
Trise1
Tfall1
none
0
4.0
4.7
鈥?/div>
鈥?/div>
100
鈥?/div>
鈥?/div>
1000
300
鈥?/div>
3.45
1000
300
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鈥?/div>
鈥?/div>
鈥?/div>
400
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鈥?/div>
300
300
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0.9
300
300
鈥?/div>
鈥?/div>
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0
4.0
4.7
鈥?/div>
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250
0
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鈥?/div>
4.7
4.0
4.0
4.7
0
0.6
1.3
鈥?/div>
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100
0
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鈥?/div>
0.6
0.6
0.6
1.3
100
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鈥?/div>
1000
300
鈥?/div>
3.45
1000
300
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400
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300
300
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300
300
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0
4.0
4.7
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4.7
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4.0
4.7
0
0.6
1.3
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鈥?/div>
100
0
鈥?/div>
鈥?/div>
0.6
0.6
0.6
1.3
100
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鈥?/div>
1000
300
鈥?/div>
3.45
1000
300
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鈥?/div>
鈥?/div>
鈥?/div>
400
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鈥?/div>
300
300
鈥?/div>
0.9
300
300
鈥?/div>
鈥?/div>
鈥?/div>
鈥?/div>
kHz
碌s
碌s
ns
ns
ns
碌s
ns
ns
碌s
碌s
碌s
碌s
kHz
碌s
碌s
ns
ns
ns
碌s
ns
ns
碌s
碌s
碌s
碌s
100 KHz
Figure 18
SDAP
Tsu2
Thld2
Trise2
Tfall2
SCLP rising
250
0
鈥?/div>
鈥?/div>
Start or repeated start condition
Stop condition
Bus free time between a stop and
start condition
SCLP
Tsu3
Thld3
Tsu4
Tdelay5
Frequency
Thigh1
Tlow1
Trise1
Tfall1
SDAP falling
SDAP rising
4.7
4.0
4.0
4.7
none
0
0.6
1.3
鈥?/div>
鈥?/div>
400 KHz
SDAP
Tsu2
Thld2
Trise2
Tfall2
SCLP rising
100
0
鈥?/div>
鈥?/div>
Start or repeated start condition
Stop condition
Bus free time between a stop and
start condition
1.
Tsu3
Thld3
Tsu4
Tdelay5
SDAP falling
SDAP rising
0.6
0.6
0.6
1.3
Table 13 I
2
C AC Timing Characteristics
For more information see the I
2
C-Bus specification by Philips Semiconductor
34 of 47
May 25, 2004

IDT79RC32T355-180DH 产品属性

  • 24

  • 集成电路 (IC)

  • 嵌入式 - 微处理器

  • Interprise™

  • RISC 32-位

  • -

  • 180MHz

  • 2.5V

  • 表面贴装

  • 208-BFQFP

  • 208-PQFP（28x28）

  • 托盘

  • 79RC32T355-180DH

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