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TMS320VC5416GGU160 Datasheet

  • TMS320VC5416GGU160

  • TMS320VC5416 Fixed-Point Digital Signal Processor

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TMS320VC5416
Fixed-Point Digital Signal Processor
SPRS095O 鈥?MARCH 1999 鈥?REVISED JANUARY 2005
Table 5-21. McBSP Transmit and Receive Switching Characteristics
(1)
5416-120
5416-160
MIN
t
c(BCKRX)
t
w(BCKRXH)
t
w(BCKRXL)
t
d(BCKRH-BFRV)
t
d(BCKXH-BFXV)
t
dis(BCKXH-BDXHZ)
Cycle time, BCLKR/X
(2)
Pulse duration, BCLKR/X
high
(2)
Pulse duration, BCLKR/X low
(2)
Delay time, BCLKR high to internal BFSR valid
Delay time, BCLKX high to internal BFSX valid
Disable time, BCLKX high to BDX high impedance following last data
bit of transfer
DXENA = 0
t
d(BCKXH-BDXV)
Delay time, BCLKX high to BDX valid
DXENA = 1
t
d(BFXH-BDXV)
(1)
(2)
(3)
(4)
(5)
Delay time, BFSX high to BDX valid
ONLY applies when in data delay 0 (XDATDLY = 00b) mode
BCLKR/X int
BCLKR/X int
BCLKR/X int
BCLKR int
BCLKR ext
BCLKX int
BCLKX ext
BCLKX int
BCLKX ext
BCLKX int
BCLKX ext
BCLKX int
BCLKX ext
BFSX int
BFSX ext
鈥?1
(5)
3
鈥?1
(5)
3
鈥?
(5)
3
4P
(3)
D鈥?/div>
1
(4)
鈥?
0
鈥?
3
D+
1
(4)
3
6
5
11
6
10
10
20
20
30
7
11
ns
ns
C 鈥?1
(4)
C + 1
(4)
MAX
ns
ns
ns
ns
ns
ns
ns
PARAMETER
UNIT
CLKRP = CLKXP = FSRP = FSXP = 0. If the polaritiy of any of the signals is inverted, then the timing references of that signal are also
inverted.
Note that in some cases, for example when driving another 54x device McBSP, maximum serial port clocking rates may not be
achievable at maximum CPU clock frequency due to transmitted data timings and corresponding receive timing requirements. A
separate detailed timing analysis should be performend for each specific McBSP interface.
P = 0.5 * processor clock.
T = BCLKRX period = (1 + CLKGDV) * 2P
C = BCLKRX low pulse width = T/2 when CLKGDV is odd or zero and = (CLKGDV/2) * 2P when CLKGDV is even
D = BCLKRX high pulse width = T/2 when CLKGDV is odd or zero and = (CLKGDV/2 +1) * 2P when CLKGDV is even
Minimum delay times also represent minimum output hold times.
t
c(BCKRX)
t
w(BCKRXH)
t
w(BCKRXL)
BCLKR
t
d(BCKRH-BFRV)
t
d(BCKRH-BFRV)
BFSR (int)
t
su(BFRH-BCKRL)
t
h(BCKRL-BFRH)
BFSR (ext)
t
su(BDRV-BCKRL)
BDR
Bit(n-1)
t
h(BCKRL-BDRV)
(n-2)
(n-3)
t
r(BCKRX)
t
f(BCKRX)
Figure 5-21. McBSP Receive Timings
Electrical Specifications
79

TMS320VC5416GGU160 产品属性

  • 160

  • 集成电路 (IC)

  • 嵌入式 - DSP（数字式信号处理器）

  • TMS320C54x

  • 定点

  • 主机接口，McBSP

  • 160MHz

  • ROM（32 kB）

  • 256kB

  • 3.30V

  • 1.60V

  • -40°C ~ 100°C

  • 表面贴装

  • 144-LFBGA

  • 144-BGA MICROSTAR（12x12）

  • 托盘

  • 296-15829-ND - DSP STARTER KIT FOR TMS320C5416

  • 296-11660296-11660-5296-11660-5-ND

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