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道校验方式可单独定义为奇校验或偶校验，数据发送可以选择单帧发送或自动重复发送（重复发送某一帧）。 整个接口板由调制电路、解调电路、fpga、dsp和双口ram组成，如图2所示。 图2 接口板硬件结构图 3 硬件电路设计 3.1 调制解调电路设计 429信号进入接口板后，首先要把429信号转换为数字电路可以识别的ttl电平。这里采用holt公司的hi-8482实现信号的解调，将标准的429总线信号转换成5v ttl数字信号。为了降低干扰，在429总线信号的四个输入管脚分别接入39pf的高精度军品电容；采用holt公司的hi-8585芯片实现信号的调制，将ttl数字电平转换为标准的429信号。 3.2 fpga内部逻辑设计 按照429信号的编码格式、特点、传输规则以及协议要求，选用一片altera公司的acex1k型的fpga发送和接收四路数据。每一路分为接收部分和发送部分。 接收部分的主要作用是通过串/并转换将串行数据转换为32位并行数据，并对收到的数据自动实行差错控制。对于字间隔、位间隔出错等错误能进行自动检测，若无错误，则将数据分两次送至dsp的16位数据总
4mhz。fs/2 * 4=128mhz 146-128=18mhz 输入匹配 模数转换器的负载总是难以设计。 通常情况下都有高输入阻抗和较大而且可变的容抗。同时，开关电容或者采样保持电路会产生电流尖峰。这些原因导致adc输入很难匹配，必须使用放大器。差分放大器的输出级能消除电流尖峰同时为精确采样提供低阻抗源。图3中是驱动adc的典型电路。两个56 ω 的电阻用来隔离adc的容性负载和放大器来确保稳定。同时，这些电阻也是低通滤波器的一部分，用来提供抗混叠滤波和削弱噪声的功能。两个39pf的电容用来消除由于adc内部开关电路引起的电流尖峰，同时也是adc输入的低通滤波器的关键部件。在图3的电路中，滤波器的截止频率是1/ (2*p*56w *(39 pf + 14pf))=53mhz(比采样频率略低)。注意adc的输入电容在计算滤波器频率响应的时候必须要考虑，如果是差分输入的话有效输入电容的值要加倍。同时，正如在图3中显示的，许多adc的输入电容是adc转换过程(采样保持电路)的一部分。 图3 驱动adc。lmh6550驱动adc12lo66 和所有的高速电路
能与pc连用的调频广播电路 如图为能与pc连用的调频广播电路图。该电路中一些电器元件的数值：r1：47kω；r2：22kω；r3：100kω；r4：39kω；r5：47ω；r6~r12：5kω；r13~r21：15kω；c1：39pf电容；c2：47pf电容；c3：2nf电容；c4，c14：220nf电容；c5：22nf电容；c6：10nf电容；c7，c18：180pf电容；c8：150pf电容；c9：100nf电容；c10，c13：330pf电容；c11：220pf电容；c12，c16：3300pf电容；c15，c17：1800pf电容；c19，c21，c22：10mf电容；c20：10nf电容；c23：47mf电容；c24，c25：470mf电容；ic1：tda7000；ic2：lm7805；ic3：lm386；s1开关。 来源:lidy
用于浮点变换的增益可编程缓冲放大器如下图所示，opa676的a、b通道的选通由12脚ttl逻辑电平控制。a通道增益为2，b通道增益为8。opa676采用±5供电，并由两只钽电容去耦，10kω电位器调零，39pf电容进补偿。该电路可以与12位10mhz模/数转换电路adc603接口。 来源:耕在此行
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