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历史最低报价：￥5.0000 历史最高报价：￥20.0000 历史平均报价：￥14.5000

基于ADSP-BF533的数字通信信号发生器设计与实现
部ram，并根据干信比在内部ram中进行幅度加权，然后和噪声叠加，再通过ppi dma输出到dac2来产生干扰与噪声的混合波形。其中ppi时钟ppi_clk信号均由各dsp的定时器产生。两个dac的位数是14位，并且设置为4倍插值方式，即dac输入数据率为10msps，输出转换速率为40msps。dac转换需要的时钟与ppi_clk共用，dac连接在bf533ppi总线的低14位ppi13～ppi0。基带码流通过dspl的ppi15引脚输出，同步信号通过dsp1的ppi14引脚输出，经过74ac11244驱动输出波形。 dac输出的模拟信号后经过ad8054缓冲放大，再经信号和噪声合成后分为两路，可作为测试波形和信号源。若需要模拟通信信号环境，需要在微型计算机中计算多种信号的叠加数据，然后传送到通信／通信信号环境数据存储器(sdram1)中，其它过程均与通信方式相同。此模式下不能测试基带码流，但仍可测试同步信号。 3系统软件设计系统中的微型计算机采用windows 2000／xp操作系统，其usb驱动程序由ddk开发，控制应用程序可通过vs2005进行开发。计算机可根

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