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更重要的是96mhz是该电路能测量的最高频率。确了稳定性和fm调制两个目的，振荡器由一个变容二极管控制频率微调。变容二极管的电容量由加在它上面的偏置电压定。这个偏置电压由两个分量控制。12位 dac提供的直流电平和一个交流信号双重作用在变容二极管上以实现频率调制。dac的输出电压初始值设置在中间值（2v），通过手动调整可变电容（微调）把振荡器调到指定的频率，其後微控制器会稍微上下调整dac的输出电压来稳定这个频率。要用微控制器测量振荡器的频率必须先把它进行16预分频。这可由普通的74f161 4位分频器完成。预分频输出大概在5～6mhz频率范围，这个频率可以用微控制器的16位计数器/定时器进行计数。确了确定振荡频率,先把16位计数器清零，经过设定的时间间隔之後再把它的值读出来。设定时间间隔由微控制器中另一个计数器/定时器编程控制，每5.461ms周期中断一次。这样16位计数器中的值可以这样计算∶ counter/timer value=(fosc/16)×(5.461×10-3) 实际操作时微控制器读出16位定时器的值把它与用你选择的频率代人上述方程计算出来的
利用光纤发射/接收器对实现远距离高速数据采集
被送到存储器总线上的数据在接收与存储控制器产生的写脉冲/iwr作用下，存储在相应的存储单元中。数据接收与存储控制器由cpld复杂可编程逻辑器件epm7128s的一部分（另一部分作控制接口设计）设计而成，通过编程实现如下电路功能： ·同步移位脉冲计数器； ·7路数据起始与终止位同步校验； ·写脉冲/iwr形成； ·存储器地址a0～a15发生器； ·存储地址计数脉冲atrr形成； ·同步信息检测与同步控制。接收器与发送器的数据同步由74f161计数器与cpld的内部逻辑电路组成同步信息检测器，对同步传输光路传输业的移位时钟进行检测并实现同步控制。74f161计数器计数时钟由osc2提供，频率与发送时钟频率相一致，由32mhz有源晶振产生。计数器的清零输入来自经cpld内部反相器反相的sclk，同步时序见图5的接收与存储时序部分。在数据移位期间，每来一个移位时钟脉冲，计数器就清一次零。而在每个移位脉冲的周期内，计数器的计数时钟输入端有同数。从理论分析，它有两种情况：第一种飞速是计数脉冲的上升沿在复位脉冲的低电平时出现，计数器因处于复位状
高速任意波形发生器的设计
图3所示。 1．2 任意波形产生电路的设计如图4所示，一个完整的任意波形产生电路主要由时钟发生电路、地址计数器、波形存储器、锁存器、奇偶数据选择电路以及d／a转换器构成。时钟发生电路用于产生任意波形发生器所需的可变时钟，通常可以由单片机控制的锁相环电路构成，在实际设计中采用锁相环集成电路，产生最高频率为100 mhz的时钟信号，时钟电路的输出信号送往地址计数器的时钟输入端，以驱动地址计数器扫描波形存储器中的数据，地址计数器采用15位二进制同步计数器，逻辑上等同于4片74f161级联，地址计数器输出的15位地址数据与波形存储器的地址输入端相连，波形存储器使用四片32 k×8(读写速度为12 ns)的sram级联成32 k×32的sram阵列，sram阵列输出端的32比特数据中，24比特为波形数据，2比特为控制信号，其余6比特数据线不使用。每个波形点分辨率为12比特，每个地址存放两个波形点的数据，单片段任意波信号最长可达64 k个点，2个控制信号分别为停止位、同步位，停止位数据线通过d触发器与地址计数器的预置数控制端端相连，当检测到扫描至最后一个波形地址时，停止位将地址计

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