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如图所示是由双上升沿j-k触发器74hc109与双下降沿j-k触发器74hc113组成的三分频电路,利用该电路可以得到对称的分频输出。 三分频电路 在电路图中,在一般的利用常规计数器对数字脉冲进行奇数分频时,即使输入是对称信号,输出也得不到占空比为50%的分频输出,其原因是内部触发器采用的是统一的上升沿(或下降沿)进行触发。在本例中,利用j-k触发器d1、d2分别由不同的时钟沿触发这一特性,将dl、d2与d4结合起来可以得到占空比为50%的分频输出。再与d3组合,就可以构成对称输出的三分频电路。 来源:chusi
inverters 六路反向器74hc05 hex inverters open drain 六路反向器74hc08 2-input and gates 双输入与门74hc107 j-k flip-flop with clear j-k触发器74hc109a j-k flip-flop w/preset j-k触发器74hc11 triple 3-input and gates 三输入与门74hc112 dual j-k flip-flop 双j-k触发器74hc113 dual j-k flip-flop preset 双jk触发器74hc123a retriggerable monostab 可重触发单稳74hc125 tri-state quad buffers 四个三态门74hc126 tri-state quad buffers 六三态门74hc132 2-input trigger nand 施密特触发与非门74hc133 13-input nand gates 十三输入与非门74hc137 3-to-8 decoders w/latc