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如图所示电路是由4位二进制同步加/减计数器74hc193、双上升沿d触发器74hc74以及四2输入端与非门74hc00等组成的光电编码器鉴相计数电路,该电路能对光电编码器输出的信号进行鉴相和双向计数。 光电编码计数电路 该电路包括鉴相电路和计数电路两部分,其中,鉴相电路由d触发器74hc74和2个与非门构成,计数器由三片74hc193构成。 当编码器开始沿顺时针方向旋转时,a、b通道的输出波形会产生一个90°的相位差,d触发器输出端q输出高电平,计数脉冲通过d1加至74hc193的加计数时钟输入端,计数器开始进行加计数。当编码器开始沿逆时针方向旋转时,a、b通道的输出波形会产生一个-90°的相位差,d触发器输出端/q输出高电平,计数脉冲通过d2至74hc193的减计数时钟输入端,计数器开始进行减计数。 来源:xiangxueqin
如图所示是由74hc193四位二进制计数器、稳压二极管、运算放大器与电阻等构成的阶梯波信号发生器电路。通过该电路的设计,可以得到阶梯波信号。 阶梯波信号发生器电路 在图中,74hc193输出端接有r-2r(15k-7.5k)电阻梯形网络,构成四位d/a转换器。第15级的电压是将5v电源电压全部加在梯级上的值,即5v×15/1*.6875v,每一级的电压为312.5mv。为了使最大输出为10v,经运算放大器a1将其放大2倍,若每级平均电压在使用中不合适,调节器pr1调节输出端电压大小,也可在输出端进行分压。 来源:zhanbanbanzhan
lip-flop w/clear 六d触发器74hc175 hex d flip-flop w/clear 六d触发器74hc181 arithmetic logic unit 算术逻辑单元74hc182 look ahead carrygeneratr 进位发生器74hc190 binary up/dn counter 二进制加减计数器74hc191 decade up/dn counter 十进制加减计数器74hc192 decade up/dn counter 十进制加减计数器74hc193 binary up/dn counter 二进制加减计数器74hc194 4bit bi-dir shift 4位双向移位寄存器74hc195 4bit parallel shift 4位并行移位寄存器74hc20 quad 4-input nand gate 四个四入与非门74hc221a non-retrig monostab 不可重触发单稳74hc237 3-8 line decoder 地址锁3线至8线译码器74hc242/243 tri-stat transceiver 三态收